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con VHDL..
SEMANA 13
Sentencias concurrentes:
WHEN … ELSE
Sentencia de selección múltiple. En
hardware es necesario incluir todas las
opciones posibles. En este caso es
obligatorio siempre acabar la expresión
con un ELSE.
https://es.wikibooks.org/wiki/Programaci%C3%B3n_en_VHDL/Arquitectura
3
Recordemos la sesión anterior
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CAPACIDAD TERMINAL
LOGRO DE LA SESION
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Contenidos de la sesión:
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PROCESOS
13
EJEMPLO
PROCESOS
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PULSERA ANTIESTATICA
Es un elemento de protección que
se utiliza como un brazalete que
se coloca alrededor de la muñeca,
dotado de un cable con una
pinza que se fija a tierra, con el fin
de mantenernos descargados y
evitar que los componentes se
dañen.
CIRCUITOS SECUENCIALES
FINITE STATE MACHINES
Introduction
In combinational circuits, the output depends on the current values of inputs only;
whereas in sequential circuits, the output depends on the current values of the
inputs along with the previously stored information. In the other words, storage
elements, e.g. flip flogs or registers, are required for sequential circuits. The
information stored in these elements can be seen as the states of the system. If a
system transits between finite number of such internal states, then Finite State
Machines (FSM) can be used to design the system.
https://vhdlguide.readthedocs.io/en/latest/vhdl/fsm.html
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DISEÑO DE SISTEMAS SECUENCIALES SÍNCRONOS
• En la estructura de Mealy, las señales de • En la estructura de Moore, la señal de
salida dependen tanto del estado en que salida sólo depende del estado en que se
se encuentra el sistema, como de la encuentra.
entrada que se aplica en determinado
momento.
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DISEÑO DE SISTEMAS SECUENCIALES SÍNCRONOS
Un sistema secuencial se desarrolla a través de una serie de pasos generalizados que
comprenden el enunciado del problema, diagrama de estados, tabla de estados,
asignación de estados, ecuaciones de entrada a los elementos de memoria y diagrama
electrónico del circuito.
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DISEÑO DE SISTEMAS SECUENCIALES SÍNCRONOS
A nivel físico, una de las formas más efectivas de implementar una FSM es según el
siguiente esquema:
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DISEÑO DE SISTEMAS SECUENCIALES SÍNCRONOS
Como ejemplo consideremos el diseño del siguiente sistema secuencial, en el cual se
emite un pulso de salida Z (Z=l) cuando en la línea de entrada (X) se reciben cuatro
unos en forma consecutiva; en caso contrario, la salida Z es igual a cero.
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Maquinas de estado con VHDL
Maquinas de estado con VHDL
De acuerdo con nuestro ejemplo, vemos
que el sistema secuencial se puede
representar por medio del diagrama de
estados y la tabla siguiente:
Maquinas de estado con VHDL
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Maquinas de estado con VHDL
Con el uso de declaraciones case-when
determinamos el valor que tomará el
siguiente estado, estas deben ir dentro de un
proceso
DIAGRAMAS DE ESTADO
Recuerde que:
La sentencia secuencial CASE, evalúa una expresión en vez de una condición. A
continuación su estructura y un ejemplo:
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Maquinas de estado con VHDL
La estructura del Proceso es:
DIAGRAMAS DE ESTADO
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APP DiCiDe
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DIAGRAMAS DE ESTADO
EJERCICIO PROPUESTO:
Realizar el Programa VHDL para el diagrama de estados
propuesto en CANVAS
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Diagrama de estados
RESUMEN DE LA SESION
DIAGRAMAS DE ESTADO
Recuerde que:
• Cada círculo representa un estado. En la figura tenemos
cuatro estados que se llaman S1, S2, S3 y S4.
• El estado S1 tiene una flecha que indica que es el
estado el inicial, al que se entra tras un reset del
sistema.
• El S4 tiene un doble círculo, que indica que es un
estado final.
• Los estados están unidos por una flechas llamadas
transiciones, que indican cómo evoluciona el sistema
de un estado a otro según se activan las señales de
entrada.
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SIGUIENTE SESION:
VHDL Detector de secuencias.
Enlace de interés:
https://youtu.be/KfFCfUTX4Nk
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Bibliografía:
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GRACIAS
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