Universidad Tecnológica de Panamá

Facultad de Ingeniería Eléctrica

Circuitos Lógicos
Flip-Flops

Informe de

Laboratorio 5

@
cesar.diaz@utp.ac.pa Estudiante: César Díaz, 9-749-2475 25-02-2021
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Licenciatura en Ingeniería Electromecánica
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Parte 1
Circuito por armar:

Tabla:1
SET RESET Q Q1
0 0 1 1
0 1 1 0
1 0 0 1
1 1 0 1
Anexos para cada columna de la tabla 1 y el circuito armador en gContructor.

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PARTE 2
Circuito que se debe construir:

Tabla 2:
D E Q Q1
0 0 - -
0 1 0 1
1 0 1 0
1 1 1 1
Anexos para cada columna de la tabla 2 y el circuito armador en gContructor.

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Parte 3
Circuito por construir:

Circuito construido en gcontructor:

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Observación: Cabe resaltar que en ambas imágenes el interruptor esta encendido sim
embargo la salidas (ambos leds) no encienden hasta que se presiona el interruptor, cabe
resaltar que tiene una secuencia de tiempo antes de encender ambos leds.

Explique la sucesión de transferencia de la entrada al maestro y del maestro al esclavo.

R/= Considero que comparando los pulsos de entrada en la terminal de reloj C (pulsador) con
lo que ocurre a la salida Q del flip-flop, es obvio que las transiciones ocurren para este flip-
flop cuando la señal de reloj va de "0" a "1" en vez de ocurrir cuando va de "1" a "0". Este
flip-flop D es por lo tanto uno activado por las transiciones positivas (de "0" a "1") en la
terminal del pulsador.

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Parte 4
Circuito a construir:

Comprobaciones:
D E 1
0 0 0
0 1 0
1 0 1
1 1 1

OBSERVACIÒN: Se comprobó como se muestra en las siguientes imagenes, que la salida

del flip-flop únicamente cambie en respuesta a una transición positiva del pulso del reloj.
Verifique que la salida no cambie cuando la entrada del reloj es 1 lógico, cuando el reloj tiene
una transición negativa ni cuando la entrada es 0 lógico.

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Parte 5

• FLIP-FLOP 7476
Circuito por armar:

Circuito armado:

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Investigación:
Funcionamiento:
Circuito Integrado TTL 74LS76. Flip-flop J-K dual con preselección que ofrece pulsos
individuales J, K, reloj pulsado, entradas direct set y direct clear. Estos flip-flops dobles
están diseñados para que cuando el reloj se pone en ALTO, las entradas se activan y se
aceptan datos. El nivel lógico de las entradas J y K funcionará de acuerdo con la Truth Table
siempre que se observen tiempos mínimos de configuración. Los datos de entrada se
transfieren a las salidas en las transiciones de reloj HIGH-a-LOW.
Tablas:

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• FLIP FLOP 7474

Investigación:

Funcionamiento:
Flip flop 74LS74. Flip- flop tipo D con disparo de subida doble, tipo
D, positivos, con características de flip-flop disparado con salidas activas bajas,
diseñados para la conducción de LEDs de ánodo común o
indicadores incandescentes directamente. El circuito se usa para para la conducción
de los buffers de lámparas o LEDs de cátodo común. Todos los
circuitos excepto LS49 tienen controles completos de la ondulación de supresión de entrada
/ salida y una entrada de prueba de lámparas. patrones de visualización para los recuentos de
entrada BCD superiores a 9 son símbolos únicos para autenticar condiciones de
entrada. Los circuitos SN74LS47N incorporan líder automático y / o de control del borde de
salida de supresión de cero (RBI \ RBO y \). Prueba de lámparas (LT /) de estos tipos se
puede realizar en cualquier momento cuando el \ / RBO \ nodo BI es en un nivel alto. Todos
los tipos (incluido el "LS49 '49 y) contienen una imperiosa de supresión de entrada
(BI \), que se puede utilizar para controlar la intensidad de la lámpara mediante un pulso o
para inhibir las salidas. Las entradas y salidas son totalmente compatibles para su uso
con salidas lógicas TTL.
• Salida de colector abierto los indicadores de transmisión directamente
• Provisión de prueba de lámpara

• Supresión de cero / arrastre de cero

• Todos los tipos de circuitos cuentan con capacidad de modulación de intensidad de lámpara

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Tablas:

Circuito armado y comprobar las tablas:

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