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1.- INTRODUCCION……………………….…………………………………………….
1.- INTRODUCION…………………………………………………………………………
4.- CONTADORES……………………………………………………………………….
6.- CONCLUSION………………………………………………………………………...
7.- BIBLIOGRAFIA……………………………………………………………………….
COMPUERTAS LOGICAS COMBINACIONALES Y DISPOSITIVOS
SECUENCIALES
1.- INTRODUCCION
1.2.-LOGICA NEGATIVA
Aquí ocurre todo lo contrario, es decir, se representa al estado "1" con los niveles
más bajos de tensión y al "0" con los niveles más altos. Por lo general se suele
trabajar con lógica positiva.
2.- COMPUERTAS LOGICAS
Las compuertas lógicas son dispositivos que operan con aquellos estados lógicos
mencionados en lo anterior y funcionan igual que una calculadora, de un lado
ingresas los datos, ésta realiza una operación, y finalmente, te muestra el resultado.
III. COMPUERTA OR
Al igual que la anterior posee dos entradas como mínimo y la operación
lógica, será una suma entre ambas. Debemos entender que 1 + 1 = 1, el tema
es que se trata de una compuerta O Inclusiva es como a y/o b*Es decir,
basta que una de ellas sea 1 para que su salida sea también 1*.
IV. COMPUERTA OR-EX o XOR
Es OR Exclusiva en este caso con dos entradas (puede tener más) y lo que
hará con ellas será una suma lógica entre a por b invertida y a
invertida por b. Al ser O Exclusiva su salida será 1 si una y sólo una de
sus entradas es 1.
IV. BUFFER’S
En realidad no realiza ninguna operación lógica, su finalidad es
amplificar un poco la señal (o refrescarla si se puede decir). Como
puedes ver en el siguiente gráfico la señal de salida es la misma que
de entrada.
La relación que existe entre la lógica booleana y los sistemas de cómputo es fuerte,
de hecho se da una relación uno a uno entre las funciones booleanas y los circuitos
electrónicos de compuertas digitales. Para cada función booleana es posible
diseñar un circuito electrónico y viceversa, como las funciones booleanas solo
requieren de los operadores AND, OR y NOT podemos construir nuestros circuitos
utilizando exclusivamente éstos operadores utilizando las compuertas lógicas
homónimas. Un hecho interesante es que es posible implementar cualquier circuito
electrónico utilizando una sola compuerta, ésta es la compuerta NAND. Para probar
que podemos construir cualquier función booleana utilizando sólo compuertas
NAND, necesitamos demostrar cómo construir un inversor (NOT), una compuerta
AND y una compuerta OR a partir de una compuerta NAND, ya que como se dijo,
es posible implementar cualquier función booleana utilizando sólo los operadores
booleanos AND, OR y NOT. Para construir un inversor simplemente conectamos
juntas las dos entradas de una compuerta NAND. Una vez que tenemos un inversor,
construir una compuerta AND es fácil, sólo invertimos la salida de una compuerta
NAND, después de todo, NOT (NOT (A AND B)) es equivalente a A AND B. Por
supuesto, se requieren dos compuertas NAND para construir una sola compuerta
AND, nadie ha dicho que los circuitos implementados sólo utilizando compuertas
NAND sean lo óptimo, solo se ha dicho que es posible hacerlo. La otra compuerta
que necesitamos sintetizar es la compuerta lógica OR, esto es sencillo si utilizamos
los teoremas de De Morgan, que en síntesis se logra en tres pasos, primero se
reemplazan todos los "·" por "+" después se invierte cada literal y por último se
niega la totalidad de la expresión.
Si se tiene la necesidad de construir diferentes compuertas de la manera descrita,
bien hay dos buenas razones, la primera es que las compuertas NAND son las más
económicas y en segundo lugar es preferible construir circuitos complejos utilizando
los mismos bloques básicos. Es posible construir cualquier circuito lógico utilizando
sólo compuertas de tipo NOR (NOR = NOT(A OR B)). La correspondencia entre la
lógica NAND y la NOR es ortogonal entre la correspondencia de sus formas
canónicas. Mientras que la lógica NOR es útil en muchos circuitos, la mayoría de
los diseñadores utilizan lógica NAND.
El formato del mapa de Karnaugh (mapa K), al igual que una tabla de verdad, es un
medio para demostrar la relación entre las entradas lógicas y la salida que se busca.
Figura 1. Mapas de Karnaugh y tablas de verdad para (a) dos, (b) tres y (c) cuatro
variables.
EJEMPLO DE DISEÑO DIGITAL MEDIANTE EL MAPA K:
1.- INTRODUCION
Un problema con la lógica secuencial es su falta de "memoria". En teoría, todas las
funciones de salida en un circuito combinacional dependen del estado actual de los
valores de entrada, cualquier cambio en los valores de entrada se refleja (después
de un intervalo de tiempo llamado retardo de propagación) en las salidas.
Desafortunadamente las computadoras requieren de la habilidad para "recordar" el
resultado de cálculos pasados. Éste es el dominio de la lógica secuencial. Una celda
de memoria es un circuito electrónico que recuerda un valor de entrada después
que dicho valor ha desaparecido. La unidad de memoria más básica es el flip-flop
Set/Reset. Aunque recordar un bit sencillo es importante, la mayoría de los sistemas
de cómputo requieren recordar un grupo de bits, esto se logra combinando varios
flip-flop en paralelo, una conexión de éste tipo recibe el nombre de registro. A partir
de aquí es posible implementar diferentes circuitos como registros de corrimiento y
contadores, éstos últimos también los conocemos como circuitos de reloj. Con los
elementos mencionados es posible construir un microprocesador completo.
2.- DISPOSITIVO O CIRCUITO SECUENCIAL
Un circuito o dispositivo secuencial se define como un circuito doblemente evaluado
en el cual, la salida en cualquier instante depende de las entradas en dicho instante
y de la historia pasada (o secuencia) de entradas. Esta definición implica una serie
de características a estos sistemas. Entre éstas podemos destacar las siguientes:
2.1.- Poseen uno o más caminos de realimentación, es decir, una o más señales
internas o de salida se vuelven a introducir como señales de entradas. Gracias a
esta característica se garantiza la dependencia de la operación con la secuencia
anterior.
2.2.- Como es lógico, existe una dependencia explícita del tiempo. Esta
dependencia se produce en los lazos de realimentación antes mencionados. En
estos lazos es necesario distinguir entre las salidas y las entradas realimentadas.
Esta distinción se traducirá en un retraso de ambas señales (en el caso más ideal).
2.2.1.- Elementos de retraso, ya sean explícitos o implícitos debido al retraso de la
lógica combinacional. Este retraso es fijo e independiente de cualquier señal.
2.2.2.- Elementos de memoria, que son dispositivos que almacena el valor de la
entrada en un instante determinado por una señal externa y lo mantiene hasta que
dicha señal ordene el almacenamiento de un nuevo valor.
3.- FLIP-FLOP
S R Q Q+
0 0 0 0
0 0 1 1
0 1 0 0
0 1 1 0
1 0 0 1
1 0 1 1
1 1 0 -
1 1 1 -
3.2.-FLIP FLOP T
Nótese que en la implementación del FF T, las dos entradas del FF S-R están
conectadas a compuertas AND, ambas conectadas a su vez a la entrada T.
Además, la entrada Q está conectada a R y Q’ a S. Esta conexión es así para
permitir que el FF S-R cambié de estado cada que se le mande un dato a T. Por
ejemplo, si Q = 1 en el tiempo actual, eso significa que Q’ = 0, por lo tanto, al recibir
T el valor de 1, se pasaran los valores de R = 1 y S = 0 al FF S-R, realizando un
reset de Q.
La tabla de estado para el FF T se presenta a continuación. Es muy sencilla: cuando
T = 0 el estado de Q no cambia, es decir Q = Q+ (estado de memoria), cuando T =
1, Q es complementada y, por lo tanto, Q+ = Q’.
T Q Q+
0 0 0
0 1 1
1 0 1
1 1 0
El flip-flop J-K es una mezcla entre el flip-flop S-R y el flip-flop T. Esto ocurre de la
siguiente manera:
J K Q Q+
0 0 0 0
0 0 1 1
0 1 0 0
0 1 1 0
1 0 0 1
1 0 1 1
1 1 0 1
1 1 1 0
De la tabla anterior se obtiene la siguiente ecuación característica mediante mapas
de Karnaugh: Este flip-flop es uno de los más comunes con
reloj. El siguiente diagrama lo muestra con entrada para reloj:
El flip-flop D es uno de los FF más sencillos. Su función es dejar pasar lo que entra
por D, a la salida Q, después de un pulso del reloj. Es, junto con el FF J-K, uno de
los flip-flops más comunes con reloj. Su tabla de estado se muestra a continuación:
D Q Q+
0 0 0
0 1 0
1 0 1
1 1 1
4.1.-CONTADORES SINCRONOS
El contador síncrono está formado por una serie de flip-flops a los que se les aplica
simultáneamente todas las entradas o pulsos de reloj de forma que todos los flip-
flops cambian simultáneamente de estado.
El contador asíncrono está constituido por un conjunto de flip-flops en los que los
pulsos que se aplican a la entrada, generalmente procedentes de un reloj, deben
atravesar el primer flip-flop antes de poder mandar al segundo y así sucesivamente
hasta el último flip-flop.
También conocidos como contadores de ondulación, son el tipo más simple, que
requieren menos componentes y menos circuitería que contadores síncronos. Los
contadores asíncronos son más fáciles de construir que sus contrapartes síncronas,
pero la ausencia de un reloj interno también presenta varias desventajas
importantes. Los flip-flops en un contador asíncrono cambian los estados en
diferentes momentos, por lo que los retrasos en el cambio de un estado a otro,
conocidos como retardos de propagación, se suman para crear un retardo global.
Mientras más flip-flops contenga un contador asíncrono, mayor será el retardo
global.
5.- DISEÑO DE CONTADORES
Muchas veces se desea tener contadores que sigan secuencias de conteo que no
sea la binaria, en ese caso ya no se dispondrá de circuitos integrados que
contengan el contador, sino que debemos diseñarlo. Al ser el contador un circuito
secuencial para diseñarlo se utilizarán las técnicas de diseño de circuitos
secuenciales. Se analizará el procedimiento para el caso de los contadores, lo que
implica una gran simplificación del procedimiento.
Así, para el FF2 que genera Q2, el estado presente es 0 y el estado futuro es 0.
Esto sucede cuando J2=K2=0 o cuando J2 = 0 y K2 = 1. De este modo, J2 tiene que
ser cero, y K2 puede tener cualquier valor que indicaremos en la columna
correspondiente a J2 con un 0 y en la correspondiente a K2 con una X indicando la
condición de "no importa". Así vamos obteniendo las entradas para todos los FF y
para todas las transiciones de estado.
Si notan con atención, esta representación es una tabla de verdad de las entradas
de los flip flop en función del estado presente, por lo que podemos obtener las
funciones mínimas de estas entradas utilizando Mapas de Karnaugh.
De la tabla de transiciones para cada una de las entradas de los FF obtenemos los
Mapas de Karnaugh en función del estado presente, y simplificando obtenemos las
funciones de las entradas de cada flip flop. Note que se colocó en cada casilla el
valor decimal. Este corresponde al valor decimal de la cuenta del estado presente:
J2 = Q1·Q0 J1 = Q0 J0 = 1
El paso final es obtener el diagrama circuital. Para ello utilizamos las funciones de
entrada de los flip flops para dibujar la lógica combinacional correspondiente a las
entradas de cada flip-flop y formar así el contador.
Las funciones de entrada obtenidas de los Mapas de Karnaugh son:
J2 = K2 =Q1·Q0
J1 = K1 = Q0
J0 = K0 = 1
-Las álgebras booleanas, estudiadas por primera vez en detalle por George Boole,
constituyen un área de las matemáticas que ha pasado a ocupar un lugar
prominente con el advenimiento de la computadora digital.
-Las compuertas lógicas son los dispositivos electrónicos más sencillos que existen,
pero al mismo tiempo son los más utilizados en la actualidad.
7.- BIBLIOGRAFIA
-https://es.slideshare.net/diegoavalos_tec/circuitos-secuenciales-12604375
-https://m09arroyo.wordpress.com/2013/04/08/contadores-sincronos-y-asincronos/
-http://perso.wanadoo.es/luis_ju/edigital/ed03.html
-https://prezi.com/6yapouvqj_jw/contadores-sincronos-y-asincronos/
-http://www.ehowenespanol.com/contadores-sincronos-asincronos-info_472637/
-http://www.monografias.com/trabajos71/compuertas-logicas/compuertas-
logicas.shtml
-http://www.profesormolina.com.ar/electronica/componentes/int/comp_log.htm
-http://www.uhu.es/raul.jimenez/DIGITAL_II/dig2_i.pdf