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Introduccion Al GRAFCET 2 PDF
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GRAFCET
El GRAFCET (GRAphe Fonctionnel de Commande Etapes-Transitions) es un mtodo grfico que
permite representar los automatismos secuenciales describiendo grficamente la evolucin del
automatismo y los diferentes comportamientos de este.
Entre dos etapas hay una TRANSICIN. Las transiciones indican la posibilidad de evolucin
entre etapas, es decir, la evolucin del estado interno del sistema. A cada transicin le corresponde
una RECEPTIVIDAD. La receptividad es la condicin que se tiene que cumplir para poder pasar
la transicin, es decir, la condicin que permite la evolucin del sistema desde una etapa hasta otra
etapa.
Despus de cada etapa siempre hay una o varias transiciones. Despus de cada transicin siempre
debe ir una o varias etapas.
Una TRANSICIN es VLIDA cuando todas las etapas inmediatamente anteriores son
ACTIVAS.
El GRAFCET utiliza una simbologa normalizada para representar las etapas, las transiciones y las
lneas que las unen:
En la siguiente figura puede observarse la simbologa del GRAFCET aplicada a un proceso simple.
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Introduccin al GRAFCET
2. Estructuras bsicas
El GRAFCET para automatizacin presenta un gran espectro de posibilidades en cuanto a la
secuencia a realizar por un automatismo, existiendo diferentes estructuras bsicas que, por
combinacin de las mismas, permiten implementar cualquier secuencia por muy compleja que est
sea. Las estructuras bsicas ms utilizadas comnmente son las siguientes:
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Introduccin al GRAFCET
F1
9 B
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Introduccin al GRAFCET
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Introduccin al GRAFCET
Se habla receptividades condicionas por etapas cuando la receptividad que corresponde a una
transicin no es una seal externa al propio GRAFCET, sino que la condicin que permite la
evolucin del GRAFCET es el hecho de que una una etapa este activada o desactivada. Igualmente
se puede hablar de acciones condicionadas por etapas
Et20
Et20 3 Accin
Los temporizadores son muy empleados para conseguir que el proceso permanezca en un estado
(realizando una labor) un determinado nmero de segundos. Dado que el GRAFCET del proces
recoge los estados por los que ha de pasar el proceso, estos temporizadores tambin han de ser
includos en dicho GRAFCET. Tpicamente se emplearan temporizadores con retardo a la
conexin que iniciasen la cuenta (se arrancasen) al activarse una etapa. Pasado el tiempo
ajustado, el temporizador cambiara su estado lo que puede llevarse como condicin para que el
GRAFCET pase a la etapa siguiente. Tambin pueden emplearse otro tipo de temporizadores.
7s
5s
5s / Et3 / 7s
Ejemplo. La receptividad 5s / Et3 / 7s se cumplir cuando hayan pasado 5 segundos desde la ultima
activacin de la etapa 3 y volver a ser falsa cuando hayan pasado 7 segundos de la desactivacin
de la etapa 3.
En cualquier caso, dado que la mayora de los temporizadores que se emplearn en las prcticas (y
en la prctica) son de retardo a la conexin y que resulta ms intuitivo arrancar los temporizadores
como si fueran simples salidas, se preferir la siguiente representacin:
- en ella, simplemente se indica que cuando el GRAFCET active la etapa Et6 Arrancar T1
6, se iniciar la cuenta del temporizador T1 (ajustado a 4 s), y cuando
termine, pasar a la etapa 7. T1 = 4s
Et7
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Introduccin al GRAFCET
Una vez representado grficamente el proceso mediante el Grafcet se adaptar dicha descripcin al
lenguaje propio del dispositivo digital empleado para controlar el proceso. Si el dispositivo digital
es un microcontrolador o microprocesador, ser necesario trascribirlo a lenguaje ensamblador, ya
sea directamente o a travs de un compilador. Si es un autmata, robot o mquina de control
numrico se adaptar al lenguaje propio de dicho sistema y marca.
activa la-s
siguiente-s
si la transicin y se cumple la desactiva la-s
es vlida receptividad anterior-es
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Introduccin al GRAFCET
Cond1 Cond2
Et2 Et3
Et1 Et2
Cond1 Cond2
Et5
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Introduccin al GRAFCET
Et1
Cond1
Et1 Et2
Cond1
Et3
En lo que se refiere a transcripcin a AWL o KOP, el resto de las estructuras bsicas vistas en el
apartado 2 son casos particulares de acciones exclusivas.
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Introduccin al GRAFCET
Et1 A8.0
U Et1
A8.3 = A8.0
= A8.3
U Et2
Et2 A8.1 = A8.1
Et1 Arranque T1 (4 s)
T1 fin
Et2 Iniciar contador Z1 (23)
Et1 T1 U Et1
SE L S5T#2S
SE T1
S5T#2s
Et2 Z1 U Et2
SZ
L C#23
C#23 S Z1
Un error muy comn causa es la asignacin mltiple de una misma salida o la carga en varios
puntos de un mismo temporizador. En el caso de que varias etapas activen una misma salida, la
solucin ser hacer una combinacin OR de etapas y asignar el resultado a la salida.
Et1 A8.0
U Et1
= A8.0
O Et1
Et1 A8.3 O Et2
= A8.3
Et2
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