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UNIDAD 4 Electronica Digital
UNIDAD 4 Electronica Digital
Parte III
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Entradas asíncronas (1)
• Para los flip-flops sincronizados por reloj que hemos estudiado, las
entradas S, R, J, K, y D se han asignado como entradas de control.
• A estas entradas también se les conoce como entradas síncronas, ya
que su efecto sobre la salida del flip-flop está sincronizado con la
entrada CLK.
• Como ya hemos visto, las entradas de control síncronas deben usarse
en conjunto con una señal de reloj para disparar el FF.
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Entradas asíncronas (2)
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La fig. 5-31 muestra un flip-flop J-K con dos entradas asíncronas
designadas como PRESET y CLEAR, que son entradas activas en BAJO.
La tabla de funciones sintetiza la manera en que afectan a la salida del FF.
Fig. 5-31
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Análisis de casos
• Muchos FFs sincronizados por reloj que están disponibles como CIs
tendrán ambas entradas asíncronas; otros solo tendrán la entrada
CLEAR.
• Algunos FFs tendrán entradas asíncronas que sean activas en ALTO, en
lugar de ser activas en BAJO.
• Para estos FFs, el símbolo del FF no tendrá una burbuja en las entradas
asíncronas.
• Aunque la mayoría de los FFs de CI tienen cuando menos una o más
entradas asíncronas, hay ciertas aplicaciones de circuitos en las que no
se utilizan. En tal caso se mantienen de forma permanente en su nivel
inactivo.
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Ejemplo 5-9
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Fig. 5-32. Formas de onda que muestran cómo responde un FF
sincronizado por reloj a sus entradas asíncronas.
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Consideraciones de sincronización de los Flip-Flops
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Fig. 5-37. Q2 responderá en forma apropiada al nivel presente en Q1 antes
de la NGT de CLK, siempre y cuando el requerimiento de tiempo de
retención de Q2 (tH) sea menor que el tiempo de propagación de Q1
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Ejemplo 5-11. Determine la salida Q para el FF J-K disparado por flanco
negativo para las formas de onda de entrada que se muestran en la figura
5-38. Suponga que al principio tH = 0 y que Q = 0
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Fig. 5-39 (a) Muestra una situación en donde la señal de entrada A se genera a partir de un
interruptor sin rebotes controlado por un operador.
A cambia a ALTO cuando el operador activa el interruptor y cambia a BAJO cuando el operador libera
el interruptor.
La entrada A se utiliza para controlar el paso de la señal de reloj hacia la compuerta AND, de manera que
Aparezcan pulsos de reloj en la salida X solo durante el tiempo que A esté en ALTO.
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Fig. 5-40 Un FF D disparado por flanco se utiliza para
sincronizar la habilitación de la compuerta AND con las
NGT del reloj.
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Registro de desplazamiento
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Transferencia de datos en serie: Registros de
desplazamiento.
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Registro de desplazamiento de cuatro bits (I)
• En la fig. 5-45 (a) se muestra una manera de ordenar los flip-flops J-K
para que operen como un registro de desplazamiento de cuatro bits.
• Los FFs están conectados de manera que la salida de X3 se transfiera
hacia X2, X2 hacia X1, y X1 hacia X0.
• Lo cual significa que cuando ocurre la NGT de un pulso de
desplazamiento, cada FF toma el valor almacenado previamente en el
FF a su izquierda.
• El flip-flop X3 Toma un valor determinado por las condiciones
presentes en sus entradas J y K cuando ocurre la NGT.
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Registro de desplazamiento de cuatro bits (II)
• Asuma que las entradas J y K de X3 son alimentadas por las formas de onda de
DATA IN (DATOS ENT) mostradas en la fig. 5-45 (b).
• También se asume que todos los FFs están en el estado 0 antes de que se
apliquen los pulsos de desplazamiento.
• Las formas de onda en la fig. 5-45 (b) muestran como los datos de entrada
son desplazados de izquierda a derecha de un FF a otro FF cuando se aplican
los pulsos de desplazamiento.
• Cuando ocurre la primera NGT en T1, cada uno de los FFs X2, X1, y X0 tendrán
las condiciones presentes de J=0, K=1 debido al estado del FF a su izquierda.
• El flip-flop X3 tendrá J=1, K=0 debido a DATA IN (DATOS ENT).
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Registro de desplazamiento de cuatro bits (III)
• Por lo tanto, en T1, solamente X3 irá a ALTO, mientras que todos los otros FFs
se mantendrán en BAJO.
• Cuando ocurra la segunda NGT en T2, el flip-flop X3 tendrá J=0, K=1 porque
DATA IN (DATOS ENT) es 0.
• El flip-flop X2 tendrá J=1, K=0 debido al nivel ALTO actual en X3.
• Los flip-flops X1 y X0 tendrán todavía la condición J=0, K=1.
• Por lo tanto, en T2, solamente el FF X2 irá a ALTO, FF X3 irá a BAJO, Y LOS FFs X1
y X0 permanecerán BAJOS.
• Un razonamiento similar se puede usar para determinar los cambios en las
formas de onda en T3 y T4.
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Transferencia en serie entre registros
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Transferencia en serie entre registros (I)
22
Transferencia en serie entre registros (II)
23
Transferencia en serie entre registros (III)
24
Transferencia en serie entre registros (IV)
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Contador binario de tres bits
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Diagrama de transición de estados
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Transferencia de datos binarios desde un
microprocesador a un registro externo
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Respuesta de un inversor estándar a una entrada
ruidosa y lenta
29
Respuesta del disparador de Schmitt a una entrada
ruidosa y lenta
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Temporizador 555 utilizado como multivibrador astable
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