Electrónica Industrial – 3º GITI 1er Parcial 2023-24

Examen – Problemas 1 hora

Problema 1 (2,5 puntos) Problema 2 (2,5 puntos)

Se desea diseña un codificador con prioridad, de 4 a 2 líneas. Las cuatro líneas de entrada
se designan I3, I2, I1, I0, las dos de salida S1, S0, siendo S0 el bit menos significativo.

El circuito debe funcionar de la siguiente forma:

1) La salida debe indicar en binario el número de la entrada activada de mayor

prioridad, que es la del número más alto, en caso de que presentara más de una.
2) Las entradas y salidas serán activas a nivel bajo.
3) El circuito despondrá además de dos salidas (N y A) que indicarán que no se ha
activado ninguna entrada (N) o que se ha activado alguna entrada (A), siempre
activas a nivel bajo.

Se pide:

1) Tabla de verdad, con la siguiente cabecera: I3, I2, I1, I0, S1, S0, N, A Para el circuito de la figura, se pide:
2) Primeras formas canónicas
3) Funciones simplificadas 1) Cronograma cuando la señal de control U es igual a 1 (representar con el siguiente
orden: señal de reloj, señal de control U y las salidas A, B y C).
2) Cronograma cuando la señal de control U es igual a 0 (representar con el siguiente
orden: señal de reloj, señal de control U y las salidas A, B, y C)
3) Diagrama de estado.

Se valorará la exactitud de los resultados y la claridad del ejercicio.

Se valorará la exactitud de los resultados y la claridad del ejercicio.

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Examen – Problemas 1 hora

Problema 1 (2,5 puntos)

I3 I2 I1 I0 S1 S0 N A
0 0 0 0 0 0 1 0
0 0 0 1 0 0 1 0
0 0 1 0 0 0 1 0
0 0 1 1 0 0 1 0
0 1 0 0 0 0 1 0
0 1 0 1 0 0 1 0
0 1 1 0 0 0 1 0
0 1 1 1 0 0 1 0
1 0 0 0 0 1 1 0
1 0 0 1 0 1 1 0
1 0 1 0 0 1 1 0
1 0 1 1 0 1 1 0
1 1 0 0 1 0 1 0
1 1 0 1 1 0 1 0
1 1 1 0 1 1 1 0
1 1 1 1 X X 0 1

Primeras formas canónicas

𝑆1 = 𝑚12 + 𝑚13 + 𝑚14 + 𝑚15

𝑆0 = 𝑚8 + 𝑚9 + 𝑚10 + 𝑚11 + 𝑚14 + 𝑚15

𝑁 = 𝑚0 + 𝑚1 + 𝑚2 + 𝑚3 … . . +𝑚14

𝐴 = 𝑚15
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Examen – Problemas 1 hora

Problema 1 (2,5 puntos)

1) Cronograma cuando la señal de control U=1

2) Cronograma cuando la señal de control U=0

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Examen – Problemas 1 hora

3) Diagrama de estados
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Cuestiones 1 hora

Cuestión 1 (1,25 puntos) Cuestión 2 (1,25 puntos)

Dada la función lógica F = (A+B+A.B)(A+C) averiguar razonadamente cuál de los circuitos +5V

siguientes la realiza:

CLK

+5V

Para el circuito de la figura, se pide lo siguiente:

1º) Rellenar la tabla que se acompaña, suponiendo que los biestables se han inicializado
accionando el pulsador S.
Se valorará la exactitud de los resultados y la claridad del ejercicio.
2º) Identificar, mediante un nombre lo más preciso posible, de qué tipo de circuito se trata.

Se valorará la exactitud de los resultados y la claridad del razonamiento.

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Cuestiones 1 hora

Cuestión 3 ( 1,25 puntos) Cuestión 4 ( 1,25 puntos)

Utilizando el número necesario de circuitos integrados 74151 y el mínimo número de Determinar los márgenes de ruido de los niveles ALTO y BAJO para TTL LS y CMOS 4000,
puertas lógicas auxiliares, implementar la función: utilizando la información de la siguiente tabla:

𝑓 = ∑(𝑚0, 𝑚1, 𝑚2, 𝑚3, 𝑚4, 𝑚9, 𝑚13, 𝑚14)

Basándose en los cálculos anteriores de margen de ruido,

¿Qué familia de dispositivos, TTL LS o CMOS 4000, debería utilizarse en entornos de alto
ruido?

Responder razonadamente

Se valorará la exactitud de los resultados y la claridad del ejercicio.

Se valorará la exactitud de los resultados y la claridad del esquemático.

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Cuestiones 1 hora

Cuestión 1 ( 1,25 puntos)

𝐹 = (𝐴 + 𝐵 + 𝐴. 𝐵)(𝐴 + 𝐶) = 𝐴𝐴 + 𝐴𝐵 + 𝐴. 𝐴. 𝐵 + 𝐴. 𝐶 + 𝐵. 𝐶 + 𝐴. 𝐵. 𝐶 = 𝐴 + 𝐴. 𝐵(1 + 𝐴) + 𝐴. 𝐶(1 + 𝐵) + 𝐵. 𝐶 =

𝐴 + 𝐴. 𝐵 + 𝐴. 𝐶 + 𝐵. 𝐶 = 𝐴(1 + 𝐵) + 𝐴. 𝐶 + 𝐵. 𝐶 = 𝐴 + 𝐴. 𝐶 + 𝐵. 𝐶 = 𝐴(𝐶 + 1) + 𝐵. 𝐶 = 𝐴 + 𝐵. 𝐶

Correspondiéndose con el esquemático (3).

Cuestión 2 ( 1,25 puntos)

Se trata de un contador asíncrono descendente de módulo 16

Nº de Q3 Q2 Q1 Q0
pulso
0 1 1 1 1
1 1 1 1 0
2 1 1 0 1
3 1 1 0 0
4 1 0 1 1
5 1 0 1 0
6 1 0 0 1
7 1 0 0 0
8 0 1 1 1
9 0 1 1 0
10 0 1 0 1
11 0 1 0 0
12 0 0 1 1
13 0 0 1 0
14 0 0 0 1
15 0 0 0 0
16 1 1 1 1
17 1 1 0 1

Cuestión 3 ( 1,25 puntos)

𝑓 = 𝐴̅𝐵6𝐶̅ 𝐷
8 + 𝐴̅𝐵6𝐶̅ 𝐷 + 𝐴̅𝐵6𝐶𝐷
8 + 𝐴̅𝐵6𝐶𝐷 + 𝐴̅𝐵𝐶̅ 𝐷
8 + 𝐴𝐵6𝐶̅ 𝐷 + 𝐴𝐵𝐶̅ 𝐷 + 𝐴𝐵𝐶𝐷
8

Si utilizáramos un solo multiplexor podríamos hacer lo siguiente:

8
1º) Utilizar por ejemplo ABC para seleccionar los canales D0….D7 y en las entradas del multiplexor podríamos poner un 1, 0, D o 𝐷
dependiendo de los minitérminos de la función lógica. Así, tendríamos la siguiente posible solución:

• Un 1 en D0 implica que en f están los términos 𝐴̅𝐵6𝐶̅ 𝐷

8 𝑦 𝐴̅𝐵6𝐶̅ 𝐷
• Un 1 en D1 implica que en f están los términos 𝐴̅𝐵6𝐶𝐷 8 𝑦 𝐴̅𝐵6𝐶𝐷
• Un D en D2 implica que en f está el término 𝐴𝐵𝐶 𝐷 y que no está 𝐴̅𝐵𝐶̅ 𝐷
8 ̅ ̅ 8
• Un 0 en D3 implica que en f no están los términos 𝐴̅𝐵𝐶𝐷 8 𝑦 𝐴̅𝐵𝐶𝐷
• Una D en D4 implica que en f no está el término 𝐴𝐵𝐶 𝐷 y que está 𝐴𝐵6𝐶̅ 𝐷
6 ̅ 8
• Un 0 en D5 implica que en f no están los términos 𝐴𝐵 6 𝐶𝐷 8 𝑦 𝐴𝐵6𝐶𝐷
• Una D en D6 implica que en f que no está el término 𝐴𝐵𝐶̅ 𝐷 8 y que está 𝐴𝐵𝐶̅ 𝐷
• 8 8
Una D en D7 implica que en f está el término 𝐴𝐵𝐶𝐷 y que no está 𝐴𝐵𝐶𝐷
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Cuestiones 1 hora

Otra posible solución sería utilizar dos multiplexores cuyas señales de selección S2, S1 y S0, estuvieran ligadas a las variables
lógicas B, C, D y la señal de E se utilizara para habilitar el MUX1 cuando A=0 y el MUX2 cuando A=1

Cuestión 4 ( 1,25 puntos)

Se utilizará aquella familia que tenga mayor margen de ruido.

VNH = V OH –V IH
VNL = V IL– V OL

TTL LS

𝑉!" = 𝑉#" − 𝑉$" = 2,7 𝑉 − 2𝑉 = 0,7𝑉

𝑉!% = 𝑉$% − 𝑉#% = 0,8 𝑉 − 0,5 𝑉 = 0,3𝑉

Luego para esta familia el margen de ruido es 0,3V

CMOS 4000

𝑉!" = 𝑉#" − 𝑉$" = 4,99 𝑉 − 3,5𝑉 = 1,49𝑉

𝑉!% = 𝑉$% − 𝑉#% = 1,5 𝑉 − 0,001 𝑉 = 1,49𝑉

Luego para la familia CMOS 4000 el margen de ruido es 1,49V, que es considerablemente mayor que los 0,3V de la TTL LS. Luego la
familia CMOS 4000 está más indicada que la TTL LS para entornos ruidosos.