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Registros)
Andres Alejandro Pinilla González, Duvan Stivens Muñoz
Merchan
Facultad de Ingeniería, Tecnología en Electrónica,
Fundación Universitaria Juan De Castellanos
Tunja, Colombia
Pinillita1108@gmail.com,dsmm182@gmail.com
Correo electrónico Segundo Integrante
• Multivibrador astable:
• Integrado 74190.
Simulaciones JF y D
Fig. 7: simulacion integrado 74161
Fig. 11: Simulación tipo D.
Contador Síncronos
Fig. 12: Tabla de función
Simulación de Tipo JK
Contador de modulo 7
Contador 32 bits
Divisor de frecuencia
Fig. 20: Simulación división de frecuencia 100 veces En la Fig.22 una compuerta and en el reloj que nos permitió para
pausa al contador por medio de una entrada, después van los
Se amplia cada vez la frecuencia mediante el reinicio del Flip- divisores de frecuencia para poder bajar la velocidad de la FPGA
Flop. Siguiendo la lógica del circuito se puede ampliar la división y poder ver el conteo en los siete segmentos, utilizamos un
de la frecuencia. contador de referencia 74190 que es un contador síncrono que
tiene una entra para ser descendente o ascendente que van
Contador Ascendente y descendente conectado a un decodificador 7447 que nos codifica la entrada
binaria a varias salidas para el siete segmentos, para poder
entender el funcionamientos de estos circuitos nos basamos en el
Datasheet de cada uno.
VII. CONCLUSIONES