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UNIVERSIDAD
NACIONAL MAYOR
DE SAN MARCOS
(Universidad del Perú, Decana de
América)
FACULTAD DE INGENIERÍA ELECTRÓNICA Y
ELÉCTRICA
Laboratorio N°3
Curso: Laboratorio de Micro/Nano Sistemas Electrónicos
Profesor: Alarcón Matutti Rubén
Tema: FAMILIAS LÓGICAS PARA EL DISEÑO
Alumno: - Guzman Camacho Eleazar Moises (20190198)
2024
lOMoARcPSD|8931491
ENTRADAS SALIDA
X1 X2 X3 F
0 0 0 0
0 0 1 0
0 1 0 1
0 1 1 0
1 0 0 1
1 0 1 0
1 1 0 0
1 1 1 1
Realizamos la simulación:
Observamos de los valores de salida que el periodo es igual a 2.256 ns y la frecuecnia es igual a
0.443 GHZ. Tambien notamos que el retraso máximo es igual 1128ps entonces la frecuencia
máxima es:
1 1
𝑓𝑚𝑎𝑥 =
𝑟𝑒𝑡𝑟𝑎𝑠𝑜𝑚𝑎𝑥 1128𝑝𝑠 = 𝟎. 𝟖𝟖𝟔 𝑮𝑯𝒛
=
Para este caso las medidas del área son, 67𝜆 𝑦 74 𝜆 que, tenemos tener en cuenta que el valor de
𝜆=0.125 µ𝑚 , por lo que el valor del área de trabajo seria:
á𝑟 𝑒 𝑎 =67𝜆 𝑥 74 𝜆
á𝑟 𝑒 𝑎 =77.47 p𝑚 ^2
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