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• Definiciones básicas
Autómata de Mealy
Autómata de Moore
• Formas de descripción de un sistema secuencial
Diagrama de estado
Tabla de flujo
Tabla de estado-salida
Tabla de transición
• Problemas estructurales en circuitos asíncronos. Circuitos síncronos.
• Elementos de Memoria
• Proceso de Análisis y síntesis de circuitos con elementos de memoria
• Reducción de tablas de estado
Obtención de pares compatibles mediante la carta de implicación
Obtención del conjunto compatible máximo
• Reglas de asignación de variables de estado
Definiciones básicas
• Definiciones básicas.
E = x ,x , .... , x
1 2 2n
= e ,e , .... , e
1 2 2n donde xi = (x1,x 2 , ... xn )
b) Un conjunto finito de p señales de salida (z1,z2, ... zp), que generan un conjunto
finito de 2p estados de salida S.
S = z ,z , .... , z
1 2 2p
= s ,s , .... ,s
1 2 2 p donde zi = (z1,z2 , ... zp )
c) Un conjunto finito de m variables internas (y1,y2, ... ym), que generan un
conjunto finito de 2m estados internos Q.
Q = y ,y , .... ,y
1 2 2m
= q ,q , .... ,q
1 2 m
2 donde y = (y1,y 2 , ... ym )
i
d) Un circuito combinacional.
xn CIRCUITO zp
COMBINACIONAL
yi(t+1) = Yi(t)
y1 Y1
y2 Y2
ym Ym
Autómatas
• Autómata de Mealy
a) Alfabeto de entrada:
E = x ,x , .... , x
1 2
= e ,e , .... , e
2n
1 2 2n
Q = y ,y , .... ,y = q ,q , .... ,q
1 2 2m
b) Alfabeto de estados internos: 1 2 2m
c) Alfabeto de salida:
S = z ,z , .... , z
1 2 2p
= s ,s , .... ,s
1 2 2p
d) Función de salida: f: E Q → S
e) Función de transición: t: E Q → Q
f(ei , qi) = si
t(ei , qi) = qm
• Autómata de Moore
a) Alfabeto de entrada:
E = x ,x , .... , x
1 2
= e ,e , .... , e
2n
1 2 2n
Q = y ,y , .... ,y = q ,q , .... ,q
1 2 2m
b) Alfabeto de estados internos: 1 2 2m
c) Alfabeto de salida:
S = z ,z , .... , z
1 2 2p
= s ,s , .... ,s
1 2 2p
d) Función de salida: f: Q → S
e) Función de transición: t: E Q → Q
f(qi) = si
t(ei , qi) = qm
• Importante
Análisis Diseño
Diagrama de estado
Reglas de asignación
Tabla de Transición
Elección de elementos de memoria
(tabla de los elementos de memoria) (tabla de evolución de los elementos de memoria)
Circuito Lógico
XK / f(XK,qi) XK
qi qj qi/f(qi) qj/f(qj)
Xm / f(Xm,qi) Xm
Máquina de Mealy Máquina de Moore
• Tipos de estados
a) Estado terminal
Estado en el que se permanece independientemente de la secuencia que se
de en las entradas.
b) Estado inaccesible
Estado al que no se puede llegar desde ningún estado, aunque se aplique
cualquier secuencia en las variables de entrada.
• Tabla de estado-salida
En las columnas se representa el alfabeto de entrada xi, y en las filas los estados
presentes qi.
X0 x1 .......... xn-1
q0 t(x0,q0),f(x0,q0) t(x1,q0),f(x1,q0) .......... t(xn-1,q0),f(xn-1,q0)
Q q1 t(x0,q1),f(x0,q1) t(x1,q1),f(x1,q1) .......... t(xn-1,q1),f(xn-1,q1)
... .......... .......... .......... ..........
qm-1 t(x0,qm-1),f(x0,qm-1) t(x1,qm-1),f(x1,qm-1) .......... t(xn-1,qm-1),f(xn-1,qm-1)
E S
x0 x1 .......... xn-1
q0 t(x0,q0) t(x1,q0) .......... t(xn-1,q0) f(q0)
Q q1 t(x0,q1) t(x1,q1) .......... t(xn-1,q1) f(q1)
... .......... .......... .......... .......... ..........
qm-1 t(x0,qm-1) t(x1,qm-1) .......... t(xn-1,qm-1) f(qm-1)
• Tabla de flujo
Es una representación tabular del próximo estado en función del valor de las entradas
y de el estado presente, pero en la que sólo figuran los estados estables. Los estados
inestables son sustituidos por el estado estable al que se transitará.
En las columnas se representa el alfabeto de entrada xi, y en las filas los estados
presentes qi.
• Tabla de transición.
En las columnas se representa el alfabeto de entrada xi, y en las filas los valores
presentes de las variables de estado.
a) Azar extrínseco
b) Azar intrínseco
c) Carrera
• Tipos de carreras
a) Carrera crítica
b) Carrera no crítica
Otro posible problema es cuando para una determinada combinación de las variables
de entrada, no hay ningún estado estable, por lo que tendríamos una máquina
secuencial no determinista, y sería imposible predecir el estado al que tiende la
máquina para dicha combinación de entrada
Están libres de todos los problemas que presentan los circuitos secuenciales
asíncronos, para lo cual presentan las siguientes restricciones:
b) Cuando las entradas son estables, se cierran los lazos y se producen los
cambios de estado
CIRCUITO
xn COMBINACIONAL zp
yi(t+1) = Yi(t)
y1 Y1
y2 Y2
ym Ym
Clk
Como consecuencia, NO hay estados inestables, ya que cada próximo estado, será el
estado siguiente al que se llegará, ya que sólo se permite una transición por cada
pulso de reloj
Elementos de Memoria
Biestable SR
S y
R y
S R Y y→Y S R
0 0 y 0→0 0 -
0 1 0 0→1 1 0
1 0 1 1→0 0 1
1 1 no permitido 1→1 - 0
Biestable JK
J y
K y
JK Y
y→Y JK
00 y
0→0 0-
01 0
0→1 1-
10 1
1→0 -1
11 y
1→1 -0
Biestable D
y
D
y
y→Y D
0→0 0
D Y
0→1 1
0 0
1→0 0
1 1
1→1 1
Biestable T
y
T
y
y→Y T
0→0 0
0→1 1
T Y
1→0 1
0 y
y 1→1 0
1
J y
T
K y
JK Y
00 y T Y
T = 0 = J = K entrada 00
01 0 0 y
T = 1 = J = K entrada 11
10 1 1 y
11 y
Análisis Diseño
Diagrama de estado
Reglas de asignación
Tabla de Transición
Elección de elementos de memoria
(tabla de los elementos de memoria) (tabla de evolución de los elementos de memoria)
Circuito Lógico
....
....
CCSAL
DEF: Una tabla de estados A se dice que cubre a una tabla de estados B, si
todo estado de B es cubierto por al menos un estado de A
x1,x2
00 01 10 11
1 1,1 6,1 1,1 2,0
2 3,1 2,0 2,1 2,0
3 3,1 5,1 3,1 2,0
4 4,1 6,1 4,1 2,0
5 1,1 5,1 4,1 5,0
6 1,1 6,1 3,1 6,0
Tabla de Estado/Salida
1
*
X 2
5-6 *
X 3
* 5-6
X 4
Para todas las columnas, proceder desde la derecha hacia la izquierda con el
siguiente proceso. Dada la columna i.
Cuando se termina el proceso con todas las columnas, el conjunto final C es el MCS
x1,x2
00 01 10 11
A A,1 B,1 A,1 C,0
B A,1 B,1 A,1 B,0
C A,1 C,0 C,1 C,0
a) Los estados que tienen idénticos próximos estados, para todas las entradas (en
las mismas entradas), deben tener asignamientos adyacentes
b) Los estados que tienen idénticos próximos estados, para todas las entradas (en
distintas entradas), deben tener asignamientos adyacentes si dichos próximos
estados pueden ser dados como asignamientos adyacentes
c) Los estados que tienen idénticos próximos estados, para algunas entradas,
deben tener asignamientos adyacentes. Los estados con más columnas
idénticas tendrán mayor prioridad
REGLA 2
REGLA 3
Los estados que tengan la misma salida para una cierta entrada deben tener
asignamientos adyacentes
FIN