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PRÁCTICA N°6
1. TEMA
DISEÑO SSI
2. OBJETIVOS
2.1. Familiarizar al estudiante con el funcionamiento y la utilización de circuitos lógicos
combinacionales que realizan operaciones binarias.
3. TRABAJO PREPARATORIO
Diseñe los circuitos solicitados a continuación:
3.1. Medio sumador de 1 bit:
• Realizar la tabla de verdad.
• Encontrar los mintérminos de la función.
• Encontrar la función canónica.
• Reducir la función canónica utilizando álgebra de Boole
• Realizar el diagrama del circuito utilizando compuertas AON.
3.3. Multiplexor de 2 a 1:
• Realizar la tabla de verdad.
• Encontrar los mintérminos de la función.
• Encontrar la función canónica.
• Reducir la función canónica utilizando álgebra de Boole
• Realizar el diagrama del circuito utilizando compuertas AON.
3.4. Demultiplexor de 1 a 2:
• Realizar la tabla de verdad.
• Encontrar los mintérminos de la función.
4. EQUIPO Y SOFTWARE
• Computadora.
• Proteus.
5. PROCEDIMIENTO
5.1. Implementar en simulación los diseños correspondientes a los ítems 3.1, 3.2, 3.3 y
3.4 del trabajo preparatorio.
5.2. Utilizando un multiplexor de 8 a 1 implementar la función lógica de tres entradas
señalada por el instructor.
6. INFORME
6.1. Presente los resultados obtenidos durante la sesión del laboratorio.
6.2. Diseñar un demultiplexor de 1 a 4:
Lunes 𝐹(𝐴,𝐵,C,D)=Σ(0,1,3,9,11,15)
Martes 𝐹(𝐴,𝐵,C,D)=Σ(1,3,8,9,12,14)
miércoles 𝐹(𝐴,𝐵,C,D)=Σ(2,5,6,7,10,13)
Jueves 𝐹(𝐴,𝐵,C,D)=Σ(3,6,5,9,10,11)
Viernes 𝐹(𝐴,𝐵,C,D)=Σ(2,4,6,8,14,15)
7. REFERENCIAS
[1] TOCCI/WIDMER/MOSS. “Sistemas Digitales. Principios y Aplicaciones”. Prentice
Hall. 10ma. Edición. 2007.
[2] NOVILLO CARLOS A., "Sistemas Digitales" Quito, Escuela Politécnica Nacional,
2010.
Elaborado por: Ing. Elvis Espinosa, Ing. Aldrin Reyes