Laboratorio Calificado 1 Circuitos Ló gicos Digitales EL245

Profesores del curso:

Ing. Cárdenas Zavala, Germain
Ing. Páez Trujillo, Emiliano
Ing. Salazar Revatta, Vicky
Ing. Vargas, Luis

Integrantes:

N° Apellidos y Nombres Participación*

*Participación
A: El estudiante trabajó activamente con el grupo y cumplió la tarea asignada
B: El estudiante trabajó con el grupo y cumplió medianamente con la tarea asignada
C: El estudiante no trabajo con el grupo o no cumplió con la tarea asignada

Profesores del curso 2022-2 Pá gina 1

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OBJETIVOS
1. Diseñar un circuito lógico combinacional siguiendo los pasos establecidos.
2. Simplificar una función booleana usando Mapas de Karnaugh.
3. Simular el circuito haciendo uso del Software Proteus.
4. Utilizar el Software Quartus para describir el circuito y simularlo en VHDL.

FORMA DE PRESENTACIÓN:

El laboratorio será en grupos de 3 a 4 estudiantes.

El laboratorio consiste en la resolución de dos problemas de aplicación de contexto real, los cuales
deben interpretar, diseñar, simplificar, simular y describir el código en VHDL.

Los alumnos entregarán al profesor tres archivos por cada problema de aplicación:

1. Documento en Formato PDF - Resolución completa del problema:

a) Especificar el circuito a diseñar (entradas, salidas y niveles lógicos), tabla de verdad y
simplificación de las funciones usando Mapas de Karnaugh.
b) Simulación en Proteus, insertar la imagen del circuito (no copiar toda la pantalla).
c) Código en VHDL modo Flujo de Datos usando la función booleana.
 Insertar la imagen del código (no copiar toda la pantalla).
 Simulación – Cronograma de Tiempos. (Comentar y verificar si se cumple con los
resultados esperados).
 Circuito RTL
d) Código en VHDL modo Flujo de Datos usando “when – else”.
 Insertar la imagen del código (no copiar toda la pantalla).
 Simulación – Cronograma de Tiempos. (Comentar y verificar si se cumple con los
resultados esperados).
 Circuito RTL
e) Código en VHDL modo Flujo de Datos usando “with – select – when”.
 Insertar la imagen del código (no copiar toda la pantalla).
 Simulación – Cronograma de Tiempos. (Comentar y verificar si se cumple con los
resultados esperados).
 Circuito RTL

2. Video con la demostración de la simulación del circuito en Proteus. Los alumnos deben grabar
la pantalla simulando los valores de ingreso al circuito para verificar que la tabla de verdad sea
la misma. Colocar el enlace al video en el informe en la parte b).

3. Carpeta comprimida (Formato ZIP, RAR, 7Z, etc) de la ubicación de los archivos en VHDL, se
sugiere crear una carpeta general del laboratorio y dentro crear subcarpetas:

La carpeta comprimida será Lab1_2022_02 Grupo#.rar.

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PROCEDIMIENTO
Experiencia 1

La siguiente figura muestra el cruce de una autopista principal con un camino de acceso
secundario. Se colocan sensores para detección de vehículos a lo largo de los carriles C y D
(camino principal) y en los carriles A y B (camino de acceso). Las salidas del sensor están en
nivel BAJO (0 - LOW) cuando no pasa ningún vehículo y en nivel ALTO (1 - HIGH) cuando
pasa algún vehículo. El semáforo del cruce se controlará con la siguiente lógica:

 El semáforo EO estará en luz verde cuando no haya vehículos transitando.

 El semáforo EO estará en luz verde siempre que los carriles C y D están ocupados.
 El semáforo EO estará en luz verde siempre que C está ocupado y D no lo está.
 El semáforo EO estará en luz verde sólo si D está ocupado.
 El semáforo NS estará en luz verde siempre que los carriles A y B están ocupados y
sólo C no está ocupado.
 El semáforo NS estará en luz verde cuando A o B están ocupados en tanto que C no
lo está.
 Por ningún motivo los semáforos EO y NS deben estar simultáneamente en luz
verde o en luz rojo.

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Utilizando las salidas de los sensores A, B, C y D como entradas, diseñar y simular el

circuito que permita controlar los semáforos. Debe haber dos salidas NS y EO, que pasan a
nivel ALTO cuando la luz correspondiente se pone en verde.

Entradas Salidas
A B C D NS EO

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Experiencia 2
Diseñar, simular e implementar el circuito lógico digital, que permita controlar el sistema de
abastecimiento de agua para un edificio de 5 pisos. El sistema cuenta con lo siguiente: CUATRO
sensores de nivel de líquido (A, B, C y P); Una luz de señalización de alarma; Un sensor de horario H
cuya salida es ‘1’ si es de noche (de 20:00 a 6:00) y ‘0’ si es de día; y Una bomba (B1) para subir el
agua desde la cisterna hacia el tanque elevado.
Su circuito debe contemplar las siguientes condiciones:
 Cuando los sensores están inactivos (A, B, C), significa que el tanque elevado está vacío y
debe funcionar la bomba B1, siempre y cuando el nivel de H 2O en la cisterna esté por
encima de P (activado).
 Cuando el nivel de agua en el tanque elevado esté entre el nivel mínimo y la mitad, se
deberá apagar la bomba B1, solamente si está en horario de noche, caso contrario deberá
llenarse el tanque.
 Cuando el agua toque el sensor A, significa que el tanque elevado está lleno y debe
apagarse la bomba B1.
 La alarma se deberá activar cuando se produzca una falla en los sensores de nivel y
apagarse la bomba. Considérese una falla, cuando por ejemplo el sensor B se activa y el
sensor C no lo está.
 Asumir que el valor lógico de un sensor activo es “1”, e inactivo “0”.

Su circuito deberá ser lo mínimo posible y puede usar cualquier tipo de compuerta de 2
entradas. Para simular la bomba deberá usar el motor DC y para la alarma la lámpara de
12Vdc.

Cisterna Tanque elevado

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ENTRADAS SAL.
P H A B C B1 AL
0              
1              
2              
3              
4              
5              
6              
7              
8              
9              
10              
11              
12              
13              
14              
15              
16              
17              
18              
19              
20              
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Lima, setiembre de 2022

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