Circuitos Combinacionales 1

TAREA 2 – CIRCUITOS COMBINACIONALES

PRESENTADO POR:

KAREN LIZETH VILLAMIL. CODIGO: 1233695732

PRESENTADO A: EDISON ANDRES ARTEAGA

GRUPO: 243004_49

UNIVERSIDAD NACIONAL ABIERTA Y A DISTANCIA UNAD

ELECTRONICA DIGITAL

PROGRAMA INGENIERIA DE TELECOMUNICACIONES

SOGAMOSO

2020
Circuitos Combinacionales 2

CONTENIDO
INTRODUCCIÓN ..................................................................................................................... 3

OBJETIVOS .............................................................................................................................. 4

General: .................................................................................................................................. 4

Específicos: ............................................................................................................................ 4

ACTIVIDADES A DESARROLLAR ....................................................................................... 5

CONCLUSIONES ................................................................................................................... 17

BIBLIOGRAFIA ...................................................................................................................... 18
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INTRODUCCIÓN

En este trabajo usted encontrara el desarrollo de diseños de circuitos digitales combinacionales

mediante el uso de herramientas computacionales para su modelamiento, como lo es el caso de

EDA Playground a través de su lenguaje VHDL; por lo que se evidenciara la compresión y

desarrollo de simulaciones de circuitos Multiplexores, Sumadores, Restadores, Codificadores y

Decodificadores, todo esto se desarrolló a través de la interpretación de los recursos educativos en

la lectura de los libros de Muñoz, J. (2012) “Introducción a los Sistemas Digitales: Un enfoque

usando Lenguajes de Descripción de Hardware” y de Flórez, F. H. A. (2010). Diseño lógico:

fundamentos de electrónica digital.

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OBJETIVOS

General:

 Interpretación y comprensión de los conceptos de circuitos Multiplexores, Sumadores,

Restadores, Codificadores y Decodificadores, para crear lógica de desarrollo de los

ejercicios propuestos.

Específicos:

 Implementar el desarrollo de los ejercicios de simulaciones de los circuitos Multiplexores,

Sumadores, Restadores, Codificadores y Decodificadores en lenguaje VHDL en la

herramienta EDA Playground

 Presentar informe colaborativo con la integración de todos los ejercicios propuestos en la

guía de actividades, el cual cuente con las características descritas en el anexo 0.

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ACTIVIDADES A DESARROLLAR

Resolver los siguientes ejercicios:

1. Describa en VDHL tres multiplexores utilizando la sentencia with-select. Los tres multiplexores

deben tener un tamaño diferente (2 a 1, 8 a 1, etc.) y cada entrada un número de bits diferente.

A. Una impresión de pantalla de la descripción en VHDL (Ver la advertencia al final de la guía,

con respecto a las impresiones de pantallas válidos)

B. Una impresión de pantalla del resultado (diagrama) de la simulación, en el cual se debe

evidenciar el correcto funcionamiento del diseño. NO se debe incluir el código VHDL de la

simulación.

SOLUCIÓN:
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2. Describa en VDHL un decodificador de 3 entradas utilizando la sentencia with-select.

El diseño debe contener:

A. Una impresión de pantalla de la descripción en VHDL.

B. Una impresión de pantalla de la simulación, en el cual se debe evidenciar el correcto

funcionamiento del diseño.

SOLUCIÓN:
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3. Describa en VDHL un codificador de 4 entradas, sin prioridad, utilizando la sentencia with-

select.

El diseño debe contener:

A. Una impresión de pantalla de la descripción en VHDL.

B. Una impresión de pantalla de la simulación, en el cual se debe evidenciar el correcto

funcionamiento del diseño.

SOLUCIÓN:
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4. Describa en VDHL el circuito que se muestra en la siguiente figura:

A. Utilizando la sentencia with-select.

B. Utilizando la sentencia when-else.

Figura 1

El diseño debe contener:

A. Un pantallazo de la descripción en VHDL.

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B. Un pantallazo de la simulación, en el cual se debe evidenciar el correcto funcionamiento del

diseño.

SOLUCIÓN:
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5. Describa en VDHL el circuito que se muestra en la siguiente figura, utilizando la sentencia

when-else.

Figura 2

El diseño debe contener:

A. Una impresión de pantalla de la descripción en VHDL.

B. Una impresión de pantalla de la simulación, en el cual se debe evidenciar el correcto

funcionamiento del diseño.

SOLUCIÓN:
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6. Describa en VDHL el circuito que se muestra en la siguiente figura. El diseño debe contener

tres módulos diferentes (tres COMPONENTs) y un archivo de alto nivel, tal como se muestra en

la siguiente figura.

Figura 3

El diseño debe contener:

A. Una impresión de pantalla de la descripción en VHDL.

B. Una impresión de pantalla con el RTL del alto nivel.

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C. Una impresión de pantalla de la simulación, en el cual se debe evidenciar el correcto

funcionamiento del diseño.

SOLUCIÓN:
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CONCLUSIONES

Los circuitos digitales combinacionales son aquellos que en su salida está sujeta al valor de su

entrada, cuyo ingreso es interpretado por una puerta lógica o un circuito integrado ofreciendo así

una señal de salida. Partiendo de la experiencia del desarrollo de los ejercicios propuestos,

concluyo que para realizar casos prácticos la sucesión de pasos seria:

 Establecer ingresos y salidas del circuito.

 Tablas de valores de verdad.

 Interpretación de la función lógica de conveniencia.

 Definir la puerta lógica e implementación.

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BIBLIOGRAFIA

 Muñoz, J. (2012). Introducción a los Sistemas Digitales: Un enfoque usando Lenguajes

de Descripción de Hardware. (Capítulos 4, 5 y 6, pp. 77-134). Madrid. Recuperado
de: https://openlibra.com/es/book/introduccion-a-los-sistemas-digitales

 Flórez, F. H. A. (2010). Diseño lógico: fundamentos de electrónica digital. (Capítulos

4, pp. 83-107). Recuperado de: http://bibliotecavirtual.unad.edu.co:2460/lib/unadsp/
detail.action?docID=3199073

 Fajardo, C. (2016, diciembre 17), Diseño de un multiplexor en VHDK. [Archivo de

video], Recuperado: http://hdl.handle.net/10596/9851