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POSICIONES DE MEMORIA
R1 1 2 3 4 n-1 n
DIRECCIONAMIENTO R2 1 2 3 4 … n-1 n
A1 …
DIRECCIÓN
R3 1 2 3 4 n-1 n
CAPACIDAD: A2
A3 R4 1 2 3 4 … n-1 n
. ..
2m n bits .
. . .. .. .. .. .. ..
Am . . . . … . .
2m = M …
RM 1 2 3 4 n-1 n
MEMORIAS
Programadas Programables
Estáticas Dinámicas en el proceso por el usuario FIFO/LIFO
de fabricación PROM/EPROM
TEMA 6: MEMORIAS SEMICONDUCTORAS
6.2.- Memorias de acceso aleatorio: RAM y ROM
En las memorias de acceso aleatorio, el tiempo que se tarda en acceder a una determinada
posición de la memoria es independiente de la posición escogida. Existen dos tipos principales: las
de lectura-escritura (RAM) y las de solo lectura (ROM).
S DESCRIPCIÓN EXTERNA:
I: Entrada de datos.
S: Selección de celda. I
W: Habilitación de escritura. CELDA
O
O: Salida de datos. W RAM
S
MEMORIAS DE LECTURA-ESCRITURA (RAM)
ESTRUCTURA INTERNA Y DESCRIPCIÓN EXTERNA
O3
O O O O O O O O
CELDA CELDA CELDA CELDA CELDA CELDA CELDA CELDA
03 13 23 33 43 53 63 73
I W S I W S I W S I W S I W S I W S I W S I W S
I3
SALIDA DE DATOS
O2
O O O O O O O O
CELDA CELDA CELDA CELDA CELDA CELDA CELDA CELDA
ENTRADA DE DATOS
02 12 22 32 42 52 62 72
I W S I W S I W S I W S I W S I W S I W S I W S
I2
O1
O O O O O O O O
CELDA CELDA CELDA CELDA CELDA CELDA CELDA CELDA
01 11 21 31 41 51 61 71
I W S I W S I W S I W S I W S I W S I W S I W S
I1
O0
O O O O O O O O
CELDA CELDA CELDA CELDA CELDA CELDA CELDA CELDA
00 10 20 30 40 50 60 70
I W S I W S I W S I W S I W S I W S I W S I W S
I0
R0 R1 R2 R3 R4 R5 R6 R7 I0 I1 I2 I3
A2
CS
A1 RAM
8x4 bits
A0 WE
O0 O1 O2 O3
DECODIFICADOR
A2 A1 A0 WE CS
HABILITACIÓN SELECCIÓN
BITS DE DIRECCIÓN DE ESCRITURA DE CHIP
TEMA 6: MEMORIAS SEMICONDUCTORAS
6.2.- Memorias de acceso aleatorio: RAM y ROM
R7
I I I I
CELDA CELDA CELDA CELDA
W 70 O W 71 O W 72 O W 73 O
DECODIFICADOR S S S S
WE
CS
A2
CS
A1
RAM
8x4 bits D0 D1 D2 D3
WE
A0
D0 D1 D2 D3
TERMINALES DE ENTRADA Y SALIDA DE DATOS
TEMA 6: MEMORIAS SEMICONDUCTORAS
6.2.- Memorias de acceso aleatorio: RAM y ROM
R1
Celda DRAM
Cada celda DRAM está
R2 constituida por dos
transistores MOS.
RM
VENTAJAS: INCONVENIENTES:
- Mayor densidad de integración. - Pérdida de cargas necesidad de refresco.
- Coste más bajo para altas capacidades. - Durante el refresco no se accede a la información.
TEMA 6: MEMORIAS SEMICONDUCTORAS
6.2.- Memorias de acceso aleatorio: RAM y ROM
D0
Posición de Dirección Datos m2
memoria A2 A1 A0 D3 D2 D1 D0
m0
m0 0 0 0 0 1 1 0 m4
m3 m5 D1
m1 0 0 1 0 0 0 1 A2 m6
m2 0 1 0 0 1 0 1 A1
m0
A0 m4 m2
m3 0 1 1 1 1 0 0 m3
m4
D2
m4 1 0 0 0 1 1 0 m7
m5
m5 1 0 1 1 0 1 1 m3
m6 1 1 0 1 0 1 0 m5 D3
m6
m7 1 1 1 0 1 0 1 m6
m7
DECODIFICADOR CODIFICADOR
TEMA 6: MEMORIAS SEMICONDUCTORAS
6.2.- Memorias de acceso aleatorio: RAM y ROM
DECODIFICADOR CODIFICADOR
DECODIFICADOR
m0 m1 m2 m3 m4 m5 m6 m7
0 0 0 1(VCC) 0 0 0 0
R
D0
R
D1
R D2
R I
D3
-VCC
TEMA 6: MEMORIAS SEMICONDUCTORAS
6.2.- Memorias de acceso aleatorio: RAM y ROM
DECODIFICADOR
m0 m1 m2 m3 m4 m5 m6 m7
R
D0
R
D1
R
D2
R
D3
El borrado de la memoria consiste en la eliminación de las cargas en las puertas flotantes de los MOS:
a) UV-EPROM: El borrado hace mediante la exposición a radiación ultravioleta.
b) E2PROM: El borrado se hace mediante impulsos eléctricos se puede reprogramar sin necesidad de
extraerla del circuito.
TEMA 6: MEMORIAS SEMICONDUCTORAS
6.2.- Memorias de acceso aleatorio: RAM y ROM
A2 A2 A2
A1 CS A1 CS
A1 RAM 1 RAM 2
8x4 bits A0 8x4 bits
A0 A0 WE WE
D0 D1 D2 D3 D0 D1 D2 D3
D0
D1
D2
D3
D4
D5
D6
D7
BUS de
8 líneas
TEMA 6: MEMORIAS SEMICONDUCTORAS
6.2.- Memorias de acceso aleatorio: RAM y ROM
A3
WE
A2 A2 A2
A1 CS CS
A1 RAM 1 A1 RAM 2
8x4 bits 8x4 bits
A0 A0 WE A0 WE
D0 D1 D2 D3 D0 D1 D2 D3
D0
D1
D2
D3
BUS de
4 líneas
TEMA 6: MEMORIAS SEMICONDUCTORAS
6.2.- Memorias de acceso aleatorio: RAM y ROM
TIEMPOS DE CONMUTACIÓN
En las memorias se deben respetar una serie de especificaciones temporales para poder
leer y escribir correctamente en ellas. Ejemplos:
a) Diagrama de tiempos en una ROM ilustrando el efecto de un cambio de dirección:
t0 t1 t2 t3 t4
Dirección
(Ai)
tAA
Selección Chip no
de chip Chip
seleccionado seleccionado
(CS)
tCE tOH
TIEMPOS DE CONMUTACIÓN
b) Diagrama de tiempos en una ROM ilustrando el efecto de la deshabilitación del chip:
t0 t1 t2 t3 t4
Dirección
(Ai)
tAA
Selección
Chip no Chip
de chip
seleccionado seleccionado
(CS)
tCE tCD
TIEMPOS DE CONMUTACIÓN
c) Diagrama de tiempos asociado a la escritura de datos en una RAM:
Selección
de chip
(CS)
Dirección
(Ai)
Entrada
de datos
(Dj)
Habilitación
de escritura
(WE)
tWSD tWHD
tWSA tW tWHA
tWSCS tWHCS
tWSD: Retardo de escritura para datos. tW: Anchura tWHD: Mantenimiento de escritura para datos.
tWSA: Retardo de escritura para dirección. del pulso de tWHA: Mantenimiento de escritura para dirección.
tWSCS: Retardo de escritura para selección de chip. escritura tWHCS: Mantenimiento de escritura para selección de chip.
TEMA 6: MEMORIAS SEMICONDUCTORAS
6.3.- Memorias de acceso secuencial: FIFO y LIFO
En las memorias secuenciales, el tiempo que se tarda en acceder a una determinada posición de
la memoria depende de la posición escogida. Existen dos tipos principales: las FIFO y las LIFO.
MEMORIAS FIFO
Las siglas FIFO significan First Input First Output. Consisten básicamente en una serie de registros
de desplazamiento:
REGISTRO DE DESPLAZAMIENTO
O0
I0 SR0 k bits
ENTRADA DE DATOS
SALIDA DE DATOS
REGISTRO DE DESPLAZAMIENTO
O1
I1 SR1 k bits
. .
. .
. .
REGISTRO DE DESPLAZAMIENTO
On-1
In-1 SRn-1 k bits
SALIDA DE DATOS
In-1
. .
. .
. .
I1 O1
O0
I0
D0 Q0 D1 Q1 Dn-1 Qn-1
REG. DESP. REG. DESP. REG. DESP.
SR0 SR1 ... SRn-1
k bits k bits k bits
DIRECCIÓN DE SD0 C0 SD1 C1 SDn-1 Cn-1
DESPLAZAMIENTO
SD
Reloj
Diferencias con las memorias FIFO: Capacidad: k×n (k palabras de n bits)
- No hay recirculación de datos.
- Los datos se escriben en, y se leen de, la misma etapa de los registros de desplazamiento.
- Los registros de desplazamiento son reversibles (SD).
TEMA 6: MEMORIAS SEMICONDUCTORAS
6.3.- Memorias de acceso secuencial: FIFO y LIFO
Dirección
CLK CONTADOR RAM
(Puntero de pila)
MR
U/D
Sentido de cuenta
R/W WE
Terminal de lectura-escritura