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Presentado por:
Profesor:
OSCAR QUINTERO
ELECTRÓNICA DIGITAL 1
YOPAL CASANARE
10-04-2020
FUNDACIÓN UNIVERSITARIA DE SAN GIL UNISANGIL
FACULTAD DE CIENCIAS NATURALES E INGENIERÍA
INGENIERÍA ELECTRÓNICA
CONTENIDO
INTRODUCCION .......................................................................................................................... 4
Lógica Positiva..................................................................................................................... 5
a) 𝑨𝑩(𝑪 + 𝑫) = 𝑨𝑩 + (𝑪 + 𝑫) = 𝑨 + 𝑩 + 𝑪 𝑫 = 𝑨 + 𝑩 + 𝑪 𝑫............................... 7
c) Simulaciones .................................................................................................................... 7
a) 𝑩 + 𝑩𝑪 𝑩 + 𝑩𝑪(𝑩 + 𝑫) ............................................................................................... 8
c) Simulaciones .................................................................................................................... 8
c) Simulaciones .................................................................................................................... 9
c) Simulaciones .................................................................................................................. 10
a) Segmento a ..................................................................................................................... 12
b) Segmento b ..................................................................................................................... 13
c) Segmento c ..................................................................................................................... 13
d) Segmento d ..................................................................................................................... 13
e) Segmento e ..................................................................................................................... 14
f) Segmento f...................................................................................................................... 14
g) Segmento g ..................................................................................................................... 14
4. CONCLUSIONES ................................................................................................................ 16
5. BIBLIOGRAFÍA .................................................................................................................. 16
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INTRODUCCION
Existen diferentes tipos de compuertas y algunas de estas son más complejas, con la posibilidad
de ser simuladas por compuertas más sencillas. Todas estas tienen tablas de verdad que explican
los comportamientos en los resultados que otorga, dependiendo del valor booleano que tenga en
cada una de sus entradas y está orientada al estudio de las compuertas lógicas, que son de gran
utilidad en el diseño de los circuitos lógicos. En el estudio de las compuertas lógicas será analizada
su operación lógica mediante el álgebra booleana. También veremos cómo se combinan las
compuertas lógicas para producir circuitos lógicos que serán analizados mediante álgebra
booleana.
El álgebra booleana se utiliza para expresar los efectos que los diversos circuitos digitales ejercen
sobre las entradas lógicas y para manipular variables lógicas con objeto de determinar el mejor
método de ejecución de cierta función de un circuito. Ya que solo puede haber dos valores, el
álgebra booleana es muy sencilla de entender y manejar. De hecho en el álgebra booleana solo
existen tres operaciones básicas: OR, AND Y NOT. Usaremos el álgebra booleana primero para
describir y analizar estas compuertas lógicas básicas y más tarde para analizar combinaciones de
compuertas lógicas conectadas como circuitos lógicos.
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OBJETIVO GENERAL
Aplicar el álgebra booleana y los métodos de simplificación para obtener la implementación más
sencilla posible en el diseño de circuitos lógicos.
1. OBEJTIVOS ESPECIFICOS
2. FUNDAMENTO TEORICO
ELECTRÓNICA DIGITAL
Es una ciencia que estudia las señales eléctricas, pero en este caso son señales discretas, es decir,
están bien identificadas, razón por la cual a un determinado nivel de tensión se lo llama estado alto
(High) o Uno lógico; y a otro, estado bajo (Low) o Cero lógico. Si suponemos que las señales
eléctricas con que trabaja un sistema digital son 0V y 5V. Donde 5V será el estado alto o uno
lógico, pero habrá que tener en cuenta que existe la Lógica Positiva y la Lógica Negativa, veamos
cada una de ellas.
LÓGICA POSITIVA
En esta notación al 1 lógico le corresponde el nivel más alto de tensión (positivo, si quieres llamarlo
así) y al 0 lógico el nivel más bajo (que bien podría ser negativo), pero que ocurre cuando la señal
no está bien definida...?. Entonces habrá que conocer cuáles son los límites para cada tipo de señal
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(conocido como tensión de histéresis), en la figura 2.1 se puede ver con mayor claridad cada estado
lógico y su nivel de tensión.
Figura 1: lógicas
LÓGICA NEGATIVA
Aquí ocurre todo lo contrario, es decir, se representa al estado "1" con los niveles más bajos de
tensión y al "0" con los niveles más altos.
ÁLGEBRA DE BOOLE
El álgebra booleana es la teoría matemática que se aplica en la lógica combinatoria. Las variables
booleanas son símbolos utilizados para representar magnitudes lógicas y pueden tener sólo dos
valores posibles: 1 (valor alto) o 0 (valor bajo).
Las operaciones booleanas son posibles a través de los operadores binarios negación, suma y
multiplicación, es decir que estos combinan dos o más variables para conformar funciones lógicas.
Una compuerta es un circuito útil para realizar las operaciones anteriormente mencionadas.
Compuertas Lógicas Las compuertas lógicas son dispositivos que operan con aquellos estados
lógicos que funcionan igual que una calculadora, de un lado ingresas los datos, ésta realiza una
operación, y finalmente, te muestra el resultado.
3. PROCEDIMIENTO Y METODOLOGIA
La actividad se desarrolla de manera individual, cada estudiante elige un ejercicio de cada tema
propuesto teniendo en cuenta si el dígito final de su documento de identidad es par o impar, es
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decir si su documento termina en número par, tiene la opción de elegir cualquier problema par de
cada tema, lo mismo aplica para los números impares.
a) 𝑨𝑩(𝑪 + 𝑫) = 𝑨𝑩 + (𝑪 + 𝑫) = 𝑨 + 𝑩 + 𝑪 𝑫 = 𝑨 + 𝑩 + 𝑪 𝑫
b) Tabla de verdad
Tabla 1: ejercicio 1
A B C D X
0 0 0 0 1
0 0 0 1 0
0 0 1 0 1
0 0 1 1 1
0 1 0 0 1
0 1 0 1 1
0 1 1 0 1
0 1 1 1 1
1 0 0 0 0
1 0 0 1 1
1 0 1 0 0
1 0 1 1 0
1 1 0 0 1
1 1 0 1 1
1 1 1 0 1
1 1 1 1 1
c) Simulaciones
a) ( 𝑩 + 𝑩𝑪)( 𝑩 + 𝑩𝑪)(𝑩 + 𝑫)
B (B + D)
( 𝐵 + 𝐵𝐷 ) = 𝐵
b) Tabla de verdad
Tabla 2: ejercicio 3
B C D X
0 0 0 0
0 0 1 0
0 1 0 0
0 1 1 0
1 0 0 1
1 0 1 1
1 1 0 1
1 1 1 1
c) Simulaciones
a) ̅𝑪
𝑨𝑩(𝑩 ̅ + 𝑩𝑫)
Dominio: A, B, C, D Forma Estándar = 𝐴𝐵𝐷(𝐶 + 𝐶̅ ) = 𝐴𝐵𝐶𝐷 + 𝐴𝐵𝐶̅ 𝐷
b) Tabla de verdad
Tabla 3: ejercicio 2
A B C D X
0 0 0 0 1
0 0 0 1 0
0 0 1 0 1
0 0 1 1 1
0 1 0 0 1
0 1 0 1 1
0 1 1 0 1
0 1 1 1 1
1 0 0 0 0
1 0 0 1 1
1 0 1 0 0
1 0 1 1 0
1 1 0 0 1
1 1 0 1 1
1 1 1 0 1
1 1 1 1 1
c) Simulaciones
Figura 4: ejercicio 2
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a) 𝑨𝑩 + 𝑨𝑩𝑪 + 𝑨𝑪 + 𝑨𝑩𝑪
𝐴𝐵 + 𝐴𝐵𝐶 + 𝐴𝐶 + 𝐴𝐵𝐶
= 𝐴𝐵 (𝐶 + 𝐶)
=𝐴𝐵𝐶 + 𝐴𝐵𝐶
= 𝐴𝐶𝐵 (𝐵 + 𝐵)
=𝐴𝐶𝐵 + 𝐴𝐶 𝐵
b) Tabla de verdad
Tabla 4: ejercicio
A B C X
0 0 0 1
0 0 1 1
0 1 0 1
0 1 1 1
1 0 0 1
1 0 1 1
1 1 0 1
1 1 1 0
c) Simulaciones
Figura 5: simulación
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a) 𝑨𝑩 + 𝑨𝑩𝑪 + 𝑨𝑪 + 𝑨𝑩𝑪
b) Mapa de Karnaugh
B, C
00 01 11 10
1 1 1 1
A 0
1 1 0 1
1
𝐴+ 𝐵+ 𝐶
Determinar la lógica mínima para un BCD (decodificador binario a decimal) mediante el uso de
expresiones booleanas y el mapa de Karnaugh, diseñar y simular mediante el software proteus.
Los pines sin letra son los comunes, es decir si es de ánodo común se conecta a vcc (normalmente
5 voltios), y si es de cátodo común se conecta a tierra.
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A continuación se muestra la tabla de la verdad y pasamos a realizar los mapas de Karnaugh. Como
son 7 salidas, entonces son 7 mapas. Además se hará, de ser posible el uso de compuertas NAND
y XOR, la razón es que implementar el circuito es más sencillo, disminuyendo el número de
circuitos integrados usados.
De acuerdo con la tabla de verdad anterior se hizo los mapas de Karnaugh y ecuaciones de cada
uno de los segmentos.
a) Segmento a
CD
AB
00 01 11 10
0 1 0 1 1
01 0 1 1 1
11 X X X X
10 1 1 X X
Ecuación: ̅̅̅̅̅̅̅̅̅̅̅̅̅̅̅
𝐶̅ 𝐴̅(𝐵 ⊕ 𝐷)
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b) Segmento b
CD
AB
00 01 11 10
0 1 1 1 1
01 1 0 1 0
11 X X X X
10 1 1 X X
̅̅̅̅̅̅̅̅̅̅)
Ecuación: 𝐵(𝐶⨁𝐷
c) Segmento c
CD
AB
00 01 11 10
0 1 1 1 0
01 1 1 1 1
11 X X X X
10 1 1 X X
Ecuación: ̅̅̅̅̅̅̅̅
𝐴̅𝐵̅ 𝐶𝐷
̅
d) Segmento d
CD
AB
00 01 11 10
0 1 0 1 1
01 0 1 0 1
11 X X X X
10 1 0 X X
̅̅̅̅̅̅̅̅̅̅̅̅̅̅̅̅̅̅̅̅
̅̅̅̅
̅ ̅̅̅̅ ̅ ̅̅̅̅̅̅
Ecuación: 𝐵̅𝐷 𝐶𝐵̅ ̅̅̅̅
𝐶𝐷 𝐵𝐶̅ 𝐷
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e) Segmento e
CD
AB
00 01 11 10
0 1 0 0 1
01 0 0 0 1
11 X X X X
10 1 0 X X
Ecuación: ̅̅̅̅̅̅̅̅
̅̅̅̅
𝐵 ̅ ̅̅̅̅
̅𝐷 ̅
𝐶𝐷
f) Segmento f CD
AB
00 01 11 10
0 1 0 0 0
01 1 1 0 1
11 X X X X
10 1 1 X X
̅̅̅̅̅̅̅̅̅̅̅̅̅̅̅̅
Ecuación: 𝐴̅ ̅̅̅̅
̅ ̅̅̅̅
𝐶̅ 𝐷 𝐵𝐶̅ ̅̅̅̅
̅
𝐵𝐷
g) Segmento g
CD
AB
00 01 11 10
0 0 0 1 1
01 1 1 0 1
11 X X X X
10 1 1 X X
̅̅̅̅̅̅̅̅̅̅̅̅̅̅̅
̅̅̅̅̅
̅ (𝐵⨀𝐶)
Ecuación:𝐴 𝐶𝐷
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Se realizó con compuertas NAND y XOR, la razón es que implementar el circuito es más sencillo,
disminuyendo el número de circuitos integrados usados.
4. CONCLUSIONES
Se pudo comprobar los diferentes postulados del álgebra booleana y los métodos de simplificación
para obtener la implementación más sencilla posible en el diseño de circuitos lógicos.
Se logró aplicar las leyes y reglas básicas del álgebra booleana y adicionalmente se logró también
aplicar en práctica de simulaciones los teoremas de DeMorgan a expresiones booleanas.
Con la simplificación de expresiones usando las leyes y reglas del álgebra booleana se reduce
mucha más circuitos.
El uso de los mapas de Karnaugh ayuda a la simplificación de las expresiones booleanas y también
nos permite simplificar las tablas de verdad.
En la aplicación sistemática donde se hizo el display 7 segmentos se logró aplicar álgebra booleana
y el método de mapa de Karnaugh.
5. BIBLIOGRAFÍA
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