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Clase13 - VHDL Senencias y Ejemplo
Clase13 - VHDL Senencias y Ejemplo
Sintaxis:
Segunda opción
IF condicion THEN SENTENCIAS
ELSE SENTENCIAS
END IF;
3. Diseño Digital usando VHDL
3.8. Sentencias para flujo de datos
3.8.2. Sentencias Condicionales
LA SENTENCIA IF
Sintaxis:
Tercera opción:
IF condición THEN SENTENCIAS
ELSIF condición THEN SENTENCIAS
ELSIF condición THEN SENTENCIAS . . .
END IF;
Sintaxis:
CASE expresión IS
WHEN valor => SENTENCIAS
WHEN rango_de_valores => SENTENCIAS
WHEN OTHERS => SENTENCIAS (debe incluirse Others, cuando no se
escriben todos los posibles valores)
END CASE;
3. Diseño Digital usando VHDL
3.8. Sentencias para flujo de datos
3.8.2. Sentencias Condicionales
LA SENTENCIA CASE
En los bucles (LOOP) pueden utilizarse sentencias EXIT y NEXT que sirven,
respectivamente, para salir o finalizar una determinada iteración.
null;
3. Diseño Digital usando VHDL
3.9. Subprogramas
Además de los operadores predefinidos, el lenguaje VHDL permite el uso de
subprogramas para el diseño de operaciones de computación y el modelado
hardware.
Sintaxis:
La sintaxis básica de la declaración de funciones y procedimientos es: