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se presenta una recopilación de las bases teóricas empleadas para diseñar bloques
funcionales del codificador/decodificador Reed-Solomon y una metodología de
diseño orientada a tecnología FPGA empleando VHDL
Para codificar la trama con esta estructura se debe procesar a través de un circuito
digital que opere bajo los fundamentos de campo finito de Galois. Este presenta
una arquitectura en el codificador compuesta por los bloques funcionales
mostrados en la Figura
CAMPOS DE GALOIS APLICADOS A LA
CODIFICACIÓN REED-SOLOMON