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Practica 6
Practica 6
MARÍA
CIRCUITOS DIGITALES
GRUPO: 03
2021
ELEMENTOS DE MEMORIA Y LATCHS
I. OBJETIVO:
• Verificar experimentalmente la operación de los latchs.
• Verificar experimentalmente la operación de los flip-flops.
2.1 LATCH
El latch (cerrojo) es un tipo de dispositivo de almacenamiento temporal de dos estados
(biestables), que se suele agrupar en una categoría diferente a la de los flip-flops.
Básicamente, los latches son similares a los flip-flops, ya que son también dispositivos
de dos estados que pueden permanecer en cualquier de sus dos estados gracias a su
capacidad de realimentación, lo que consiste en conectar (realimentar) cada una de las
salidas a la entrada opuesta. La diferencia principal entre ambos tipos de dispositivos
está en el método empleado para cambiar de estado.
Una señal de reloj oscila entre estado alto o bajo, y gráficamente toma la forma de una
onda cuadrada. Los circuitos que utilizan la señal de reloj para la sincronización pueden
activarse en el flanco ascendente, flanco descendente o en ambos, por ejemplo, las
memorias DDR SDRAM son activadas en ambos flancos.
La mayoría de los circuitos integrados complejos utilizan una señal de reloj para
sincronizar sus diferentes partes y contar los tiempos de propagación.
FLIP-FLOP
Los flip-flops son circuitos capaces de permanecer en uno de dos estados estables. Su
funcionamiento es similar al de un latch con gatillo.
Un pulso de entrada selecciona uno de los estados del flip-flop, el cual puede permanecer
por tiempo indefinido. El siguiente pulso de entrada lleva al flip-flop al estado opuesto,
que también es estable.
Los dos estados opuestos se consideran estables porque es necesario aplicar un pulso de
entrada para cambiar el nivel de la salida.
Por consiguiente, un flip-flop es un dispositivo biestable, similar en su operación a un
circuito multivibrador biestable. La abreviatura para el flip-flop es FF.
Los flip-flops son importantes en circuitos lógicos porque presentan características de
memoria.
Para cada pulso de entrada el circuito mantiene las condiciones de salida hasta la llegada
del siguiente pulso de entrada. Debe notarse que las compuertas lógicas no tienen esta
capacidad de memoria.
Flip-flop J-K
Este flip-flop J-K se considera como el FF universal. Su símbolo lógico se muestraen la
figura.
Tiene dos entradas para datos etiquetadas como J y K así como otra para el pulso de reloj
(CK). También tiene dos salidas: Q y Q’. La flecha (>) en la entrada CK indica que es
disparado por flanco ascendente; el círculo señala que el disparo se hace con el flanco
descendente, lo cual significa que los datos se transfieren desde las entradas hasta la
salida Q cuando el pulso de reloj efectúa una transición desde ALTO hasta BAJO.
Modo de retención (hold). Este modo corresponde al estado de memoria. Los pulsos de
reloj en la entrada CK no tienen efecto alguno sobre las salidas.
Flip-flop T
En este caso, el flip-flop alterna si T=1 cuando el reloj hace una transición de alto a bajo
y conserva su estado actual si T=0 cuando el flip-flop está controlado por el reloj.
El circuito equivalente del flip-flop T con reloj, es sólo un flip-flop JK con entradas
J=K=T, y su entrada C es controlada por la señal del reloj. La ecuación característica del
flip-flop T con reloj se puede deducir de la ecuación del flip-flop JK, sustituyendo T por
J y K de la manera siguiente:
III. INFORME PREVIO:
1. Analizar y señalar las características eléctricas y electrónicas de los CI – TTL:
74LS73, 74LS74, 74LS75, 74LS76 y 74LS194, en base a las hojas de datos.
• 74LS73:
• Características:
• Entrada y salida TTL
• Aplicaciones: Industrial, comunicaciones y red
• Especificaciones:
• Familia: LS
• Tipo de Flip-flop: JK
• Tipo de trigger: Edge Negativo
• Tipo de salida: Differential / Complementaria
• Retardo de propagación: 15 ns
• Frecuencia: 30 MHz
• Tensión de alimentación mínima: 4.75 V
• Tensión de alimentación máxima: 5.25 V
• Corriente de salida: 8 mA
• Temperatura de funcionamiento mínima: 0 ° C
• Temperatura de funcionamiento máxima: 70 ° C
• Encapsulado: DIP
• 14 pines
➢ 74LS74:
• Características:
• Salida de colector abierto los indicadores de transmisión
directamente
• Provisión de prueba de lámpara
• Supresión de cero / arrastre de cero
• Todos los tipos de circuitos cuentan con capacidad de
modulación de intensidad de lámpara
• Especificaciones:
• Familia: LS
• Tipo de Flip-flop: D
• Tipo de trigger: Positivo
• Tipo de salida: Diferencial / Complementarias
• Retardo de propagación: 13 ns
• Frecuencia: 33 MHz
• Salida de Corriente: 8 mA
• Tensión de alimentación mínima: 4.75 V
• Tensión de alimentación máxima: 5.25 V
• Temperatura de funcionamiento mínima: 0°C
• Temperatura de funcionamiento máxima: 70°C
• Encapsulado: DIP
• 14 pines
• 74LS75:
• Características:
• Aplicaciones: Industrial
• Especificaciones
• Familia: LS
• Tipo de cierre: Tipo D biestable
• Tipo de Salida: Diferencial
• Número de puntas: 8 bits
• Tensión de alimentación mínimo: 4.75V
• Tensión de alimentación máximo: 5.25V
• Corriente de Salida 8mA
• Retardo de Propagación 15ns
• Temperatura de trabajo mínima: 0°C
• Temperatura de trabajo máxima: 70°C
• Encapsulado: DIP
• 16 pines
• Modelo: 60K6893
• 74LS76:
• Especificaciones:
• Familia: LS
• Tipo: Dual J-K Flip Flop
• Tensión de alimentación mínima: 4.75 V
• Tensión de alimentación máxima: 5.25 V
• Temperatura de trabajo mínima: 0°C
• Temperatura de trabajo máxima: 70°C
• Encapsulado: DIP
• 16 Pines
• 74LS194:
• Características:
• Frecuencia de cambio típica de 36 MHz
• Restablecimiento maestro asíncrono
• Modo de espera (no hacer nada)
• Transferencias de datos en serie o paralelas totalmente
sincrónicas
• Los diodos de abrazadera de entrada limitan los efectos de
terminación de alta velocidad
• Especificaciones
• Familia: LS
• Función registro de desplazamiento: Universal
• Tipo lógica del circuito: Registro de desplazamiento
• Número de elementos: 1
• Tipo de salida: Estándar
• Tensión de alimentación mínima: 4.75 V
• Tensión de alimentación máxima: 5.25 V
• Temperatura de operación mínima: 0 °C
• Temperatura de operación máxima: 70 °C
• Encapsulado: DIP
• Número de pines: 16
En muchas aplicaciones esto no supone ningún problema, pero en otras sí. En los
circuitos de contaje, por ejemplo, la aparición de rebotes en los impulsos de entrada
debe evitarse porque, si no, esto también es contado.
El esquema que se va a usar para proteger un pulsador del efecto rebote, o sea, el
circuito antirrebote, un circuito en la que utiliza un interruptor I, una puerta lógica
G (Trigger-Schmitt, 74LS13, CD40903), junto con un condensador electrolítico C
cuyo valor se puede aumentar o reducir (1uF/63V) y un par de resistencias de 1k.
FUNCIONAMIENTO DEL CIRCUITO ANTIRREBOTE:
Al cerrar I, el condensador C, se descargará a través de R (Línea a trazos D), hasta la
tensión de basculamiento 0,9V para TTL y su salida S, pasará al nivel alto (H). No
obstante, cuando se abra I, el condensador se cargará de nuevo y cuando su tensión
alcance los 17V la salida S, basculará al nivel L.
Debido a las características del esquema, los rebotes de los contactos mecánicos, no
tendrán efecto en la señal de entrada en G ya que cuando estos se producen, el
condensador se está cargando o en otro caso se está descargando.
La capacidad del condensador se podrá aumentar, en función del número de rebotes
mecánicos del interruptor. Aunque no es conveniente que sea muy alto el efecto de
histéresis, puede retrasar demasiado la carga y no podría generar un posterior
impulso a tiempo. Normalmente su valor puede estar entre 0,02uf y 1uf o un poco
más.
3. Que es un circuito de reloj, cuáles son sus características y como se construye un
circuito de reloj.
Una señal de reloj (en inglés clock signal, o simplemente clock) es en la electrónica
digital una señal binaria, que sirve para coordinar las acciones de varios circuitos,
en especial para la sincronización de biestables en sistemas digitales complejos.
Según su aplicación, la señal de reloj se puede repetir con una frecuencia
predefinida o también ser aperiódica.
En los casos en los que hay una señal de reloj, suele darse por medio de un generador
de reloj. La señal oscila entre un estatus alto y bajo, que se caracteriza por un
período de oscilación o bien por un valor de cambio, la frecuencia de reloj y el ciclo
de trabajo.
Los circuitos que utilizan la señal de reloj para sincronizarse, pueden, según su
construcción, basarse en el flanco ascendente o en el descendente de la señal (en el
caso de DDR se utilizan ambos flancos). En hojas técnicas y diagramas a la señal
de reloj se le suele describir como CLK.
La mayoría de circuitos integrados complejos requieren una señal de reloj, para
sincronizar diferentes partes del chip y equilibrar los retrasos de las puertas. Dado
que los chips son cada vez más complejos, es cada vez más difícil proveer de una
señal de reloj precisa y homogénea en todos los sitios. Ejemplo ilustrativo de este
problema son los microprocesadores, componente central de las computadoras
modernas. Para los transistores se suele indicar la frecuencia, hasta la que es posible
amplificar una pequeña señal. Ésta suele ser diez veces mayor a la frecuencia de
reloj.
Si utilizamos un C.I 555:
El temporizador IC 555 es un circuito integrado (chip) que se utiliza en una variedad
de aplicaciones y se aplica en la generación de pulsos y de oscilaciones. El 555
puede ser utilizado para proporcionar retardos de tiempo, como un oscilador, y
como un circuito integrado flip-flop. Sus derivados proporcionan hasta cuatro
circuitos de sincronización en un solo paquete. Introducido en 1971 por Signetics,
el 555 sigue siendo de uso generalizado debido a su facilidad de uso, precio bajo y
la estabilidad. Muchas empresas los fabrican en versión de transistores bipolares y
también en CMOS de baja potencia.
MATERIALES:
- 1 555
- 1 DIODO LED
- 1 RESISTENCIA 1 K
- 1 RESISTENCIA DE 220 O 330
- 1 POTENCIOMETRO DE 10 K O 100 K
- 1 CAPACITOR DE 10 uF
- 1 FUENTE DE 5 V - 12V
• 7473:
• 7474:
• 74194:
IV. MATERIALES Y EQUIPOS
• Fuentes de Alimentación • Circuitos integrados
• Multímetro ➢ 2 CI 7473 Flip Flop JK
➢ 2 CI 7474 Flip Flop D
➢ 2 CI 7400 NAND
➢ 1 CI 74194 Reg. Universal
➢ 2 CI 7402 NOR
• Cables de conexión • 4 Resistencias (220,330,560,1K)
• 4 Dip switch de 4 y 8 contactos • Leds de colores variados
• Protoboard
V. PROCEDIMIENTO
LATCH
1. Implemente el siguiente circuito.
Entradas Salidas
Explicación
S R Q Q'
1 1 0 0 Condición no válida
0 1 0 1 Se restablece (RESET)
1 0 1 0 Se establece (SET)
0 0 N.C N.C No cambia, permanece en el estado inicial
3. Cambie el Latch anterior con uno construido con puertas NAND.
Entradas Salidas
Explicación
S R Q Q'
1 1 N.C N.C No cambia, permanece en el estado inicial
0 1 1 0 Se establece (SET)
1 0 0 1 Se restablece (RESET)
0 0 1 1 Condición no válida
6. Reemplace las puertas NOR por puertas NAND y verifique el funcionamiento anotando
en una tabla.
E R S Q Q'
0 0 0 N.C N.C
0 1 0 N.C N.C
0 0 1 N.C N.C
0 1 1 N.C N.C
1 0 0 N.C N.C
1 1 0 0 1
1 0 1 1 0
1 1 1 latch latch
FLIP-FLOP TIPO D
D Q Q' Comentario
0 0 1 SET
1 1 0 RESET
0 0 D 1 1
0
FLIP-FLOP TIPO JK
13. Armar el circuito para probar el flip flop tipo JK
14. Aplique los niveles y pulsos de reloj necesarios (circuito antirebote) y anote sus
resultados en una tabla.
CLK J K Q Q'
1 0 0 N.C N.C
1 1 0 1 0
1 0 1 0 1
1 1 1 latch latch
10
11
00 0 JK 00
1
01 10
10
11
FLIP-FLOP TIPO T
17. En base a los flip flops tipo JK implemente un flip flop tipo T
18. Aplique los niveles y pulsos necesarios y anote sus resultados en una tabla.
T Q Q' Comentario
0 0 1 Sin cambios
1 1 0 Cambio
19. Grafique el Diagrama de Estados de dicho flip flop.
0 0 T 1 0
Un ejemplo es uno construido con cuatro flip-flops tipo D y una entrada común de
pulsos de reloj. La entrada de pulsos de reloj, CP, habilita todos los flip-flops de
modo que la información presente disponible en las cuatro entradas puede
transferirse al registro de 4-bits.
VIII. BIBLIOGRAFÍA:
Indique la bibliografía consultada en la elaboración de su informe.