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Trabajo Colaborativo Final Electronica Digital
Trabajo Colaborativo Final Electronica Digital
ELECTRÓNICA DIGITAL
PROYECTO FINAL
PRESENTADO POR:
GRUPO:
243004_36
PRESENTADO A:
MARIO RICARDO ARBULU
PLATO MAGDALENA
DICIEMBRE 2017
ELECTRONICA DIGITAL
1. Diseñe un circuito que permita contar las personas que entran a una
discoteca. El diseño tendrá una entrada pulsador que se pondrá en alto
cada vez que una persona cruza la puerta.
a) Diagrama de bloques
b) Descripción en VHDL con al menos al menos dos COMPONENTS y
un archivo de alto nivel.
c) Diagrama RTL generado por el software. El diagrama RTL debe
coincidir con el diagrama de bloques planteado en el ítem a.
d) Simulación: Tenga en cuenta que cada vez que cada vez que una
persona pasa por la puerta, la entrada pulsador permanece en alto
por varios ciclos de reloj (Ver figura 1).
Fig. 2 CD4018B
Un análisis simple de las necesidades y revisando las opciones que nos ofrecen estos
IC’s, podemos optar por un contador de décadas como el CD4018 que es un contador
preajustable divisor por N. Las conexiones externas permiten dividir una frecuencia por
10, 9, 8, 7, 6, 5, 4, 3, 2 . Las entradas 2, 3, 7, 9, y 12 sirven para la pre-selección, es
decir, para situar el contador en un estado inicial previo para contar. Las salidas por los
pines Q1 a Q4, dispone de Reset, Clock, Data y Preset-Enable.
Por supuesto que hay otras opciones, por ejemplo si disponemos del contador/divisor,
los HCC4026B o el HCC4033B consisten cada uno en un contador de décadas (5
etapas Johnson) y un decodificador de salida que convierte el código a un 7 segmentos
de salida decodificado para manejar un display numérico. Estos dispositivos son
especialmente ventajosos en aplicaciones de visualización donde son importante una
baja disipación de potencia y/o bajo recuento. Entradas comunes a ambos tipos son
CLOCK, RESET yCLOCK INHIBIT, salidas comunes son; CARRY OUT y las siete
salidas decodificadas (a, b, c, d, e, f, g). El HCC4026B incluye entradas/salidas
adicionales para DISPLAY ENABLE IN y salida “UNGATED ‘C’ SEGMENT” (segmento
C sin sincronizar). Las señales propias del HCC4033B son entrada de RIPPLE-
BLANKINGK-OUT, una salidaRIPPLE-BLANKING-INPUT y entrada LAMP TEST
INPUT.
Fig. 3 CD4026B y CD4033B
Tenemos varias alternativas que pueden servir para nuestro propósito. Antes de tomar
una decisión, debemos estudiar las posibilidades que más se adapten a nuestro
proyecto, es decir ¿nos interesa que tenga un pre-ajuste integrado o mejor que tenga
salida directa a 7 segmentos? El pre-ajuste no siempre se utiliza o no interviene, pero
estará disponible su uso en cualquier momento. El CD4018B, evidentemente se
descarta ya que no se adapta a lo planteado.
Los tipos HCC4511B son controladores del decodificador BCD a 7 segmentos con latch
(retención) construidos con lógica CMOS y dispositivos de salida de transistores
bipolares NPN en una sola estructura monolítica, figura 8. Estos dispositivos combinan
la disipación de baja energía en reposo y características de inmunidad de ruido del
CMOS con salida de transistores bipolares npn capaces de abastecer hasta 25 mA.
Esta capacidad permite a los tipos HCC4511B manejar directamente LEDs y otras
pantallas. Se proporcionan pines para comprobar la pantalla, prueba de Lámparas (LT),
Supresión (BL) y entradas Latch Enable o Strobe, apagado o de intensidad-
modulada y Store (almacén) o Strobe un código BCD, respectivamente. Varias
señales diferentes pueden ser multiplexadas y se visualizan cuando se utiliza circuitería
de multiplexado externo.
Con estos circuitos a nuestro alcance, vamos a diseñar un circuito que cumpla con el
objetivo propuesto. El siguiente esquema es una aproximación al esquema que
necesitamos. Probaremos con un dígito para aprender como actuar ante un contador
como el CD4029B. He utilizado un interruptor para la alimentación, cuatro interruptores
para simular el preselector de cuenta, uno para la supresión, en realidad este no tiene
demasiado sentido aquí, su utilidad está en otro campo y uno más para habilitar o no la
cuenta, en realidad se comporta como un reset permanente, un pulsador para el reset y
uno segundo pulsador para los pulsos de entrada a contar. Por otra parte están el
conmutador Binario/Decimal que en este proyecto no tiene sentido, lo he puesto para
que se vea su funcionalidad y por último otro conmutador para el conteo INCR/DECR.
La entrada de pulsos es un punto a tener en cuenta, este tema está muy descrito, sin
embargo, he de insistir las señales deben estar bien conformadas lo que nos permitirá
obtener una cuenta sin errores. Es recomendable utilizar si es posible una puerta
Triger-Smitch para escuadrar los pulsos si proceden de un circuito exterior, en nuestro
caso ya se ha previsto la puerta IC5.
EL CIRCUITO.
Una señal Alta PRESET ENABLE, permite obtener información sobre las entradas
JAM para preajustar el contador a cualquier estado, de forma asíncrona con el reloj.
Una señal Baja en cada línea JAM, cuando la señal de PRESET-ENABLE es Alta,
reinicia el contador a cero su cuenta. El contador avanza una cuenta en la transición
positiva del reloj cuando las señales CARRY-IN y PRESET ENABLE son bajas.
e) Diagrama de bloques
f) Descripción en VHDL con al menos al menos dos COMPONENTS y
un archivo de alto nivel.
g) Diagrama RTL generado por el software. El diagrama RTL debe
coincidir con el diagrama de bloques planteado en el ítem a.
h) Simulación: Tenga en cuenta que cada vez que cada vez que una
persona pasa por la puerta, la entrada pulsador permanece en alto
por varios ciclos de reloj (Ver figura 1).
Simulación