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Cdla. Universitaria (Predios Huachi) / Casilla 334 / Telefax: 03-2851894 – 2411537, Correo Electrónico: carrera.industrial@uta.edu.ec
AMBATO-ECUADOR
FORMATO DE PRÁCTICA
PORTADA
UNIVERSIDAD TÉCNICA DE AMBATO
Facultad de Ingeniería en Sistemas, Electrónica e Industrial
“Práctica N° 3”
Tema: Contadores Asincronos
Carrera: Telecomunicaciones
Unidad de Organización Curricular: Profesional
Línea de Investigación: Nanotecnología
Ciclo Académico y Paralelo: 4 “A”
Alumno: Satuquinga Evelin
1.2 Objetivos
Saber que de un contador asíncrono
Desarrollo de los circuitos mod 7, 10 y 15
Verificar el funcionamiento de mod 7,10 y 15 que esta implementado
con con los Flip-flop J-K .
1.3 Resumen
En esta practica se realiza contadores asíncronos con flip flop J-K de mod 7 ,10
y 15 con 3 bits y 4 bits donde las entradas es J y K y las salidas Q y Q negada
y
Se aplica una señal de reloj externa a la primera entrada de reloj en el primer
flip-flop y los demás se aplica con la salida del primer flip-flop .
Con esto podemos decir que podemos realizar la tabla de excitación de flip-flop
para el contador de mod 7,10 y 15.
1.5 Introducción
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1.6.2 Metodología
Contador asíncrono
En los contadores síncronos las entradas de reloj de todos los flip flops se
conectan juntas a un reloj común. De esta manera todos los FF cambian de
estado simultáneamente.
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Estado entrandas
present estado de cada
e futuro
flip flolp
Q(t) q(t+1)
Q Q J J K
d Qc Qb Qa d Qc Qb Qa d Kd c Kc Jb b Ja Ka
0 0 0 0 0 0 0 1 0 x 0 x 0 x 1 x
0 0 0 1 0 0 1 0 0 x 0 x 1 x x 1
0 0 1 0 0 0 1 1 0 x 0 x x 0 1 x
0 0 1 1 0 1 0 0 0 x 1 x x 1 x 1
0 1 0 0 0 1 0 1 0 x x 0 0 x 1 x
0 1 0 1 0 1 1 0 0 x x 0 1 x x 1
0 1 1 0 0 1 1 1 0 x x 0 x 0 1 x
0 1 1 1 1 0 0 0 1 x x 1 x 1 x 1
1 0 0 0 1 0 0 1 x 0 0 x 0 x 1 x
1 0 0 1 0 0 0 0 x 1 0 x 0 x x 1
Tabla 2 tabla de excitación del circuito mod 10
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entrand
Estado as de
present estado cada
e futuro flip flolp
Q(t q(t+
) 1)
Q Q Q Q Q Q K K K J
d Qc b a d Qc b a Jd d Jc c Jb b a Ka
0 0 0 0 0 0 0 1 0 x 0 x 0 x 1 x
0 0 0 1 0 0 1 0 0 x 0 x 1 x x 1
0 0 1 0 0 0 1 1 0 x 0 x x 0 1 x
0 0 1 1 0 1 0 0 0 x 1 x x 1 x 1
0 1 0 0 0 1 0 1 0 x x 0 0 x 1 x
0 1 0 1 0 1 1 0 0 x x 0 1 x x 1
0 1 1 0 0 1 1 1 0 x x 0 x 0 1 x
0 1 1 1 1 0 0 0 1 x x 1 x 1 x 1
1 0 0 0 1 0 0 1 x 0 0 x 0 x 1 x
1 0 0 1 1 0 1 0 x 0 0 x 1 x x 1
1 0 1 0 1 0 1 1 X 0 0 x x 0 1 x
1 0 1 1 1 1 0 0 X 0 1 x x 1 x 1
1 1 0 0 1 1 0 1 X 0 x 0 0 x 1 x
Tabla 3tabla de excitación del mod15
1 1 0 1 1 1 1 0 X 0 x 0 1 x x 1
1 1 1 0 0 0 0 0 X 1 x 1 x 1 0 x
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Como sabemos con los Flip flop jk asíncronos la primera salida continua a las
siguientes de CLK y obtenemos para el contadores de mod15 ascendente y
descendente.
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Sabiendo que para nuestro diseño tenemos tres y cuatro flip flop jk de
referencia 74ls112,El efecto de un impulso en la entrada de reloj primer
integrado 74ls112 se produce .un efecto en el cual no llega inmediatamente al
segundo integrado, debido al retardo de propagación a través del primer
integrado ante mencionado. Del mismo modo, se produce un retardo de
propagación a través de segundo flip -flop, antes de que llegue tercer integrado
pueda ser disparado. Por tanto, el efecto de impulso en la entrada de reloj se
"propaga" a través del contador, tardando un cierto tiempo en alcanzar el último
de los flip-flop, debido a los retardos de propagación.
1.8 Conclusiones
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1.11 Anexos
UNIVERSIDAD TÉCNICA DE AMBATO
FACULTAD DE INGENIERÍA EN SISTEMAS, ELECTRÓNICA E INDUSTRIAL
CARRERA DE
PERÍODO ACADÉMICO: ABRIL / SEPTIEMBRE 2020
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