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SOLIDIC Hoja de datos SDI0829 serie: 0809-X1 \ 19-X1 \ 29-X1

24 Baja tensión de alta precisión analógico

características: Breve descripción:

• 24 resolución de bits (no hay códigos que faltan) SDI0829 serie es un código que falta ninguna resolución de 24

• 20.7 Bits menos significativos bits analógico de baja tensión al convertidor digital. De bajo voltaje

(ENBO 128 Magnificación, 10Hz de salida, 3.0V) características SDI0829 puede asegurar alta exactitud y todavía mantener

• 18.2 Bit código fijo una fuerte rendimiento anti-jamming en tensión de alimentación de 1,5 V,

(ENBO 128 Magnificación, 10Hz de salida, 3.0V) bajo consumo de energía adecuados para su uso en una variedad de escenarios.

• ganancia programable integrada interna: Serie 3 SDI0829 orden interno estructura Sigma-Delta, integración

2 , 4 , 8 , 16 , 32 , 128 , 256 , 1024 , interna 2 veces - 2048 Una ganancia, se puede aplicar fácilmente a varios

2048 tiempo tipos de débil sistema de medición de señal, tales como: balanza

• tasa de salida opcional ( hz ): electrónica, sensor de presión digital, monitores de presión arterial.

0,625 , 1.25 , 2.5 , 5 , 10 , 20 ( por defecto) ,

40 , 80 , 160 , 320 , 640 , 1280 , 2560 , 5120 SDI0829 Hay tres series de canales internos, un canal que tiene

• salida de voltaje de referencia interno: una temperatura interna sensor está conectado. Se puede medir

VCOM salida 1.5V o AVDD fácilmente la temperatura.

• Triple canales de entrada diferenciales SDI0829 Proporcionar una serie salida de la fuente de referencia ( VCOM

(En donde el tercer paso es un sensor de temperatura interna) exportación 1.5V ), También puede ser utilizado para hacer un interruptor de control simple ( VCOM

• adopción SPI interfaz de salida de datos ( 2 línea o 3 línea) exportación AVDD ). por VCOM , Puede suministrar energía a un sensor

• Baja tensión de funcionamiento : 1.5v - 3.0v externo, así como conveniente el suministro de energía.

• Sleep Consumo de energía: Mínimo < 0.1uA SDI0829 Serie de integración interna ( 2-2048 ) Ganancia del

amplificador. ¿Cuándo VREFP = 3.3V ( = 128 PGA Cuando los tiempos), que

aplicación: tiene 20.7 Bits menos significativos ( ENBO ), El ruido de entrada equivalente

• balanzas electrónicas, barómetros de 15nV ;

• sensor de presión digital; SDI0829 por series IDE Pin, la configuración de chip

• monitores de presión arterial y otros equipos médicos;

• señales de medición y control industrial débiles;

modelo paquete explicación

SDI0809AS-X1 SOP8 Compatible SDI0809AS \ SDI0809AD

SDI0809AD-X1 DIP8 (No pines de configuración SDI, utilizan la configuración por defecto)

SDI0819AS-X1 SOP16 SDI0819AS compatibles

SDI0829AS-X1 SOP16

SDI0829TS-X1 SSOP20

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1- Pin Descripción

Figura 1: SDI0809A-X1 Figura 2: SDI0819A-X1

La figura 3: SDI0829A pin de mapa Figura 4: SDI0829T pin de mapa

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Figura 5: El diagrama general de bloques

nombre Una breve descripción de la naturaleza del puerto

DVDD digital digital Power

AVDD simulación alimentación analógica

AGND simulación tierra analógica

DGND digital Planta digital

VCOM salida analógica interna de la tensión de referencia integrado ( VCOM exportación 1.5V ), También puede ser utilizado como Jane

Interruptor único usando ( VCOM exportación AVDD ).

VREFP referencia de entrada analógica de entrada de alimentación

VREFN referencia de entrada analógica de entrada de alimentación

CAP1 simulación Filtra Interface condensador: generalmente flotar a

CAP2 simulación Filtra Interface condensador: generalmente flotar a

AIN1P canales de entrada analógica la Diferencial terminal de entrada analógica de la fase positiva

AIN1N canales de entrada analógica la Terminal inversor de la entrada analógica diferencial

AIN2P canales de entrada analógica B Diferencial terminal de entrada analógica de la fase positiva

AIN2N canales de entrada analógica B Terminal inversor de la entrada analógica diferencial

LDOCON control de entrada digital VCOM (Pull-up):

1 : La salida 1.5V 0 :

salida AVDD

BUF control de entrada digital BUF (Pull-up):

1 : Habilitado BUF 0 :

Cerrar BUF

SCLK entrada digital SPI Interfaz: una señal de reloj

DRDY / DOUT salida digital SPI Interfaz: Salida de Datos (Salida de colector abierto)

ADC señal válida de datos y la salida de datos en serie: control

específico referencia de temporización SPI Descripción sección de sincronización de interfaz

IDE entrada digital SPI Entrada de datos: Interfaz

control detallado referencia de temporización SPI Descripción sección de sincronización de interfaz

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2- Parámetro Descripción

Aunque este IC con ESD Circuito de protección, pero aún dañado cuando las descargas electrostáticas en ciertas condiciones extremas. La descarga

electrostática puede causar todo el chip no funciona, puede afectar a algunos chips de circuitos de precisión, por lo que no se puede lograr en nuestra

información pública. Por lo tanto cuando se utiliza un contacto directo evitar apropiado con los pasadores, para evitar ESD El suceso.

Las condiciones extremas:

parámetros típico unidad

AVDD a la presión AGND - 0,3-3,3 V

DVDD a la presión DGND - 0,3-3,3 V

AGND a la presión DGND - 0,3-0,3 V

Voltaje de entrada analógica - 0,3 - AVDD + 0,3 V

voltaje de entrada digital - 0,3 - DVDD + 0,3 V

El rango máximo de temperatura de funcionamiento --40--100 ℃

Temperatura de la unión 150 ℃

Parámetros eléctricos:

Condiciones de prueba:

AVDD = DVDD = VREFP = 3,3 V; rango de temperatura: -25 a -80 ° C;

parámetros condición la gama unidad

mínimo Los valores típicos máximo

señal de entrada

voltaje diferencial de PGA = 128

entrada (VINP - + / - 0,5 VREFP / 128 V

VINN)

rango de modo común AGND + 0,6 AVDD - 0,6 V

VREFP AVDD AVDD + 0,3 V

Rendimiento ADC

no linealidad PGA = 2 0,0002 0,001 % De FS

Integral (INL) = 128 PGA 0,0005 0,001 % De FS

Offset de entrada = 128 PGA 3 5 ppm de FS

La deriva de compensación de entrada + / -10

nV o
/ C

ganancia de error 0.01 % De FS

poder

Corriente de fuente de alimentación de 3,3 V 1,6 mA

alimentación (PGA = 128)fuente de alimentación de 1,5 V 1.3 mA

Corriente de fuente de alimentación de 3,3 V 0.6 mA

alimentación (PGA = 2) fuente de alimentación de 1,5 V 0.6 mA

SPI sueño volvió 3.3V 20 uA

despertar LF 2.5V 3 uA

2.0V 1.2 uA

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SPI cerrado de 3.3V 9 uA

2.5V
baja frecuencia de sueño-vigilia 0.3 uA

2.0V 0.1 uA

rendimiento de ruido:

ganancia El ruido de entrada equivalente RMS pico de entrada equivalente pico de ruido bit válido Código fijo dígitos

= Tensión de alimentación 3.3V ; VREFP - VREFN = 3.3V ;

Frecuencia de salida = 10Hz

2 600nV 3.1uV 21.4 19

128 15nV 85nV 20.7 18.2

= Tensión de alimentación 1.5V ; VREFP - VREFN = 1.5V ;

Frecuencia de salida = 10Hz

2 760nV 3.3uV 20.1 17.8

128 17nV 89nV 19.4 17

módulo 3- función

3.1 Sigma-Delta ADC

Figura VI Sigma-Delta ADC

fin se empleó núcleo parte 3 SDI0829 estructura ADC modulador sigma-delta se puede aplicar fácilmente a varios tipos de débil sistema de

medición de señal.

Las principales características son las siguientes:

• ADC ajuste de la tasa de muestreo

ADC Muestreo frecuencia fundamental de las señales diferenciales analógicas de entrada fs ( 76.8KHz ) , Puede ser configurado para ser

ajustado por: Frecuencia de muestreo: ACLK * Fs = Fs , 2Fs , 4Fs ( por defecto) , 8fs

( ACLK es ADC Relación de velocidad, la referencia " SPI Interface ")

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• Ganancia Programable interna ( SG_PGA ): 2 , 4 , 16 , 32 , 128 , 256 , 512 , 1024 , 2048 tiempo

SDI0829 series, ADC Hay tres amplificador de ganancia en el camino de la señal

• GAMP : Amplificador preoperacional

GAMP : 1 , 64 tiempos;

• GCAP : amplificador de condensador

SGAIN_CAP : 1 , 2 tiempos;

• GCLK / ACLK : Reloj integrante amplificador de ganancia

GCLK En la siguiente manera: 1 , 2 , 4 , 8 ( por defecto) , 16

ACLK En la siguiente manera: 1 , 2 , 4 ( por defecto) , 8

Al configurar se deben cumplir: GCLK> ACLK ;

ADC ganancia = GAMP * * GCAP (GCLK / ACLK)

( GCLK , ACLK referencia " SPI Interface ")

El (configuración solicitada no enumerado calculado según la ecuación de ganancia):

GAMP GCAP GCLK ACLK ADC ganancia

1 1 8 4 2

1 1 16 4 4

1 1 16 2 8

1 1 16 1 16

1 2 16 1 32

64 1 8 4 128 ( por defecto)

64 1 16 4 256

64 1 16 2 512

64 1 16 1 1024

64 2 16 1 2048

• La selección de canales ( SG_CHA )

Proporciona tres de alta precisión analógica de canal de datos de canal conversor digital de medida por SG_CHA [1: 0] Para

controlar. Caracterizado porque el canal 1 y el canal 2 entrada diferencial ordinaria puede ser externo, conectado a un paso interno en los

tres sensores de temperatura. SG_CHA [1: 0]

00 canal 1 (Por defecto)

01 canal 2

10/11 Canal de temperatura

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• ADC selección de la velocidad de salida

ADC Los datos se convierten a través del filtro de dos muestreo: respectivamente, por SG_SPA [2: 0] , SG_SPB [1: 0]

Para controlar.

El efecto de dos filtro de muestreo se superpone:

Tales como: una primera etapa hacia abajo 7680 Veces, la segunda etapa de descenso 4 Veces, la

caída global 30720 Si los tiempos ADC La velocidad de muestreo es: 4 Fs = 76.8K * 4

La tasa de salida es: 4Fs / 30.720 = 10 Hz

La primera relación de filtro etapa submuestreo La segunda relación de filtro etapa submuestreo

SG_SPA [2: 0] Abajo-frecuencia de muestreo SG_SPA [1: 0] Abajo-frecuencia de muestreo

000 30720 00 4

001 15360 (Por defecto) 01 2

010 7680 10/11 1 (Por defecto) (segunda etapa del efecto

de filtrado)

011 3840

100 1920

101 960

110 240

111 120

Por defecto:

ACLK = 4 ; SG_SPA [2: 0] = 3,840 ; Segundo filtro etapa no funciona, por lo ADC Última

salida fue el siguiente: 4Fs / 15.360 = 20Hz

• ADC valor de salida (Entrada de tensión de referencia: VREF = VREFP - VREFN )

entrada: AIN1P - AIN1N (Rango de entrada: +/- 0.5VREF / ganancia)

'S complementan

entrada positiva de salida 000001h - 7FFFFFh

0000000h 000000h

Entrada es negativa FFFFFFH - 800000h

• BUF
Cuando se utiliza sin el amplificador pre-operativo ( GAMP = 0 ), Para ser aumentado en ADC impedancia de entrada equivalente del

lugar, puede utilizar BUF .

El "Pin BUF "Flotante o se tira hasta el BUF Efectiva, cerca BUF Cuando el "pin BUF "Low.

BUF El uso de " Carril-a-Carril "Estructura, el rango de señal de entrada que es: AGND - AVDD

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3.2 fuente de referencia incorporada

serie SDI0829 incorpora un LDO interna, de entrada como AVDD, salida VCOM. El LDO 1.5V para proporcionar una salida de tensión de referencia

puede ser utilizado como un simple interruptor (salida VCOM AVDD).

Cuando la salida de 1,5 V, requiere VCOM 0.1uF pin condensador plus

Nota: Potencia Sigma-Delta ADC también es proporcionada por el VCOM

3.3 RC interno

SDI0829 serie integra dos oscilador RC interno

• oscilador de 2.46MHz reloj maestro

proporciona el reloj del sistema para el maestro ADC

• 32KHz oscilador de baja frecuencia

Sleep, da salida a una señal de impulso de bajo nivel se suministra a través de la DRDY

mecanismo 3,4 latencia

serie SDI0829 SCLK alto para 100us A punto de dormir, SCLK BAJA inmediatamente salir de la inactividad.

Dos modos de suspensión:

• el modo de reposo total

el modo de suspensión completa, todo el circuito se detuvo y el consumo de energía es muy pequeña

DRDY / DOUT salida de alta

• En el modo de reposo Pulso este modo, sólo 32KHz trabajo

del reloj

DRDY / DOUT Se da salida a un nivel alto, y cada 200ms Se emite un impulso bajo (menor tiempo de

30us ) Por iniciativa externa de despertador MCU .

DVDD voltaje 1.8V 2.0V 2.5V 3.0V 3.3V

intervalo de impulso 200ms 160ms 150ms 130 ms 90ms

• Consumo de energía en modo de espera

Consumo de energía en modo de espera

DVDD voltaje el modo de reposo total el modo de suspensión de impulsos

1.8 0.7uA <0.1uA

2.0 1.2uA <0.1uA

2.5 2.0uA 0.3uA

3.0 7UA 3.0uA

3.3 18uA 8.6uA

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Interfaz de datos 4-

4.1 Resumen

SDI0829 Serie de tres hilos SPI interfaz: SCLK , DRDY / DOUT , IDE

• SCLK : señal Se "interfaz serie velocidad de reloj"

• DRDY / DOUT : "Salida bandera Preparación de datos" y "datos de salida" señal multiplexada

• IDE : señal de "datos de configuración de entrada"

Si utiliza la configuración por defecto, no se puede configurar SDI0829 En este momento no es necesario IDE , Que recibió un bajo nivel puede ser alto.

4,2 ADC "lectura de datos" y "configuración de modo de trabajo"

SDI0829 por series SPI conversión de salida de interfaz completó 24 Codificación de bits, MSB primero. Al tiempo que toma ventaja de IDE La señal

de entrada, la lectura ADC Al mismo tiempo de la terminación de los datos SDI0829 Configuración.

normal MCU secuencia de interfaz es el siguiente:

• ¿Cuándo SDI0829 Después de la llegada de nuevos datos de conversión, DRDY / DOUT Con efecto inmediato, pasa a nivel bajo. En este momento,

DRDY / DOUT Una señal de marca de validación de datos.

• DRDY / DOUT flanco de bajada MCU Interrumpido por este último SCLK Enviar a SDI0829 La señal de reloj.

ADC configuración: en el envío de SCLK antes de la primera IDE Datos sobre la lista, SCLK El flanco ascendente

IDE Los datos muestreados en el SDI0829 En el interior, una entrada total 25 datos de bits;

ADC leer: SDI0829 en SCLK El flanco ascendente de la transmisión de datos a DRDY / DOUT En. ahora

DRDY / DOUT Una señal de datos, una señal de datos es alta en el primero, una transmisión total 24 Para los datos.

• En el primer 25 más SCLK El flanco ascendente, DRDY / DOUT forzada de alto , Restauración de la señal de datos de marca válida, si

no hay nueva SCLK Llegada, entonces, en este estado hasta SDI0829 Los nuevos datos de conversión llega. ( 25 más SCLK Después,

el método puede continuar enviando SCLK La interfaz no tratada)

parámetros explicación mínimo máximo unidad

t1 DRDY / DOUT Para una primera bajo activo SCLK subir 0 ns

A lo largo de tiempo

t2 SCLK El flanco ascendente de los datos de salida es válida 50 ns

t3 SCLK La anchura de la alta y baja nivel 100 ns

t4 SDI0829 ciclo de datos de salida 90 (10 Hz) 105 (10 Hz) ms

t5 IDE El tiempo de preparación de datos 20 ns

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Los datos leídos de tiempo:

"Los datos leídos de la tarde" + "Configuración de la entrada de datos" de la tarde:

4.3 ADC de 25 datos de configuración Bit

25 datos de valor configuración Descripción funcional

configuración Bit

Bit [1: 0] 00 ACLK = 1 configuración: ACLK

01 ACLK = 2

10 (Por defecto) ACLK = 4

11 ACLK = 8

Bit [2] 1 (Por defecto) Las pruebas internas

Bit [4: 3] 10 (Por defecto) Las pruebas internas

Bit [5] 0 (Por defecto) Las pruebas internas

Bit [8: 6] 000 GCLK = 1 configuración: GCLK

001 GCLK = 2

010 (Por defecto) GCLK = 4

011 GCLK = 8

1xx GCLK = 16

Bits [11: 9] 000 30720 Configuración de una primera etapa de muestreo descendente filtro:

001 (Por defecto) 15360 SG_SPA [2: 0]

010 7680

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011 3840

100 1920

101 960

110 240

111 120

Bits [13:12] 00 4 El filtro de segunda etapa dispuesta submuestreo:

01 2 SG_SPA [1: 0]

1x (Por defecto) 1

Bit [14] 0 1 Preconfigurado amplificador operacional:

1 (Por defecto) 64 GAMP

Bits [16:15] 00 (Por defecto) canal 1 Selección del canal de configuración: SG_CHA [1: 0]

01 canal 2

1x Canal de temperatura

Bit [17] 0 (Por defecto) Capacitor configuración de amplificador:

1 GCAP

Bit [18] 0 el modo de reposo total Configurar el modo de suspensión

1 (Por defecto) el modo de suspensión de impulsos

Bits [24:19] 010101 (Por defecto) Las pruebas internas

4.4 secuencia de comandos de hibernación

SDI0829 en SCLK alto para 100us A punto de dormir, SCLK BAJA inmediatamente salir de la inactividad.

parámetros explicación máximo unidad

T5 SDI0829 Se va a dormir SCLK alta duración 100 nosotros

T6 SDI0829 frecuencia de pulso de despertador 200 ms

T7 SDI0829 ancho de pulso de despertador 30 nosotros

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5- paquete unidad: mm
5.1 DIP8L

5.2 SOP8L

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5.3 SOP16

5.4 SSOP20

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