Segundo-parcial-22-sol.

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Anónimo

Sistemas Digitales

1º Grado en Ingeniería Informática

Escuela Técnica Superior de Ingenieros Informáticos

Universidad Politécnica de Madrid

Reservados todos los derechos.

No se permite la explotación económica ni la transformación de esta obra. Queda permitida la impresión en su totalidad.
 Solución problema 1
a).-

Cerrada

Sí ¿mando=1? No

motorSubida:= 1 Subiendo

Sí ¿sensorFin No
Movimiento=1?

Abierta

Sí ¿mando=0 y No
sensorPaso=0?

motorBajada:= 1 Bajando

Sí ¿sensorFin No
Movimiento=1?

Sí ¿mando=1 o No
sensorPaso=1?

Detenida

Sí ¿sensorFin No
Movimiento=0?

1/2

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Reservados todos los derechos. No se permite la explotación económica ni la transformación de esta obra. Queda permitida la impresión en su totalidad.
 b).-

Estado Actual Entradas Estado Futuro Salidas

Etiqueta Q2 Q1 Q0 mando sensorPaso sensorFin Etiqueta D2 D1 D0 motor motor
Movimiento Subida Bajada
CERRADA 0 0 0 0 x x CERRADA 0 0 0 0 0
1 x x SUBIENDO 0 0 1 0 0
SUBIENDO 0 0 1 x x 0 SUBIENDO 0 0 1 1 0

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x x 1 ABIERTA 0 1 1 1 0
BAJANDO 0 1 0 0 0 0 BAJANDO 0 1 0 0 1
x 1 0 DETENIDA 1 0 0 0 1
1 x 0 DETENIDA 1 0 0 0 1
x x 1 CERRADA 0 0 0 0 1
ABIERTA 0 1 1 0 0 x BAJANDO 0 1 0 0 0
1 x x ABIERTA 0 1 1 0 0
x 1 x ABIERTA 0 1 1 0 0
DETENIDA 1 0 0 x x 0 SUBIENDO 0 0 1 0 0
x x 1 ABIERTA 0 1 1 0 0

c).-

mando mando_or_sensorPaso
sensorPaso

000 Vdd
mando_or_sensorPaso 001
sensorFinMovimiento 010
011 MUX PRE
D2
D Q Q2
100 8:1 S
101
CLK Q
110
111 CLR

c2 c1 c0

Q2 Q1 Q0 reloj reset

000 Vdd
sensorFinMovimiento
001
mando_or_sensorPaso 010
Vdd 011 MUX PRE
D1
sensorFinMovimiento D Q Q1
100 8:1 S
101
CLK Q
110
111 CLR

c2 c1 c0

Q2 Q1 Q0 reloj reset

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 mando Vdd
000
Vdd 001
010
mando_or_sensorPaso PRE
011 MUX
D0
Vdd D Q Q0
100 8:1 S

Reservados todos los derechos. No se permite la explotación económica ni la transformación de esta obra. Queda permitida la impresión en su totalidad.
101
CLK Q
110
111 CLR

c2 c1 c0

Q2 Q1 Q0 reloj reset

000
001 motorSubida
DEC 010 motorBajada
3:8 011
100
101
110
111

c2 c1 c0

Q2 Q1 Q0

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 Solución al problema 2
a).-

D2= Q1 + Q0
T1= Q2
T0= Q1
b).-

Q2(t) Q1(t) Q0(t) D2(t) T1(t) T0(t) Q2(t+1) Q1(t+1) Q0(t+1)

0 0 0 0 0 0 0 0 0
0 0 1 1 0 0 1 0 1
0 1 0 1 0 1 1 1 1
0 1 1 1 0 1 1 1 0
1 0 0 0 1 0 0 1 0
1 0 1 1 1 0 1 1 1
1 1 0 1 1 1 1 0 1
1 1 1 1 1 1 1 0 0
c).-

000 001 101 111 100

011 110 010

d).-

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 Solución cuestiones 3

a).-
La capacidad de almacenamiento será de 512·8= 4096 bits.

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b).-

A8 - A0 Dirección de lectura
tACC= 90 ns tAH= 15 ns
CS
tCS= 50 ns
tCH= 10 ns

D7 - D0
Dato leído
tD= 40 ns

c).-
El módulo de memoria de partida es de 512 x 8.
Para poder almacenar datos de 16 bits necesitaremos 2 módulos de forma que el primero
almacene 8 bits y el segundo, los 8 bits restantes.
Además, para formar la memoria solicitada necesitamos duplicar el número de direcciones
disponibles en el módulo de inicio.
En resumen, para poder construir una memoria de 1024 x 16 necesitaremos emplear 2·2= 4
módulos.

A10

A0

A9 A8 A7 A6 A5 A4 A3 A2 A1 A0 A9 A8 A7 A6 A5 A4 A3 A2 A1 A0 A9 A8 A7 A6 A5 A4 A3 A2 A1 A0 A9 A8 A7 A6 A5 A4 A3 A2 A1 A0

RAM RAM RAM RAM

512x8 512x8 512x8 512x8

CS CS CS CS

D7 D6 D5 D4 D3 D2 D1 D0 D7 D6 D5 D4 D3 D2 D1 D0 D7 D6 D5 D4 D3 D2 D1 D0 D7 D6 D5 D4 D3 D2 D1 D0

CS

D15

D0

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