Documentos de Académico
Documentos de Profesional
Documentos de Cultura
PARA
MANUFACTURA
PRÁCTICA UII. Flip-flop
Componentes:
• 2 CI 7400
• 2 CI 7402
• 1 CI 74LS74A
• 1 CI 74LS76
• 2 interruptores de botón normalmente cerrados
• 2 interruptores de botón normalmente abiertos
• 2 LED
• Software de diseño eléctrico (Proteus y Logisim)
Desarrollo:
Cerrojo R-S:
El cerrojo R-S es la base de diseño para la mayoría de los flip-flops. Dos tipos de
cerrojo R-S serán estudiados en esta práctica. Cerrojo R-S basado en compuertas
NAND y cerrojo R-S basado en compuertas NOR. Los niveles de entrada a estos
circuitos determinan el estado de su salida. El cerrojo R-S no posee una entrada de
reloj, por lo que se dice que opera asíncronamente.
Q= 1 Q’= 0
Note que el soltar el botón no hace que Q cambie de estado, ¿Por qué sucede esto?
Respuesta:
Si “S” es igual a 1 “Q” estará activada mientras “Q’” estará desactivada, cuando se
coloca “S” en “0” sigue activa en “Q”, hasta el momento en el que se haga el reset,
es decir tanto “S” como “R” este cortada la energía.
Ahora pulse de nuevo el botón conectado a S, ¿Qué efecto provoco en las salidas
del circuito?
Respuesta: No hubo ningún cambio en las salidas, continúan en sus mismos
estados.
1- Pulse el botón conectado a R, y observe que Q vuelve a ser 0 y se mantiene
en este estado incluso tras haber soltado el botón:
Respuesta:
Al soltar los botones, las salidas no quedan en 0 lógico. Las salidas se modifican
dependiendo cual botón se soltó primero sin embargo siempre se encuentra un
estado en “0” y otro en “1”.
Cerrojo R-S basado en compuertas NAND:
1- Estudie cuidadosamente y construya el circuito mostrado en la Figura 2.
Conecte un interruptor del botón normalmente cerrado a la entrada R, y otro
a la entrada S del circuito
(0= pulsado, 1= no pulsado). Despliegue el estado de las salidas Q y Q’
usando LED debidamente polarizados.
2- Encienda la fuente regulada de voltaje que alimenta su circuito. Pulse el botón
conectado a S y verifique que la salida Q cambia a 1 lógico y Q’ a 0 lógico:
Ahora pulse el botón conectado a R y observe que la salida del cerrojo es 0 lógico
y se mantienen en este estado incluso después de haber soltado el botón:
3- Alterne el pulsar el botón conectado s S y R varias veces. Observe que las
salidas siempre se encuentran en estados opuestos.
4- Respuesta: Tal como se menciona anteriormente las salidas siempre están
en lados opuestos.
5- Pulse simultáneamente los botones conectados a R y S y observe los
cambios producidos en las salidas:
Flip-flop J-K:
El flip-flop J-K elimina la condición prohibida presentada en el cerrojo R-S, y en su
lugar se presenta el estado de inversión de la salida. Normalmente, un flip-flop
puede ser operado síncronamente dado que sus entradas J y K necesitan de un
cambio en la entrada de reloj para provocar un cambio a la salida Q. Un flip-flop J-
K también puede ser operado asíncronamente mediante sus entradas C y P.
Cuando la entrada C es 0 lógico, la salida Q es forzada a O lógico sin esperar al
cambio de la entrada de reloj. De forma similar, cuando P es 0 lógico, el estado de
Q cambiara inmediatamente a 1 lógico. Observe que la condición P= 0 y C= 0 está
prohibida.
Flip-flop J-K C1 74LS76:
1- Obtenga y estudie la hoja de especificaciones
del CI 74LS76. Observe que la entrada
correspondiente al reloj se caracteriza por
una pequeña punta de flecha dentro del
bloque que representa el CI. También
observar que existe una burbuja a la entrada
del reloj. La pequeña punta de la flecha indica
que el circuito es sensitivo solo a las
transiciones del reloj, y la burbuja indica
inversión. Por lo tanto, el CI 74LS76 es un
dispositivo con captura en el flanco negativo
del reloj. Dibuje la distribución de patillas del
74LS76:
B) Si Q= 0, pulse el botón conectado a Clk para obtener Q=1. Abra los dos
interruptores conectados a J y K, y observe que Q permanece en el mismo
estado. Pulse el botón a Clk, ¿Qué ocurre a Q? R= Q pasa al 0 lógico.
C) Cierre el interruptor asociado a K y observe que Q mantiene su estado.
Pulse el botón conectado a Clk, ¿Qué le ocurre a Q? R= Q se mantienen
en el mismo estado de 0.
D) Cambie J a 1 y después a 0, y observe que Q no cambia. Pulse el botón
conectado a
Clk. Deberá observar que Q permanece en 0. Esto prueba que el estado
de las entras J y K presentes al momento de la transición del reloj son los
que afectan la salida del flip-flop.
E) Abra el interruptor conectado a K y cierre el que esta conectado a J.
Observe que Q no cambia. Aplique un pulso de reloj y observe que Q
cambia a 1. Aplique pulsos adicionales a la entra de reloj.
Operación asíncrona del CI 74LS76:
1- Las entradas P y C son entradas asíncronas que operan independientemente
de las entradas síncronas. Estas entradas son frecuentemente etiquetadas
como PRE y CLR. Estos acrónimos vienen de las ingles Preset y Clear. La
barra superior indica que estas entradas son activas en bajo. Las entradas
asíncronas tienen prioridad sobre las entradas síncronas. Verifique lo
anteriormente mencionado presionando el botón conectado a la entrada C y
observando que la salida del flip-flop deja de conmutar, aunque se sigan
aplicando pulsos de reloj. La salida Q permanecerá en 0 lógico hasta el
primer pulso de reloj emitido justo después de haber liberado el botón
conectado a la entrada C.
2- Desconecte el cable que va de Vcc a una de las terminales del interruptor de
botón conectado a P, momentáneamente conecte este cable a GND. Usted
deberá observa que la salide del flip-flop deja de conmutar y permanece en
1 lógico mientras P permanezca en 0 lógico.
Flip-flop D:
El flip-flop D es un flip-flop J-K con un inversor entre las entradas J y K. Esto provoca
que el estado de la salida cambie junto con la única entrada síncrona. Como el flip-
flop J-K, el flip-flop D también posee entradas C y P para su operación asíncrona.
C1 74LS74A:
1- Obtenga la hoja de especificaciones del CI 74LS74A y dibuje su diagrama de
distribución de patillas:
Conclusión:
Conforme iba realizando la actividad comprendí de manera más visual el cómo
funcionan estos circuitos y sus salidas aleatorias las cuales dependen en gran
medida de las entradas pasadas y actuales, ya que para lograr encender el led se
inicia de un estado concreto según el orden que se presione el interruptor R o S del
circuito.
Se estuvieron probando los posibles casos que se pudieran presentar en cada uno
de los circuitos y con este se resolvieron las preguntas.
Las entradas J y K en un CI 74LS76 afectan a las salidas Q y Q’ en el CLK del reloj
de acuerdo con lo simulado.
Las entradas C y P en un CI 74LS76 son entradas positivas (activas) y son
independientes de la entrada de reloj.