Electrónica Avanzada

“Introducción a VHDL”

Dr. David Alejandro Elvira Ortiz

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FPGA (Field Programmable Gate Array)

Estructura del bloque lógico configurable

Arreglo básico interno de un FPGA
(CLB)
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Revisión de VHDL
VHDL:Very high speed IC Hardware Description Language,
es un lenguaje de descripción de comportamiento de sistemas
digitales.

Evolución histórica del VHDL

Creado en 1980 por el departamento de defensa de EUA.
Proyecto VHSIC, Very-High-Speed Integrated Circuits.
En 1987 se establece como estándar, IEEE-1076.
En 1993 se mejoran algunas características, IEEE-1164.
En 2000, 2003 y 2006 se han hecho algunas revisiones
menores.
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Originalmente creado para la simulación, actualmente se utiliza

también para el diseño y la implementación.

Archivos de descripción VHDL

Partes obligatorias
1. Librerías
2. Entidad
3. Arquitectura

Opcionales
4. Señales internas y componentes
5. Banco de pruebas
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Librerías básicas:
1164 para la definición del lenguaje y tipos de datos.
NUMERIC_STD para la definición operadores aritméticas.
UNSIGNED para operaciones sin signo.
ARITH para operaciones con signo.

La UNSIGNED y la ARITH forman el estándar de facto, aunque

el IEEE reconoce como estándar oficial solo a la
NUMERIC_STD. Son mutuamente excluyentes.
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Tipos de datos

Boleano, boolean
Binario, bit
Entero, integer
Lógico estándar, std_logic
Vector lógico estándar, std_logic_vector

Valores para el std_logic_vector

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Entidad
La entidad define las entradas y salidas de un bloque.
• Entrada (in)
• Salida (out)
• Entrada/Salida (inout)
• Buffer (buffer)
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Arquitectura
Define la funcionalidad del módulo.
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Operadores
Operadores lógicos Operadores aritméticos Operadores relacionales

not (NOT) Suma (+) Menor que (<)

and (AND) Resta (-) Igual (=)
or (OR) Multiplicación (*) Mayor que (>)
xor (XOR) División (/) Menor o igual que
(<=)
nand (NAND) Exponente (**) Mayor o igual que
(>=)
nor (NOR) Módulo (mod) Diferente (/=)
xnor (XNOR) Residuo (rem)
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Operadores

Operadores de asignación Operadores especiales

Toma el valor de (<=) Concatenar (&)

Igual a (:=) Acceso a atributos (´)
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Instrucción if-elsif-else
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Instrucción case
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Instrucción for
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Condicional incompleto
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Componentes

Los componentes son parte fundamental de la estructura de VHDL ya que le dan una
organización jerárquica a un proyecto.
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Bancos de pruebas

Los bancos de pruebas son archivos de descripción para realizar pruebas a otros módulos.
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“Fin de la presentación”

Dr. David Alejandro Elvira Ortiz