Circuitos y Sistemas Digitales

Evaluación-Parcial-Práctica

Alumno : Zacarias Lopez Lenning Andree

Sección : 21638 Docente: ING.ANDRÉS VENTOSILLA

Fecha: 13/05/ 2022

Instrucciones: Lea cuidadosamente para proceder a su desarrollo, complétela con

sus respuestas obtenidas y Suba su examen al aula virtual en la ruta indicada por el
docente.

PRIMERA PARTE (6puntos): La fig1, muestra un diagrama unifilar de un transformador de

potencia en 60kV, para el cual se desea implementar una lógica de control de cierre del
interruptor IN-F13Q0.

BARRA 60 kV

N1 SB-F13Q1
N2
ST-F13Q1

IN-F13Q0

TV-F13
N1 N2

PR-E13Q9

Fig1

Se sabe que los equipos SB-F13Q1 y ST-F13Q1, cuentan con contactos que indican su
posición (abierto o cerrado). Considere que la señal abierto de estos equipos es 0
lógico y la señal de cerrado es 1 lógico.
Así mismo, el Transformador de potencia cuenta con un relé de protección, el cual
activa una salida (1 lógico) cuando detecta un fallo en el sistema eléctrico de
potencia.

Requerimientos Para el cierre del interruptor:

✓ El seccionador de barra SB-F13Q1 debe estar en posición de cerrado.

✓ El Seccionador de tierra ST-F13Q1 debe estar abierto.
✓ De ninguna manera debe cerrarse el interruptor cuando haya una falla en el
sistema eléctrico de potencia.

Determine la Forma canónica optimizada para la implementación del sistema de

control de cierre del interruptor.

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SEGUNDA PARTE (6 puntos):

Un estudiante del curso de sistemas digitales, diseñó un circuito que controla el encendido de un
motor DC, obteniendo el siguiente mapa de Karnaugh:

Considerando que, el estudiante cuenta con una fuente de tensión de alimentación

de 3.2 Voltios fija. Determine:

a) La función reducida SOP que se obtiene del mapa de karnaugh.

b) El tipo de tecnología (TTL o CMOS) que debe seleccionarse para implementar el
circuito lógico (sustente su respuesta).
c) La corriente en la salida (en amperios) del circuito implementado (en proteus),
cuando este se conecte de la siguiente manera a la carga:

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 TERCERA PARTE(8puntos):

Fig2

Diseñe un circuito digital que controla el fluido de un tanque de

almacenamiento(fig2), el cual se desea que mantenga un nivel apropiado de fluido
controlando las válvulas de entrada y de salida. Para ello considere las cuatro salidas
que se detalla:

-S1: Abrir la Válvula de entrada.

-S2: Abrir la Válvula de salida.
-S3: Activar la calefacción.
-S4: Activar Alarma.

Requerimientos del funcionamiento:

✓ El tanque cuenta con dos sensores de nivel, uno de los cuales indica cuando el
nivel de fluido es bajo y el otro si el nivel de fluido es alto.
✓ La lógica de control actúa sobre una válvula de entrada que permite que el fluido
ingrese en el tanque hasta que el sensor de nivel alto se activa. Cuando eso
suceda la lógica de control debe cerrar la válvula de entrada.
✓ El tanque cuenta con dos sensores de temperatura, uno de los cuales indica si el
fluido está demasiado caliente y el otro si el fluido está demasiado frío.
✓ La lógica de control activa un elemento de calefacción si los sensores de
temperatura indican que el fluido está demasiado frío.
✓ La lógica de control mantiene abierta la válvula de salida siempre que el sensor
de nivel bajo esté sumergido(activado) y el fluido se encuentre a la temperatura
adecuada (no demasiado caliente ni demasiado frio).
✓ Cuando el nivel de fluido cae por debajo del sensor de nivel bajo, la lógica de
control cierra la válvula de salida.
✓ Si la lógica de control detecta un fallo en cualquiera de los sensores o una
condición de temperatura muy alta, se activa una alarma.
✓ Los sensores de nivel de fluido son de tipo óptico

De lo indicado:

a) Realice su tabla de verdad del sistema (para las cuatro variables de salida indicadas
S1, S2, S3 y S4)

b) Optimice las compuertas empleando Karnaugh (para S1, S2, S3 y S4).

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 c) Utilizando el software Proteus, seleccione sus compuertas lógicas e implemente su
circuito por completo (recuerde etiquetar sus señales de entrada y salida, colocar su
nombre dentro de su diagrama). Utilice:

-Led Rojo para la salida S4

-Led verde para la salida S3.
-Logic Probe para las salidas S1 y S2.
-Para las entradas, use circuito polarizado a través de dipswitch con fuente DC de 5V.

d) Realice 4 capturas de pantalla que muestren el desempeño de su circuito para

diferentes escenarios.

Nota: El examen terminado, deberá ser subido al aula virtual en la ruta indicada por el docente

al inicio de la evaluación.

PRIMERA PARTE:

Relé SB-F13Q1 ST-F13Q1 SALIDA

0 0 0 0
0 0 1 0
0 1 0 1
0 1 1 0
1 0 0 0
1 0 1 0
1 1 0 0
1 1 1 0

Relé A
SB-F13Q1 B
ST-F13Q1 C
F(a.b.c)= a'bc'

SEGUNDA PARTE:

a) F (P, Q, R, S) = Q’+P’R’S’+OS

b) Como el consumo es bajo debemos de implementar la tecnología CMOS, por decirlo así ya

que su fuente es de 3.2 V.

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TERCERA PARTE:

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