DEC16

INFORME DE PRÁCTICA DE LABORATORIO Versión 1.
0
PROGRAMA DE INGENIERÍA MECATRÓNICA
Periodo 2018-2
DECODIFICADOR
Ñañez kevin, Barrios Diego, y Romero Andrés
{u1803185, u1803132, y u1803631}@unimilitar.edu.co
Profesor: Nubia Sanchez
 de las entradas puede ser 1 o 0, hay 2^N combinaciones o
codigos de entrada. Para cada una de estas combinaciones de
Resumen—En este laboratorio vamos a realizar un entrada solo una de las M salidas estar· activada (1), para logica
codificador que muestre el nombre de unos de los integrantes positiva; todas las otras salidas estaran desactivadas (0)
del equipo así mismo utilizaremos las herramientas de proteus,
mapas de karnaugh., el cual fortalece competencias aplicables
en electrónica de consumo, electrónica de potencia, tratamiento
de señales, robótica, control,
Inteligencia artificial.
m
er as
Palabras clave— decodificador, compuerta lógica , mapas de
Karnaugh , NOR, AND , NOT
co
Figura 1, Diagrama de bloques de un circuito combinacional
eH w
(Mano, 2003)
I. INTRODUCCIÓN
o.
rs e Circuitos combinacionales
ou urc
Los codificadores son los dispositivos encargados de la
codificación. El concepto de codificación, tal y como se exploró Los circuitos lógicos para sistemas digitales pueden ser
en la sección de Códigos, está vinculado a la “traducción” de combinacionales o secuenciales. Un circuito combinacional
o
consiste en compuertas lógicas cuyas salidas en cualquier

un código a otro. Los codificadores pueden implementarse a
momento están determinadas por la combinación actual de
aC s
partir de la aplicación de diagramas de Karnaugh comparando

entradas. Un circuito combinacional realiza una operación que
vi y re
las tablas de verdad. También existen codificadores integrados se puede especificar lógicamente con un conjunto de funciones
de diferentes características. Tienen dos tipos de entradas: de booleanas (Mano, 2003).
control y de datos. Las entradas de datos son las que componen Diagrama de bloques de un circuito combinacional (Mano,
el código a “traducir”. Las entradas de control por su parte 2003)
pueden ser de selección, las cuales se emplean en la
ed d
Mapa de Karnaugh Un mapa de Karnaugh proporciona un

codificación, y de habilitación, que existen en muchos tipos de método sistemático de simplificación de expresiones booleanas
ar stu
integrados, y se encargan de permitir o no el proceso de trabajo. y, si se aplica adecuadamente, genera las expresiones suma de
productos y producto de sumas más simples posibles, conocidas
[4] La aplicaciones del Codificador Entre las aplicaciones de como expresiones mínimas (Floyd, 2006).
los codificadores destacan la codificación de pequeños Minimización de Quine-McCluskey Existe un procedimiento
is
teclados, la conversión analógica a digital y el control de que, aunque es arduo de seguir a mano, tiene la ventaja de que
perturbaciones en los ordenadores. es sistemático y fácilmente programable en una computadora.
Th
Se trata del método de QuineMcCluskey. El método de Quine-

McCluskey o método tabular consiste en obtener de manera
A. Marco teórico sistemática adyacencias en orden creciente hasta llegar a las de
mayor orden posible, las cuales llamaremos implicantes
sh
[1]Un decodificador es un circuito logico combinacional, que primarios (Brown & Vranesic, 2000).
convierte un codigo de entrada binario de N bits en M lineas de
salidas N puede ser cualquier entero, tales que cada linea de
salida ser· activada para una sola de las combinaciones posibles
de entrada. La Figura 1, muestra el diagrama general de un
decodificador de N entradas y M salidas. Puesto que cada una
El presente documento corresponde a un informe de práctica de laboratorio

de “nombre de la materia” presentado en la Universidad Militar Nueva Granada
durante el periodo 2018-2.
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INFORME DE PRÁCTICA DE LABORATORIO Versión 1.0
Periodo 2018-2
Mapa de Karnaugh
Como fuente de texto use las letras que se muestran en la
Un mapa de Karnaugh proporciona un método sistemático de siguiente ilustración,
simplificación de
expresiones booleanas y, si se aplica adecuadamente, genera las
expresiones
suma de productos y producto de sumas más simples posibles,
conocidas como
expresiones mínimas (Floyd, 2006).
Figura 3, Fuente de texto
2. Para seleccionar cada una de las posiciones del

nombre use un Dip Switch de 4 bits.
3. Para determinar los espacios en blanco puede usar

condiciones de no importa en sus calculo y reducción
de funciones lógicas, pero tenga presente que el
m
display debe estar totalmente apagado en los
er as
caracteres en blanco, para esto puede activar o
desactivar el display con su ánodo o cátodo común,
co
por medio de un transistor BJT.
eH w
o.
Figura 2. Mapa de karnaugh. 4. Implemente el desarrollo de su circuito en un impreso
rs e diseñando un PCB.
ou urc
II. OBJETIVOS
DESARROLLO:
Diseñar un decodificador para Display 16 segmentos por
o
A continuación, es mostrado cada uno de los requisitos del

medio de lógica combinacional, con 4 entradas y 16 salidas. diseño del codificador
aC s
vi y re
1. El nombre y el apellido codificado fue:

III. COMPETENCIAS A DESARROLLAR
DIEGO_BARRIOS
Diseño, análisis y creatividad para implementar circuitos con
ed d
óptimos resultados, pocos elementos y costos razonables. 2. Se utilizaron 4 BITS de entrada utilizando 16
Escribir informes, escritos según formatos establecidos. combinaciones para obtener
ar stu
Consultar la bibliografía recomendada, Proponer alternativas en

la bibliografía, solución de ejercicios, temas de clase. Adelantar  12 combinaciones para las 12 Letras del
su saber con base en estudio autónomo. Comprender las leyes y nombre y apellido.
funciones booleanas en los circuitos lógicos y algunas técnicas  Una combinación para el espacio entre el
is
de diseño. nombre y apellido

 Dos Combinaciones para apagar o encender el
Th
display de 16 segmentos de catado común con

IV. DESARROLLO DE LA PRACTICA un punto.
A continuación, se describe la practica propuesta para el

sh
diseño de un decodificador para un display de 16 segmentos.
1. En Proteus diseñe e implemente:
Seleccione el nombre de uno de sus integrantes de grupo

y codifique en 16 posibles caracteres un nombre y un
apellido, separando estos dos únicamente por un espacio
en blanco. No use nombres o apellidos con “ñ”. Si sobran
caracteres todos deben presentar un espacio en blanco.
Periodo 2018-2
3. Fue utilizado el método del mapa de karnaugh para la

A continuación, la Tabla de verdad del decodificador con simplificación de cada salida.
entradas y salidas.
A continuación, cada una de ellas:
Letra A B C D Salida A
D 0 0 0 0
CD\AB 00 01 11 10
I 0 0 0 1
00 1 1 1 1
E 0 0 1 0
01 1 1
G 0 0 1 1
11 1 1 1
O 0 1 0 0 10 1 1 1
- 0 1 0 1 Tabla 3.Mapa de Karnaugh para el LED A
B 0 1 1 0
A= A= B´+AĆ+C´D´ (1)
A 0 1 1 1
m
er as
R 1 0 0 0 Salida B
co
R 1 0 0 1
eH w
CD\AB 00 01 11 10
I 1 0 1 0
00 1 1 1 1
o.
O 1 0 1 1
S 1
rs e
1 0 0
01 1 1
ou urc
11 1 1 1
. 1 1 0 1
10 1 1 1
1 1 1 0 Tabla4 Mapa de Karnaugh para el LED B
1 1 1 1
o
Tabla 1 . Entradas de 4 Bits B= X´+WÝ+Y´Z´ (2)

aC s
vi y re
A B C D E F G H K M N U P T R S Salida C
1 1 1 1 1 1 0 0 0 1 0 0 0 0 1 0
1 1 0 0 1 1 0 0 0 1 0 0 0 0 1 0 CD\AB 00 01 11 10
1 1 0 0 1 1 1 1 0 0 0 1 0 0 0 0 00 1 1 1
ed d
1 1 0 1 1 1 1 1 0 0 0 0 1 0 0 0 01 1
ar stu
1 1 1 1 1 1 1 1 0 0 0 0 0 0 0 0 11 1 1
0 0 0 0 0 0 0 0 0 0 0 1 1 0 0 0 10 1
1 1 1 1 1 1 0 0 0 1 0 0 1 0 1 0 Tabla5 Mapa de Karnaugh para el LED C.
is
1 1 1 1 0 0 1 1 0 0 0 1 1 0 0 0
1 1 1 0 0 0 1 1 0 0 0 1 1 0 0 0 C= AĆ´D´+ABĆ´+AB´D+A´BC (3)
Th
1 1 1 0 0 0 1 1 0 0 0 1 1 0 0 0
Salida D
1 1 0 0 1 1 0 0 0 1 0 0 0 0 1 0
1 1 1 1 1 1 1 1 0 0 0 0 0 0 0 1
CD\AB 00 01 11 10
sh
1 1 0 1 1 1 0 1 0 0 0 1 1 0 0 1
0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 00 1 1 1
0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 01
0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 11 1 1 1
Tabla 2. Salidas Abecedario del display de 16 segmentos. 10 1
Tabla7 Mapa de Karnaugh para el LED D.
D= E= AĆ´D´+ BC´D´+BĆD+A´BC (4)
Periodo 2018-2
Salida E Salida U
CD\AB 00 01 11 10 CD\AB 00 01 11 10
00 1 1 1 00 1 1
01 1 01 1 1
11 1 1 11 1
10 1 1 1 10 1
Tabla 6 Mapa de Karnaugh para el LED E Tabla 11 Mapa de Karnaugh para el LED U
E= BC´D´+ A´B´+BĆ+A´D´ (5) U= A´BĆD´+AC´D´+ABĆ´+A´BD (10)
Salida G Salida P
CD\AB 00 01 11 10 CD\AB 00 01 11 10
00 1 1 00 1 1
m
er as
01 1 01 1 1
11 1 1 1 11 1 1
co
eH w
10 1 10 1
Tabla 8 Mapa de Karnaugh para el LED G Tabla 6 Mapa de Karnaugh para el LED P
o.
G= A´BĆ´D +AĆD+BĆD+ABĆ´+ A´BĆ
rs e (6) P= AC´D´+AĆD+ABĆ´+A´BD+A´BC (11)
ou urc
Salida H Salida S
o
CD\AB 00 01 11 10 CD\AB 00 01 11 10
aC s
00 1 1 1 00 1 1
vi y re
01 1 01 1 1
11 1 1 1 11 1 1
10 1 10 1
Tabla 9 Mapa de Karnaugh para el LED H Tabla 12 Mapa de Karnaugh para el LED U
ed d
ar stu
H= BC´D´+AĆD+BĆD+ABĆ´+A´BĆ (7) S= A´BCD´+ABĆD´+A´BĆ´ (13)
Salida M
Salida R
is
CD\AB 00 01 11 10
CD\AB 00 01 11 10
Th
00 1
01 1 00 1 1
11 01 1 1
10 1 1 11 1 1
sh
Tabla 10 Mapa de Karnaugh para el LED M 10 1

Tabla 13 Mapa de Karnaugh para el LED R
M= A´BCD´+ABĆD´+A´BĆ´ (8)
R= ABĆ´ (14)
Periodo 2018-2
Con las funciones simplificada por el método de karnaugh se

realiza el circuito del decodificador de nombre.
Adicionalmente de conecta el transistor 2N2222 en el catado
del display para su desactivación y activacion, Veamos a
continuación en la figura o anexo 1:
Figura 20. Diagrama de conectividad del circuito integrado 74LS04 NOT
Figura 16. Circuito del Decodificador simplificado
m
er as
4. A continuación, el PCB del circuito resultante de la
co
simulación en proteus:
eH w
Figura 17. Diagrama de conectividad del circuito integrado 74LS32 OR
o.
rs e Alphanumeric Display - Red 0.8" [KYX-8103BS] - Micro JPM
ou urc
V. ANÁLISIS DE RESULTADOS
o
Se obtuvo la simplificación por el método de mapas

aC s
Karnaugh el es uno de los mas efectivos cuando se usa

vi y re
entradas de 4Bits. Contemplando el menor uso de compuertas

para optimo ahorro de costos para la construcción del
decodificador
ed d
Figura. 18PCB Decodificador Nombre. Se hizo uso de la teoría combinacional e identificación de las
compuertas e Display de 16 segmentos de catado común.
ar stu
Se adjuntan las referencias de las compuertas NOT, AND y OR

y display de 16 segmentos a utilizar para la construcción del
VI. CONCLUSIONES
is
circuito
Th
Se Diseñó un decodificador para Display 16 segmentos por

medio de lógica combinacional, con 4 entradas y 16 salidas.
Obteniendo una de las aplicaciones de decodificador del display
de 16 segmentos.
sh
Se obtuvo de PCB en proteus para la construcción del circuito.
Figura 19. Diagrama de conectividad del circuito integrado 74LS08 AND
Periodo 2018-2
REFERENCIAS
[1] Alldatasheet (SN74LS08) PDF [Online] Disponible en:

http://www.alldatasheet.com/datasheet-pdf/pdf/12619/ONSEMI/74LS08.html
[2] Alldatasheet (SN74LS04) PDF [Online] Disponible en:

http://html.alldatasheet.com/html-
pdf/12617/ONSEMI/74LS04/180/1/74LS04.html
[3] Alldatasheet (74LS32) PDF [Online] Disponible

en:http://pdf1.alldatasheet.com/datasheet-
pdf/view/5707/MOTOROLA/74LS32.html
[ 4] http://www.huergo.edu.ar/tcweb/pdf/APCap16.pdf
Figura 1, Diagrama de bloques de un circuito combinacional

(Mano, 2003)
m
er as
Figura 20. Diagrama de conectividad del circuito integrado 74LS04 NOT
Figura 19. Diagrama de conectividad del circuito integrado 74LS08 AND
co
eH w
Figura. 18PCB Decodificador Nombre.
Figura 17. Diagrama de conectividad del circuito integrado 74LS32 OR
o.
rs e
Figura 16. Circuito del Decodificador simplificado
ou urc
Tabla 6 Mapa de Karnaugh para el LED U
Tabla 3.Mapa de Karnaugh para el LED A

Tabla 4.Mapa de Karnaugh para el LED B
o
Tabla 5.Mapa de Karnaugh para el LED C

aC s
Tabla 6.Mapa de Karnaugh para el LED D

vi y re
Tabla 7.Mapa de Karnaugh para el LED E

ed d
ar stu
is
Th
sh
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INFORME DE PRÁCTICA DE LABORATORIO Versión 1.

consiste en compuertas lógicas cuyas salidas en cualquier

partir de la aplicación de diagramas de Karnaugh comparando

Mapa de Karnaugh Un mapa de Karnaugh proporciona un

Se trata del método de QuineMcCluskey. El método de Quine-

El presente documento corresponde a un informe de práctica de laboratorio

2. Para seleccionar cada una de las posiciones del

3. Para determinar los espacios en blanco puede usar

A continuación, es mostrado cada uno de los requisitos del

1. El nombre y el apellido codificado fue:

Consultar la bibliografía recomendada, Proponer alternativas en

de diseño. nombre y apellido

display de 16 segmentos de catado común con

A continuación, se describe la practica propuesta para el

diseño de un decodificador para un display de 16 segmentos.

1. En Proteus diseñe e implemente:

Seleccione el nombre de uno de sus integrantes de grupo

3. Fue utilizado el método del mapa de karnaugh para la

Tabla 1 . Entradas de 4 Bits B= X´+W´Y+Y´Z´ (2)

D= E= A´C´D´+ BC´D´+B´CD+A´BC (4)

E= BC´D´+ A´B´+BĆ+A´D´ (5) U= A´BĆD´+AC´D´+ABĆ´+A´BD (10)

H= BC´D´+AĆD+BĆD+ABĆ´+A´BĆ (7) S= A´BCD´+ABĆD´+A´BĆ´ (13)

Tabla 10 Mapa de Karnaugh para el LED M 10 1

Con las funciones simplificada por el método de karnaugh se

Figura 20. Diagrama de conectividad del circuito integrado 74LS04 NOT

Figura 16. Circuito del Decodificador simplificado

Se obtuvo la simplificación por el método de mapas

Karnaugh el es uno de los mas efectivos cuando se usa

entradas de 4Bits. Contemplando el menor uso de compuertas

Se adjuntan las referencias de las compuertas NOT, AND y OR

Se Diseñó un decodificador para Display 16 segmentos por

Se obtuvo de PCB en proteus para la construcción del circuito.

Figura 19. Diagrama de conectividad del circuito integrado 74LS08 AND

[1] Alldatasheet (SN74LS08) PDF [Online] Disponible en:

[2] Alldatasheet (SN74LS04) PDF [Online] Disponible en:

[3] Alldatasheet (74LS32) PDF [Online] Disponible

Figura 1, Diagrama de bloques de un circuito combinacional

Tabla 3.Mapa de Karnaugh para el LED A

Tabla 5.Mapa de Karnaugh para el LED C

Tabla 6.Mapa de Karnaugh para el LED D

Tabla 7.Mapa de Karnaugh para el LED E

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