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Tema6 1 ParametrosElec PDF
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Introducción Introducción
! La información pude ser representada como ! Hay distintas formas de implementar circuitos
un conjunto de unos y ceros (nivel lógico) digitales (tecnologías digitales)
! En un circuito digital los unos y los ceros ! Existen muchos tipos de tecnologías
están representados por tensiones altas (1) o ! CMOS
TTL
bajas (0) !
! ECL
! Se podrán construir dispositivos que procesen ! BiCMOS
la información de forma que se pueda operar ! ….
con números, procesar imágenes, transmitir ! Dependiendo de las características del circuito
información, etc. a realizar se elegirá una u otra tecnología
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Dispositivos discretos Familias lógicas
! Bipolar
! TTL
! ECL
! MOS
! CMOS
! HCMOS (Componentes discretos)
! NMOS
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7 8
Función de transferencia de una puerta
Niveles lógicos
V(y)
V(x) V(y)
V
H f V V(y)
V(y)=V(x) "1" OH Pendiente = -1
V V
IH OH
Zona de pendiente muy
abrupta (mucha indefinición
V Voltage de transición No permitido
M en la salida)
VL V Pendiente = -1
IL VOL
"0"
V
V(x) OL V
VL V V V(x)
H IL IH
Niveles de voltage
9 10
VOL VOL
0V 0V 0V
VIL
Pendiente = -1
VOL VOL
0V 0V
V V V(x)
IL IH
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Regeneración de los niveles
lógicos Inmunidad al ruido
Ruido
amortiguado
ENTRADA VALOR INTERMEDIO SALIDA
VDD ENTRADA SALIDA
VDD VDD
VIH VOH
VIH
VIL
0V 0V
VIL
Ruido
VOL magnificado
VIN VOUT 0V
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VOL
0V
! Indican en voltios la inmunidad al ruido
de una determinada tecnología
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Ejemplo A: Calcular márgenes Ejemplo B: Calcular márgenes
de ruido de ruido
NMH=1.6-1.05=0.55V NMH=1.7-0.63=1.07V
NML=0.7-0.1=0.6V NML=0.35-0.09=0.26V
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CMOS
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Niveles de ruido CMOS y TTL Niveles de ruido CMOS y TTL
ENTRADA SALIDA ! CMOS:
5V 5V
! NMH=0.9V
! NML=1.17V
VOH=2.4V
! TTL:
VIH=2V ! NMH=0.4V
! NML=0.4V
VIL=0.8V VOL=0.4V
0V 0V ! Basándose en estos resultados, ¿que familia
de dispositivos (CMOS o TTL) se tienen que
usar en un entorno de alto ruido?
TTL
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Disipación en circuitos CMOS y
TTL Tiempo de propagación
! En un circuito TTL la potencia disipada Vin
no depende de la frecuencia de
operación 50%
10% t
0 f tf tr
25 26
0
27 28
Fan-in y Fan-out Carga CMOS
! La lógica CMOS utiliza transistores MOS
(a) Fan-out N con una impedancia de entrada
capacitativa
M
! La limitación viene dada por los tiempos
(b) Fan-in M
N de carga y descarga asociados con la
resistencia de salida de la puerta
excitadora
Fan-out: Número máximo de entradas que se pueden conectar a
una salida
29 30
31 32
Carga TTL Carga TTL
IIH
IIIHIL
N
NII
IHIH < IOH
N IIH
N IIL < IOL
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Ejemplos y ejercicios prácticos
v0 v1 v2 v3 v4 v5
Si los tiempos de
propagación de
cada inversor son v0 v1 v5
tpHL=10ps y
tpLH=12ps calcula
la frecuéncia de
oscilación del
circuito
T = 2 ! tp ! N
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