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transistores unipolares
Presentado al tutor:
21/05/2020
Suponga que trabaja para una compañía que diseña, prueba, fabrica y
comercializa instrumentos electrónicos. Su segunda asignación es
presentar trabajando en equipo con cuatro compañeros, una solución
llamada amplificador de baja señal con JFET, el cual permite restaurar
señales débiles en los diferentes circuitos de transmisión y recepción de
información las especificaciones dadas para el diseño son las siguientes:
Señal de entrada: 300mV a 1Khz.
Referencia del JFET para simular en proteus: J201
ID= 3mA, VD= 10V, VGS (off)= -8V, VCC= 20V.
De catálogo se tiene que: IDSS puede Variar de 2mA a 20mA… para
este diseño se trabajara IDSS=16mA.
El equipo de trabajo cuenta con 3 semanas para presentar un informe a
la empresa, en él mismo, es obligatorio se evidencie una
fundamentación teórica, una argumentación y la validación de la
solución. Además, de ser aprobada la propuesta, se deberá realizar una
implementación real y para ello se contará con acceso a los laboratorios.
1. Luego de la lectura de los recursos educativos requeridos para la
Unidad 2, Cada estudiante debe describir con sus propias palabras la
teoría de funcionamiento del circuito anterior.
-Estudiante 1:
a.) Calcular la resistencia del drenaje RD.
-Estudiante 2:
b.) Calcular la resistencia del drenaje RS.
-Estudiante 3:
c.) ¿Cuál es el tipo de polarización del JFET? y explique porque el
valor de RG debe ser alto.
-Estudiante 4:
d.) Calcular la reactancia capacitiva de los condensadores de acople.
-Estudiante 5:
e.) Calcular la ganancia de voltaje AV.
VCC−VD
RD=
ID
(20−10)
RD=
3 mA
10
RD=
3
RD=3.3 khoms
Estudiante 2. Calcular la resistencia del drenaje RS
VGSS (OFF )
RS=
IDSS
−8 V
RS=
16 mA
RS=−0.5 ohms
1
xc 3=
2 π∗1000 hz∗10 υf
1
xc 3=
2 π∗1000 hz∗0.1 υf
xc 3=1.5915 ohms
Av=−Gm∗RD
−ID
Av= RD
VGS
ID
Av= RD
VG −GS
ID
Av= RD
0−VS
ID
Av= RD
−VS
ID
Av= RD
ID∗RS
RD
Av=
RS
3.33
Av=
−0.5
Av=−6.66 v