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Análisis e implementación de
sistemas combinacionales
Circuitos lógicos combinacionales
2
Códigos BCD y GRAY
Código:
Código GRAY:
3
Integración de los sistemas numéricos
4
Códigos alfanuméricos
Código ASCII:
5
¿Qué es un Circuito Combinacional?
6
Síntesis o Diseño de Circuitos Combinacionales
Síntesis
Especificación
F(A, B, C ) = ...
A B C F
0 0 0 1
0 0 1 0
0 1 0 1 Simplificación
0 1 1 0
1 0 0 1 e implementación
1 0 1 0
1 1 0 0
1 1 1 1
7
¿Qué es un Circuito Combinacional?
NO es combinacional
SÍ es combinacional
8
Análisis de circuitos combinacionales
9
Módulos combinacionales básicos
MSI (Medium Scale of Integration)
Módulos combinacionales básicos
11
Codificador
ENTRADA DE ACTIVACION
(ENABLE)
Codificador binario
– Dispone de 2n entradas y n salidas: COD
ENTRADAS
SALIDAS
2nxn
– La salida proporciona el código binario del
canal de entrada activado.
12
Codificador
1 0 0 0 0 0 0 0 0 0 0
0 1 0 0 0 0 0 0 0 0 1
0 0 1 0 0 0 0 0 0 1 0
0 0 0 1 0 0 0 0 0 1 1
0 0 0 0 1 0 0 0 1 0 0
0 0 0 0 0 1 0 0 1 0 1
0 0 0 0 0 0 1 0 1 1 0
0 0 0 0 0 0 0 1 1 1 1
X = D4 + D5 + D6 + D7
Y = D2 + D3 + D6 + D7
Z = D1 + D3 + D5 + D7
13
Codificador
Problemas:
– ¿cuál sería la salida del codificador si se activan 2 entradas
simultáneamente?
p. ej: COD(0,1,0,0,1,0,0,0) según las expresiones de X, Y, Z,
sería XYZ=101, pero D5=0
– ¿cuál sería la salida si no se activa ninguna entrada?
COD(0,0,0,0,0,0,0,0) daría XYZ=000 , pero D0 = 0
0
0
0
1
0
0
1
0
14
Codificador
Soluciones
– Se introduce una señal de activación (enable) que permite activar o
desactivar al codificador
– Se realiza una priorización de las entradas. En caso de activación
simultánea por dos o más canales de entrada se toma la más
prioritaria (normalmente la de mayor peso)
D0
D1 8
D2
D3
D4
D5
D6
D7
8
Circuito
de
Prioridad
15
Codificador
Codificador BCD
– Ejemplo: TTL 74147 . Conversor 9 entradas a código BCD (binary
coded decimal)
– ¡¡OJO!! entradas y salidas activas a nivel bajo
16
Codificador
Aplicación:
– Teclado simple
17
Decodificador
SALIDAS
18
Decodificador
A0
D0
A1
D1
E A1 A0 D0 D1 D2 D3
D2 1 0 0 1 0 0 0
1 0 1 0 1 0 0
1 1 0 0 0 1 0
1 1 1 0 0 0 1
E D3 0 X X 0 0 0 0
19
Decodificador
E
Implementación con puertas lógicas
DEC 2 x 4. Entradas activas a nivel alto y
salidas activas a nivel bajo con Enable
invertido
E A1 A0 D0 D1 D2 D3
0 0 0 0 1 1 1
0 0 1 1 0 1 1
0 1 0 1 1 0 1
0 1 1 1 1 1 0
1 X X 1 1 1 1
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Decodificador
1er. codificador
Enable
2do. codificador
21
Decodificador
Display de 7 segmentos BCD a 7 segmentos:
22
Multiplexor
ENTRADA DE ACTIVACION
ENTRADAS
ENTRADAS
SALIDA
SALIDA
23 CONTROL CONTROL
Multiplexor
C1 C0 E3 E2 E1 E0 S
0 0 X X X F F
0 1 X X F X F
1 0 X F X X F
1 1 F X X X F
24
Multiplexor
25
Demultiplexor
Dispone de 1 una entrada, 2n salidas y n líneas de selección
Su función es enviar el valor presente a la entrada a uno de
los canales de salida utilizando las líneas de selección. Por
lo tanto realiza la función inversa del multiplexor.
En su implementación es muy parecido a un DEC nx2n
ENTRADA DE ACTIVACION
ENTRADA
SALIDAS
ENTRADAS
SALIDAS
26 CONTROL
Demultiplexor
S1 S0 E D0 D1 D2 D3 S1 S0 E
0 0 K K 0 0 0
0 1 K 0 K 0 0
1 0 K 0 0 K 0
1 1 K 0 0 0 K
D0
D1
D2
D3
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Demultiplexor
S1 S0 E
S1 S0 E D0 D1 D2 D3
0 0 K K 1 1 1
0 1 K 1 K 1 1
D0
1 0 K 1 1 K 1
1 1 K 1 1 1 K D1
D2
D3
28
GRACIAS