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ESTUDIANTES:
Minaya Sánchez Jesús Cristian
FECHA: 23/06/2016
2016
CONTADORES
I. INTRODUCCION
En el presente laboratorio, se desarrolla el análisis funcional de los circuitos
secuenciales desarrollados con los biestables (Latch y Flip Flops); que
permiten obtener secuencias de estados binarios que al ser decodificados nos
permiten obtener una sucesión de estados ascendente, descendente y/o
desordenado (escalador) pero periódico, estableciendo el módulo del contador,
permitiendo además establecer funciones de almacenamiento de pulsos
recibidos por el sistema digital (proceso de conteo) y relacionar con la
temporización de eventos del sistema digital de lógica cableada.
II. OBJETIVOS
A. Objetivos Generales
B. Objetivos Específicos
III. RESUMEN
El experimento consta de circuitos secuenciales que desarrollan las funciones
de contadores, por lo que se debe atender especial atención de su análisis,
funcionamiento, operación de los circuitos y los resultados obtenidos
(respuesta de funcionamiento del circuito, diagramas de tiempo). Por lo que se
recomienda efectuar las consultas previas en los apuntes de clases, manuales
técnicos adecuados en relación a los dispositivos a emplear y los circuitos
digitales a implementar. Por último se implementa el circuito con los circuitos
integrados realizando conjuntamente pruebas individuales de su
funcionamiento y al terminar dicho proceso se procede a hacer las
verificaciones y desarrollo de las tablas de estados y construir los diagramas de
tiempo.
IV. CIRCUITOS PRESENTADOS EN LABORATORIO
1
R2 R1 R3 R4
1k 1k 1k 1k
U1 U2 U3 U4
2
2
4 15 4 15 4 15 4 15
S
S
J Q J Q J Q J Q
U1(CLK)
1 1 1 1
CLK CLK CLK CLK
16 14 16 14 16 14 16 14
K Q K Q K Q K Q
R
R
3
3
74LS76 74LS76 74LS76 74LS76
R5
10k
C1
470u
Q2
Q3
Q4
R2 R1 R3 R4
1k 1k 1k 1k
U1 U2 U3 U4
2
2
4 15 4 15 4 15 4 15
S
S
J Q J Q J Q J Q
U1(CLK)
1 1 1 1
CLK CLK CLK CLK
16 14 16 14 16 14 16 14
K Q K Q K Q K Q
R
R
3
3
74LS76 74LS76 74LS76 74LS76
U5
AND
R5 Q4
10k
U6:A 1
2
Q3
6 U7
4
5
Q4
Q3
Q2
Q1
Q2
C1 74S40
0.1u NOT
Q1
R6 R7 R8 R9
330 330 330 330
D1 D2 D3 D4
LED-YELLOW
LED-YELLOW
LED-YELLOW
LED-YELLOW
.
Contador “UP” modulo 10:
Q1
Q2
Q3
Q4
R2 R1 R3 R4
1k 1k 1k 1k
U1 U2 U3 U4
2
4 15 4 15 4 15 4 15
S
J Q J Q J Q J Q
U1(CLK)
1 1 1 1
CLK CLK CLK CLK
16 14 16 14 16 14 16 14
K Q K Q K Q K Q
R
R
3
Q4
U5
U6 U8:A
R5 AND 5
Q3
10k 4
6
NOT
2
Q2
1 U7
74S40
Q1
C1
470u NOT
Q4
Q3
Q2
Q1
R6 R7 R8 R9
330 330 330 330
D1 D2 D3 D4
LED-YELLOW
LED-YELLOW
LED-YELLOW
LED-YELLOW
Contador “UP” modulo 7:
Q1
Q2
Q3
Q4
R2 R1 R3 R4
1k 1k 1k 1k
U1 U2 U3 U4
2
4 15 4 15 4 15 4 15
S
J Q J Q J Q J Q
U1(CLK)
1 1 1 1
CLK CLK CLK CLK
16 14 16 14 16 14 16 14
K Q K Q K Q K Q
R
3
3
74LS76 74LS76 74LS76 74LS76
U5
AND
U7
R5 Q4
10k
U6:A 1
NOT
2
Q3
6
4
5
Q4
Q3
Q2
Q1
Q2
C1 74S40
0.1u
Q1
R6 R7 R8 R9
330 330 330 330
D1 D2 D3 D4
LED-YELLOW
LED-YELLOW
LED-YELLOW
LED-YELLOW
U6:A
74LS266
U6:B
5
3
4
6
U4:B
74LS266 5
6
Q4
4
CLK
74LS32
CLK U1:A U5:C U1:B U4:C U2:A U2:B
2
7
Q1 Q2 Q3
9 9
4 15 8 9 11 8 4 15 9 11
S
S
J Q J Q J Q J Q
10 10
U7:A 1 U5:B 6 1 6
1
CLK CLK CLK CLK CLK CLK CLK CLK
1 5 74LS08 74LS32
3 16 14 6 12 10 U7:B 16 14 12 10 U3:A
K Q K Q K Q K Q
R
R
2 4 4 74LS86
11
11
6
3
3
12
13
12
13
U9:A
U5:D 1
3
12 3
11 U8:B 2
13 74LS04
74LS08
4
U8:A 74LS08
2 1 U7:C
9
8
74LS04 U5:A 10
U4:A 2
2 3 74LS32
3 1
1
74LS08
74LS32
Q4
Q3
Q2
Q1
R1 R2 R3 R4
330 330 330 330
D1 D2 D3 D4
LED-YELLOW
LED-YELLOW
LED-YELLOW
LED-YELLOW
J4 = (Qn)´+Q2n
K4 = Qn+Q2n+Q3n
J3 = (Qn)’
K3 = (Q4n)´
J2 = Qn (Q3n)´+(Qn)´Q3n Q4n
K2 = (Qn)´+Q3n
J1 = (Q2n)´Q4n
K1 = Q2n (Q3n)´+(Q2n)´(Q4n)´
Funciones lógicas.
U3:A
1
3
2
12
11 9 11 4 15 9 11 4 15
S
J Q Q1 J Q Q2 J Q Q3 J Q Q4
13
6 1 6 1
U6:B CLK CLK CLK CLK CLK CLK CLK CLK
74LS08
4 12 10 16 14 12 10 16 14
U5:B K Q K Q K Q K Q
R
6
5 4
8
U6:A U4:A
R
1 1 U3:D U3:B
3 3 12 U3:C 4 R5
R
2 2 11 9 6 10k
13 8 5
R
74LS08 74LS08 10
U4:B 74LS32 74LS32
U4:C R
4 74LS32
9 6 U5:A
8 5 1
10 3
74LS08 2
74LS08
74LS32
Q4
Q3
Q2
Q1
D1 D2 D3 D4
LED-YELLOW LED-YELLOW LED-YELLOW LED-YELLOW
R1 R2 R3 R4
470 470 470 470
V. CONCLUSIONES
VI. BIBLIOGRAFIA