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Secretara/Divisin: rea/Departamento:
N de prctica: 1.
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Manual de Prcticas
Divisin de Ingeniera Elctrica. Departamento de Computacin.
1. Seguridad en la ejecucin
Objetivos de la prctica.
Introduccin.
Las memorias de slo lectura ROMs y las de lectura escritura RAMs son
memorias de acceso aleatorio (RANDOM ACCESS MEMORY). Esto significa que
el tiempo de acceso es constante para cualquier localidad que se quiera acceder,
ya que la seleccin se realiza por medio de un bloque direccionador que est
integrado por uno o dos decodificadores. Un decodificador es un circuito
combinacional que tiene n entradas y 2n salidas. Una y slo una de sus mltiples
salidas se activa bajo el control de la direccin de entrada y de la seal de
habilitacin, logrando as seleccionar a una localidad de la memoria. La salida
puede ser activa baja o activa alta dependiendo del nivel de voltaje de la lnea de
salida (1 0).
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Los flip-flops y las compuertas con los que se arman las memorias de tipo
estticas se fabrican con tecnologa TTL de las familias SSI y MSI, como sabemos
las compuertas TTL en todas las versiones vienen en tres tipos diferentes de
configuraciones de salida.
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Hay sin embargo, una clase especial de compuerta tipo poste totmico que
permite la conexin alambrada de las salidas con el propsito de formar un
sistema de bus comn. Cuando una compuerta TTL de salida tipo poste totmico
tiene esta propiedad, se le llama compuerta de tres estados (o triestado). El inciso
c de la figura 1, muestra el diagrama del circuito inversor de tres estados.
Observemos que los transistores Q6, Q7 y Q8, asociados con la entrada de
control forman un circuito similar a la compuerta de colector abierto. Por su parte
los transistores Q1-Q5, asociados con la entrada de datos forman un circuito TTL
de poste totmico y los dos circuitos se conectan juntos por medio del diodo D1.
Esta compuerta tiene tres estados de salida: (1) un estado de bajo nivel cuando el
transistor inferior del poste totmico est conduciendo y el superior est en corte;
(2) un estado de nivel alto cuando el transistor superior del poste totmico est
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Desarrollo.
A2 A1 A0 S7 S6 S5 S4 S3 S2 S1 S0
0 0 0
0 0 1
0 1 0
0 1 1
1 0 0
1 0 1
1 1 0
1 1 1
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iii) Armar los dos casos de bus comn que se muestran en la figura 2,
utilizando un CI 7401 que presenta salidas de colector abierto. Analice el
comportamiento, llene las tablas y explique al instructor lo que est
sucediendo.
-Segn la lgica booleana que funcin representa este circuito alambrado (el 2do.
caso).
Material.
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Previo.
F(x, y, z) = ( 1,4,5,7 )
NOTA: Cuando se pide realizar el diseo, ste debe ser justificado por medio
de la teora.