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UD5 Circuitos Secuenciales PDF
UD5 Circuitos Secuenciales PDF
Circuitos secuenciales:
anlisis y diseo de registros
y de contadores.
Jos Gorjn
ndice
Objetivos.
Introduccin.
Anlisis de registros de almacenamiento.
Anlisis de registros de desplazamiento.
Circuitos de aplicacin con registros.
Anlisis de circuitos contadores y divisores de
frecuencia asncronos con biestables integrados.
Anlisis de circuitos contadores y divisores de
frecuencia sncronos con biestables integrados.
Programmable Logic Design (PLD)
1
Objetivos.
Registros de almacenamiento.
Registros de desplazamientos.
Contador en anillo y Johnson.
Circuitos contadores, con biestables.
Circuitos divisores de frecuencia.
Circuitos contadores asncronos.
Circuitos contadores sncronos.
Registros de almacenamiento
Por Flanco
Por latch
Registros de desplazamiento
Entrada serie/Salida serie
Entrada paralelo/Salida paralelo
Entrada paralelo/Salida serie
Entrada serie/Salida paralelo
2
Registros de
almacenamiento
Por Flanco
Por Latch
3
Registro de almacenamiento con
biestables por latch. 7475 y 7477
Registros de desplazamiento.
Shift Register
4
Entrada serie /salida serie.
Entrada serie /
salida paralelo?
Registro de desplazamiento
E.Serie/S.Serie y E.Serie/S.Paralelo
5
Registro E.Serie/S.Serie 7491
6
Entrada paralelo / salida paralelo.
Entrada serie /salida paralelo.
7
Registro E.Serie/S.Serie
E.Paralelo/S.Serie 74166
Registros Universales
7495
74194
8
Registro Universal 7495
9
Smbolo del registro universal
74194
10
Tabla de funcionamiento del 74194
11
Circuitos de Aplicacin
con Registros.
Contador en Anillo.
Contador Johnson.
12
Contador Johnson de 5 bits
13
Diagrama de bloques de un
contador y un divisor de frecuencia.
Contadores asncronos
14
Contador Incremental (flip-flop T)
15
Circuito contador binario de mdulo 16
16
Retardo de propagacin al pasar del
estado 1111 al 0000
17
Contador binario descendente de
mdulo 16.
18
Contador Up-Down de modulo 8
19
Contador BCD asncrono
20
Dado electrnico con biestables J-K.
Contadores sncronos.
21
Contador de 4 bits
22
Contador 4 bits (Flip-flop D)
23
Ejercicios.-
El 74190
24
Cronograma de funcionamiento del
74190
25
Contador de 0 a 9999 con C.I 74190
conexin sncrona o propagacin anticipada
26
El 74191
27
Dado electrnico realizado con el
74191
28
UD-6 y 7 Circuitos Secuenciales.
Simple
Simple PLA
PLA
PAL
PAL versus
versus PLA
PLA
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UD-6 y 7 Circuitos Secuenciales.
SPLD
SPLD Architectures
Architectures (PAL)
(PAL)
Programmable
Programmable Logic
Logic -
- PLD
PLD
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UD-6 y 7 Circuitos Secuenciales.
Macroclula
Macroclula de
de una
una AMD
AMD 22V10
22V10
CPLD
CPLD Architecture
Architecture
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UD-6 y 7 Circuitos Secuenciales.
32
UD-6 y 7 Circuitos Secuenciales.
FPGA
FPGA Architecture
Architecture
SRAM
SRAM yy OTP
OTP Logic
Logic Cell
Cell
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UD-6 y 7 Circuitos Secuenciales.
Categories
Categories of
of FPGAs
FPGAs
SRAM based
) Volatile configuration ( lost when power off)
) Need external support to download configuration data
) Easier to reconfigure
Antifuse
) Nonvolatile configuration
) Faster than SRAM based
) No reconfiguration
EEPROM
EPROM
Packages
Packages
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