UNIVERSIDAD PRIVADA DE

TACNA
FACULTAD DE INGENIERA
ESCUELA DE INGENIERA
ELECTRNICA

CIRCUITOS
INTEGRADOS TTL
CIRCUITOS DIGITALES I
DOCENTE: Ing. Elena Vildozo Zambrano
ALUMNOS:
Triana Humpire Silva
Ernesto Ros de la Cruz

TACNA - PER

CIRCUITOS DIGITALES I

UNIVERSIDAD PRIVADA DE TACNA

INFORME DE LABORATORIO 01: Circuitos Integrados TTL

1. BASE TEORICA
1.1.
Familia de Circuitos Integrados TTL
TTL - Viene de las iniciales: Transistor - Transistor - Logic
Lgica Transistor a
Transistor. La familia de los circuitos
integrados digitales TTL tienen las siguientes caractersticas:
- El voltaje de alimentacin es de + 5 Voltios, con: V mn = 4.75 Voltios
y Vmx = 5.25 Voltios.
Por encima del voltaje mximo el circuito integrado se puede daar
y por debajo del voltaje mnimo el circuito integrado no funcionara
adecuadamente.
Caractersticas
Su tensin de alimentacin caracterstica se halla comprendida
entre los 4,75V y los 8,25V (como se ve, un rango muy estrecho).
Normalmente TTL trabaja con 5V.
Los niveles lgicos vienen definidos por el rango de tensin
comprendida entre 0,0V y 0,8V para el estado L (bajo) y los 5,4V
y Vcc para el estado H (alto).
La velocidad de transmisin entre los estados lgicos es su mejor
base, si bien esta caracterstica le hace aumentar su consumo
siendo su mayor enemigo. Motivo por el cual han aparecido
diferentes versiones de TTL como FAST, LS, S, etc y ltimamente
los CMOS: HC, HCT y HCTLS. En algunos casos puede alcanzar
poco ms de los 400 MHz.
Las seales de salida TTL se degradan rpidamente si no se
transmiten a travs de circuitos adicionales de transmisin (no
pueden viajar ms de 2 m por cable sin graves prdidas).
Esta familia utiliza elementos que son comparables a los transistores
bipolares diodos y resistores discretos, y es probablemente la ms
utilizada. A raz de las mejoras que se han realizado a los CI TTL, se
han creado subfamilias las cuales podemos clasificarlas en:

TTL estndar.

TTL de baja potencia (L).

TTL Schottky de baja potencia (LS).

TTL Schottky (S).

TTL Schottky avanzada de baja potencia (ALS).

TTL Schottky avanzada (AS).

Como sus caractersticas de voltaje son las mismas (La familia lgica
TTL trabaja normalmente a +5V), analizaremos sus velocidades y
consumo
de
potencia.

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Velocidad aproximada

Subfamilia TTL

1.5 ns

Schottky avanzada

3 ns

Schottky

4 ns

Schottky
potencia

10 ns

Schottky de baja potencia

10 ns

estndar

avanzada

de

baja

33 ns
baja potencia
Tabla 1: Velocidades de las distintas subfamilias TTL

Consumo de potencia por

puerta

Subfamilia TTL

1 mW

baja potencia

1 mW

Schottky avanzada de baja

potencia

2 mW

Schottky de baja potencia

7 mW

Schottky avanzada

10 mW

estndar

20 mW
Schottky
Tabla 2: Consumo de potencia de las subfamilias TTL
Observemos que las subfamilias Schottky de baja potencia como la
Schottky avanzada de
baja potencia renen excelentes
caractersticas de alta velocidad y bajo consumo de potencia.
Debido a su configuracin interna, las salidas de los dispositivos TTL
NO pueden conectarse entre s a menos que estas salidas sean de
colector abierto o de tres estados.
Notas:

Las seales de entrada nunca deben de ser mayores que

el voltaje de alimentacin ni inferiores al nivel de tierra.
Si alguna entrada debe estar siempre en un nivel alto, conectarla
a Vcc (voltaje de alimentacin).
Si alguna entrada debe estar siempre en un nivel bajo, conectarla
a tierra.
Si hay entradas no utilizadas, en compuertas NAND, OR, AND,
conectarlas a una entrada que si se est utilizando.
Es mejor que las salidas no utilizadas de unas compuertas estn
a nivel alto pues as consumen menos corriente.
Evitar los cables largos dentro de los circuitos.

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1.2.

Utilizar por lo menos un capacitor de desacople (0.01 uF a 0.1 uF)

por cada 5 o 10 paquetes de compuertas, uno por cada 2 a 5
contadores y registros y uno por cada monoestable.
Estos capacitores de desacople eliminan los picos de voltaje de
la fuente de alimentacin que aparecen cuando hay un cambio
de estado en una salida TTL/LS. (de alto a bajo y viceversa)
Estos capacitores deben tener terminales lo ms cortos posible y
conectarse entre Vcc y tierra, lo mas cerca posible al circuito
integrado.
OR
Este circuito integrado consta de 4 puertas OR de dos entradas
con salida en Totem Pole. Su funcin es realizar la suma lgica
de las dos variables de entrada.

1.3.

AND
Este circuito integrado consta de 4 puertas AND de dos
entradas cada una y con salida totem pole.

1.4.

NOT
El circuito integrado
salida totem pole.

1.5.

7404

consta

de

6 inversores

con

OR EXC
Este circuito nos proporciona 4 puertas EX-OR 2 entradas. El
circuito integrado 7486 uno de los usos que podemos darle en
la prctica es de circuito semi sumador, el bit de acarreo lo
podemos implementar aadiendo en paralelo con las entradas
una puerta AND.
Las patillas de alimentacin son el pin 14 VDD y 7 VSS o GND.
El tiempo de propagacin tpico de la puerta es de 30ns.
Las familias disponibles para este circuito son:

7486

74LS86

74S86

74L86

Este circuito se puede sustituir por el 74386 que es ms fcil de

encontrar.
4

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2. DIAGRAMAS Y TABLA DE CIRCUITOS INTEGRADOS

2.1.

CIRCUITO 7432 TTL

SIMBOLO

DE

LA

PUERTA

LOGICA OR:

Esta puerta lgica se representa en lgebra booleana como:

Q=B+ A

TABLA DE VERDAD
LOGICA OR:

2.2.

Entradas

Salida

CIRCUITO 7408 TTL

SIMBOLO PUERTA AND

PUERTA

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Esta puerta lgica se representa en lgebra booleana como:

Q= AB
TABLA DE VERDAD PUERTA LOGICA AND:
Entradas

Salida

1
Esta tabla de la verdad es la que

Entradas

Salida

0V

0V

0V

la salida. Hay que recordar que el

0V

5V

0V

nivel bajo estar entre 0 y 0,8 Voltios

5V

0V

0V

y el alto entre 2,4 y la tensin de

5V

5V

5V

alimentacin

2.3.

menos se suele usar en ella vemos

los voltajes que toman las entradas y

CIRCUITO 7404
SIMBOLO PUERTA NOT:

TABLA DE VERDAD PUERTA LOGICA NOT:

ENTRADA A
0

SALIDA B
1
6

Voltios.

La

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1

2.4.

CIRCUIRO 7486 TTL

SIMBOLO PUERTA OR-EXC

La funcin en lgebra booleana es: Q= A B

TABLA DE VERDA PUERTA OR-EXC

Entradas
A

Salida
B

3. EXPERIENCIA
3.1.
3.1.1.

CIRCUITO LOGICO
OR

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3.1.2.

AND

3.1.3.

NOT

3.1.4.

OR-EXC

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3.2.

TABLA DE COMPROBACION

3.2.1.

OR

ENTRADAS
A
B
1
1
1
0
0
1
0
0
3.2.2.

ENTRA
DA
A
1
0

C3
1
1
1
0

C4
1
1
1
0

SALIDAS
C1
C2
0
0
0
0
0
0
1
1

C3
0
0
0
1

C4
0
0
0
1

AND

ENTRADAS
A
B
1
1
1
0
0
1
0
0
3.2.3.

SALIDAS
C1
C2
1
1
1
1
1
1
0
0

NOT

SALIDA
Y1
0
1

3.2.4.

Y2
0
1

Y3
0
1

Y4
0
1

Y5
0
1

Y6
0
1

OR-EXC

ENTRADAS
A
B
1
1
1
0
0
1
0
0

SALIDAS
Y1
Y2
0
0
1
1
1
1
0
0

3.3.
CIRCUITO A NIVEL INTEGRADO
3.3.1.
OR

Y3
0
1
1
0

Y4
0
1
1
0

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3.3.2.

AND

3.3.3.

NOT

3.3.4.

OR-EXC

10

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4. SIMULACION
4.1.
OR

4.2.

AND

11

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4.3.

NOT

4.4.

OR-EXC

5. CONCLUSIONES

12