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Pines de configuración del dispositivo

Cuadro 13–10. Pines de configuración del dispositivo Cyclone dedicado (parte 3 de 3)

Usuario Configuración
Nombre del pin Tipo de pasador Descripción
Modo Esquema
– PD
DCLK Entrada (PS) En la configuración de PS, la entrada de reloj registra datos de una fuente
COMO Salida (como) externa en el dispositivo de destino. Los datos se enganchan en el
FPGA en el borde ascendente de DCLK. En la configuración de AS, DCLK
es una salida de Cyclone FPGA que proporciona temporización para la
interfaz de configuración. Después de la configuración, los niveles
lógicos en este pin no afectan al Cyclone FPGA. Este pin utiliza búferes
de entrada de disparador Schmitt

aso E/S en modo COMO Producción Señal de control del Cyclone FPGA al dispositivo de configuración en
PS, serie en modo AS utilizado para leer los datos de configuración.
N/A en modo
AS

nCSO E/S en modo COMO Producción Señal de control de salida del Cyclone FPGA al dispositivo de configuración
PS, en serie en modo AS que habilita el dispositivo de configuración.
N/A en modo
AS

–
NCE Todo Aporte Activación de chip bajo activo. El pin nCE activa el dispositivo con una
señal baja para permitir la configuración. El pin nCE debe mantenerse
bajo durante la configuración, la inicialización y el modo de usuario.
En la configuración de un solo dispositivo, ate el pin nCE bajo.
En la configuración de varios dispositivos, el pin nCE del primer
dispositivo está vinculado bajo, mientras que su pin nCEO está
conectado al nCE del siguiente dispositivo de la cadena. Mantenga el
pin nCE bajo para programar el FPGA a través de JTAG. Este
pin utiliza búferes de entrada de disparador Schmitt

– Todo
director general Producción Salida que se vuelve baja cuando se completa la configuración del
dispositivo. En la configuración de un solo dispositivo, este pin se deja
flotando. En la configuración de varios dispositivos, este pin alimenta el
pin nCE del siguiente dispositivo . El nCEO del último dispositivo de
la cadena se deja flotando.
–
FECHA0 Todo Aporte Entrada de datos. En el modo de configuración en serie, los datos de
configuración de bit­wide se presentan al dispositivo de destino en el pin
DATA0 . Alternar DATA0 después de la configuración no afecta el
dispositivo configurado. Este pin utiliza búferes de entrada de disparador
Schmitt

13–48 Corporación Altera

Manual del dispositivo Cyclone, Volumen 1 mayo de 2008
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Configuración de FPGA Cyclone

La Tabla 13–11 describe los pines de configuración opcionales. Si estos pines de configuración opcionales no están

habilitados en el software Quartus II, están disponibles como pines de E/S de usuario de uso general. Por lo tanto,

durante la configuración, estos pines funcionan como pines de E/S de usuario y están triestablecidos

con pull­ups débiles.

Cuadro 13–11. Pines de configuración de dispositivo de ciclón opcionales

Nombre del pin Modo de usuario Tipo de pasador Descripción

CLKUSR N/A si la opción está Aporte Entrada de reloj opcional proporcionada por el usuario. Sincroniza la inicialización
activada, E/S si la opción está de uno o más dispositivos. Este pin se habilita activando Habilitar reloj de inicio
desactivada proporcionado por el usuario (CLKUSR)
opción en el software Quartus II.

INIT_DONE N/A si la opción está activada, E/
S si la opción está
desactivada
Producción Pin de estado. Se puede utilizar para indicar cuando el dispositivo se ha inicializado y
drenaje abierto está en modo de usuario. El pin INIT_DONE debe colocarse en VCC con una resistencia de
10 kΩ. El pin INIT_DONE se vuelve bajo durante la configuración. Antes y después de la
configuración, el pin INIT_DONE se libera y se lleva a VCC mediante una resistencia pull­

up externa. Debido a que INIT_DONE tiene tres estados antes de la configuración, la resistencia

pull­up externa lo eleva.

Por lo tanto, el circuito de monitoreo debe poder detectar una transición de bajo a alto. Este
pin se habilita activando la opción de salida Habilitar INIT_DONE en el software Quartus II.

DEV_OE N/A si la opción está
activada, E/S si la
opción está desactivada.
Aporte Pin opcional que permite al usuario anular todos los estados triples en el dispositivo. Cuando
este pin está bajo, todos los pines de E/S tienen tres estados; cuando este pin se eleva,
todos los pines de E/S se comportan según lo programado.
Este pin se habilita activando la opción Habilitar salida de todo el dispositivo (DEV_OE)
en el software Quartus II.

DEV_CLRn N/A si la opción está activada, I/O Aporte Pin opcional que le permite anular todos los borrados en todos los registros del dispositivo.
si la opción está Cuando este pin se baja, todos los registros se borran; cuando este pin se eleva, todos los
desactivada. registros se comportan según lo programado.
Este pin se habilita activando la opción Habilitar restablecimiento de todo el dispositivo
(DEV_CLRn) en el software Quartus II.

Corporación Altera 13–49

mayo de 2008 Manual del dispositivo Cyclone, Volumen 1

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documentos de referencia

La Tabla 13–12 describe los pines JTAG dedicados. Los pines JTAG deben mantenerse
estables antes y durante la configuración para evitar la carga accidental de instrucciones
JTAG.

Tabla 13–12. Pines JTAG dedicados

Usuario
Nombre del pin Tipo de pasador Descripción
Modo

TDI Entrada N/A Pin de entrada en serie para instrucciones, así como datos de prueba y programación.
Los datos se desplazan en el flanco ascendente de TCK. Si no se requiere la interfaz
JTAG en la placa, el circuito JTAG se puede desactivar conectando este pin a VC Este
C. pin
utiliza búferes de entrada de disparador Schmitt

TDO N/A Salida Pin de salida de datos en serie para instrucciones, así como datos de prueba y programación. Los
datos se desplazan en el flanco descendente de TCK. El pin tiene tres estados si los datos
no se desplazan fuera del dispositivo. Si no se requiere la interfaz JTAG en la placa, el
circuito JTAG se puede desactivar dejando este pin desconectado.

TMS Entrada N/A Pin de entrada que proporciona la señal de control para determinar las transiciones de la máquina
de estado del controlador TAP. Las transiciones dentro de la máquina de estado ocurren en el flanco
ascendente de TCK. Por lo tanto, TMS debe configurarse antes del flanco ascendente de TCK. TMS
se evalúa en el flanco ascendente de TCK. Si no se requiere la interfaz JTAG en la placa,
el circuito JTAG se puede desactivar conectando este pin a VC C. Este

pin utiliza búferes de entrada de disparador Schmitt

TCK Entrada N/A La entrada de reloj al circuito BST. Algunas operaciones ocurren en el flanco ascendente,
mientras que otras ocurren en el flanco descendente. Si no se requiere la interfaz JTAG en
la placa, el circuito JTAG se puede desactivar conectando este pin a tierra. Este pin utiliza
búferes de entrada de disparador Schmitt

referenciado Este capítulo hace referencia a los siguientes documentos:

Documentos ■ AN 39: Prueba de exploración de límites IEEE 1149.1 (JTAG) en dispositivos Altera
■ AN 418: SRunner: una solución integrada para la programación de dispositivos de
configuración en serie
■ AN 423: Configuración del controlador de software serial pasivo de MicroBlaster
■ Guía del usuario del cable de descarga ByteBlaster II
■ Guía del usuario del cable de descarga ByteBlasterMV
■ Hoja de datos de la familia de FPGA Cyclone sección del dispositivo ciclón
Manual
■ DC y características de conmutación capítulo en el dispositivo ciclón
Manual
■ Depuración de diseños con SignalTap II Embedded Logic Analyzer
capítulo en el volumen 3 del Manual de Quartus II
■ Guía del usuario del cable de comunicaciones serie/USB MasterBlaster ■
Dispositivos de configuración serie (EPCS1, EPCS4, EPCS16, EPCS64 y
EPCS128) Hoja de datos
■ Configuración del software sección en el volumen 2 del Manual de configuración

13–50 Corporación Altera

Manual del dispositivo Cyclone, Volumen 1 mayo de 2008
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Configuración de FPGA Cyclone

Documento La Tabla 13–13 muestra el historial de revisión de este capítulo.

Revisión histórica

Tabla 13–13. Historial de revisión de documentos

Fecha y
Documento Cambios realizados Resumen de Cambios
Versión

—
mayo de 2008 Pequeños cambios textuales y de estilo. Se agregó la sección
v1.8 "Documentos de referencia" .

—
Enero 2007 v1.7 • Historial de revisión de documentos agregado.
• Se eliminó una nota de la Tabla 13–2.
• Figura 13–1 actualizada .
• Tabla 13–3 actualizada .
• Pies para nota actualizados en “Configuración serial activa (Serial
Dispositivos de configuración)” .
• Actualización de la nota footpara en la página 13–18.
• Nota actualizada (2) en la Figura 13–11.
• Nota actualizada (4) en la Figura 13–12.
• Nota actualizada (2) en la Figura 13–19.
—
julio de 2006 Figura 13–19 actualizada .
v1.6

—
Agosto de 2005 • Tablas actualizadas.
v1.5 • Actualizaciones menores de texto.

Marzo de 2005 —
• Figura 13–1 actualizada .
v1.4 • Figura 13–10 actualizada .
—
Febrero de 2005 Figura 13–13 actualizada .
v1.3

—
Agosto de 2004 • Secciones eliminadas: Programación de dispositivos de configuración,
v1.2 Conexión de la cadena JTAG, Serie pasiva y JTAG, Opciones de
dispositivos, Archivos de configuración de dispositivos, Fiabilidad de la
configuración y Sugerencias para el diseño de la placa.
• Figuras eliminadas: Diagrama de bloques del sistema incorporado,
Combinación de configuración PS y JTAG, cuadro de diálogo Opciones de
configuración.
• Tabla eliminada: Bits de opción de configuración de ciclón.
• Agregado: USB Blaster a la lista de cables; nueva Figura 13­13; texto en las
páginas 13­14, 13­29 y 13­30 e información en la tabla 13­6.

• Cambios en las Figuras 13–14 a 13–16, 13–19, 13–20, 13–25; los números
cambiaron en la fila EP1C4 de la tabla 13­3.
• Se agregaron descripciones detalladas de los métodos de configuración en
"Configuración de varios dispositivos con los mismos datos".
sección.

—
Julio de 2003 v1.1 Tamaños .rbf actualizados . Actualizaciones menores a lo largo del documento.
—
Mayo de 2003 v1.0 Documento agregado al Manual del dispositivo Cyclone.

Corporación Altera 13–51

mayo de 2008 Manual del dispositivo Cyclone, Volumen 1
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Historial de revisión de documentos

13–52 Corporación Altera

Manual del dispositivo Cyclone, Volumen 1 mayo de 2008