INFORME DE PRÁCTICA DE LABORATORIO Versión 1.

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PROGRAMA DE INGENIERÍA MECATRÓNICA
Periodo 2021-2

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Punta lógica
Fecha: 18 de agosto del 2021
Santos Andres, Tarazona Juan, y Mendoza Emerson
{est.andresf.santos, est.juan.tarazona, y
est.emerson.mendoza}@unimilitar.edu.co

Profesor: Puerto Jorge

Resumen— en esta práctica se abordará la investigación de un

funcionamiento razonable de una punta lógica, se implementara
la construcción de ella y se diferenciará en qué niveles se puede
encontrar en el circuito que se diseñará.
Rangos de niveles lógicos, tomado de Fundamentos de sistemas digitales[2].
Palabras clave— estados lógicos, led, niveles lógicos, corriente,
circuito, voltaje.
Punta lógica
“La punta lógica es un instrumento de medida que indica la
I. INTRODUCCIÓN
presencia de pulso alto, bajo, tren de pulsos o alta impedancia.
La finalidad de esta práctica es identificar el procedimiento de Esta, integra el equipo de medición básico para los circuitos
cada componente interno que tiene la punta lógica, el cual digitales.”[3], podemos encontrar que la punta lógica se
permite la detección de niveles lógicos presentados en convierte en uno de los instrumentos más útiles para el trabajo
circuitos con circuitos electrónicos, permitiendo encontrar errores y
A. Marco teórico fallas en estos.
“La punta lógica se alimenta de la misma fuente de tensión
Niveles lógicos del circuito bajo examen, conectándose el terminal cocodrilo
“Las tensiones empleadas para representar un 1 y un 0 se (-) a la masa y el Terminal cocodrilo (+) al positivo de 5
denominan niveles lógicos. En el caso ideal, un nivel de voltios. El funcionamiento es muy rudimentario y gira entorno
tensión representa un nivel ALTO y otro nivel de tensión a un transistor NPN que actúa como conmutador y tres
representa un nivel BAJO.” (Floyd, 2006). Además de esto, compuertas inversoras. Hay solo tres posibles estados que
Floyd[2] explica que si bien esto se puede considerar en un puedan hacer se presentes en la punta (marcada como Pta.).”[3]
circuito digital ideal, en un circuito digital real se presentan
factores que impiden el implemento de solo dos niveles de
tensión, uno para ALTO y otro para BAJO, para determinar II. DESARROLLO DE LA PRÁCTICA
estados lógicos en un sistema digital.
Inicialmente, se tiene en cuenta que todo parte de una fuente
Para dar solución a esto se emplean rangos de niveles
de 5 V. Para este desarrollo se sabe que el 1 (uno) lógico
lógicos; “La variable VH(máx) representa el valor máximo de
equivale al valor total de la fuente y el 0 (cero) lógico será 0 V
tensión para el nivel ALTO y VH(mín) representa el valor de
para la salida total.
tensión mínimo para el nivel ALTO. El valor máximo de
tensión para el nivel BAJO se representa mediante VL(máx) y
Para un buen desarrollo se tiene en cuenta que se hace un
el valor mínimo de tensión para el nivel BAJO mediante
análisis de mallas para definir las entradas en los
VL(mín). Los valores de tensión comprendidos entre VL(máx)
comparadores (hechos a partir de circuitos operacionales), que
y VH(mín) no son aceptables para un funcionamiento
posteriormente llegarán a volverse un 1 (uno) lógico o un 0
correcto.” (Floyd, 2006). En su texto[2], Floyd ejemplifica que
(cero) lógico.
en los circuitos digitales CMOS, el valor voltaje que
determina un nivel lógico ALTO se encuentra entre 2,5V y
Así mismo, se tiene en cuenta que los valores de resistencia
3,3V, y los que determinan un nivel lógico BAJO se
a comparar, para una mayor perfección del sistema, serán de 2
comprenden entre 0V y 0,8V, dejando los voltajes de entre
V con un valor de voltaje V2 y 0.8 V con el mismo V2. El
0,8V y 2,5V como inaceptables. En la siguiente figura se
valor V2 será importante debido a que este define si la salida,
ilustra el rango general de niveles lógicos:
luego de comparar valores, será un 1 (uno) lógico o un 0
(cero) lógico.

De esta forma, se tendría la siguiente malla a analizar:

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El presente documento corresponde a un informe de práctica de laboratorio

de Digitales presentado en la Universidad Militar Nueva Granada durante el
periodo 2021-2.
 INFORME DE PRÁCTICA DE LABORATORIO
Ilustración 1. Análisis en mallas.
Se necesitan 2 V entre R1 y R2. Para esto, se le debe reducir
3 V al voltaje (V1) y, a su vez, se hace uso la ley de ohm,
teniendo en cuenta que se toma R1 = 1 kΩ:
Esta corriente de 0.003 A (3 mA), se usa para hallar el valor
coherente de R2 y R3. Para el punto entre R2 y R3 se necesita
una salida de 0.8 V, para ello, se le resta 1.2 V a los 2 V en el
punto intermedio entre R1 y R2. Con ayuda de la ley de Ohm
queda tal que:
Por último, el valor de salida luego de R3 debe de ser 0 V,
por ende, se le restan los 0.8 V anteriores y se usa la corriente
inicial de 3 mA.
III. SIMULACIONES
Inicialmente se tiene el circuito con sus salidas de voltajes
apropiadas, como fue explicado anteriormente.
Versión 1.0
PROGRAMA DE INGENIERÍA MECATRÓNICA
Periodo 2021-2
Todo sale de una única fuente de voltaje llamada V1 con
valor a 5 V. Como fue mencionado anteriormente, se usan las
3 resistencias para dividir el voltaje de la forma necesaria.
Estas resistencias se usan en serie y con salidas intermedias de
voltaje como se muestra en la ilustración 2.
Los valores de las resistencias son expuestos en las
ecuaciones anteriormente hechas. En resumen, R1 = 1 kΩ,
R2 = 400 Ω y R3 = 266.67 Ω.
Ilustración 2. Voltajes iniciales
Posteriormente se usa el concepto de comparador a partir de
los amplificadores operacionales. Este concepto parte desde el
hecho de que cuando un voltaje en la entrada no inversora (+)
es mayor que el voltaje de la entrada inversora (-), el
comparador deja pasar el voltaje entrante por la saturación
positiva del opamp. Para este caso la saturación positiva es
equivalente al 1 (uno) lógico mencionado anteriormente, para
este caso, 5 V.
En caso de que la entrada no inversora (+) sea menor que el
voltaje entrante por la inversora (-), su salida equivale al 0
(cero) lógico, para este caso, es el valor a tierra. [1]
Además de tener los comparadores, continúan con un buffer
para evitar que haya fluctuaciones en la salida del opamp.
Todo lo anteriormente mencionado está mostrado en la
ilustración 3.
Ilustración 3. Comparadores con buffers.
 INFORME DE PRÁCTICA DE LABORATORIO Versión 1.0
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Periodo 2021-2

Por último, continuando en el circuito, se agregan unos leds IV. CONCLUSIONES

indicadores de sí el circuito está en funcionamiento o no. Los
leds están nombrados por D1, D2 y D3. 1. Es importante adquirir conocimientos previos en cuanto a
compuertas lógicas para determinar los valores que se
El led D1 está antecedido por el comparador entre 2 V obtendrán en la salida.
(entrada inversora) y 0.7 V (entrada no inversora). Dado el
caso de que 2 V > 0.7 V, entonces, el voltaje que entra al led 2. La punta lógica es una herramienta bastante importante en
D1 será equivalente a tierra, mejor llamado en este caso, 0 cuanto a determinar el estado lógico de un circuito, por ello se
(cero) lógico. puede determinar si cuenta con un estado bajo, alta
impedancia o alto.
El led D2 tiene una entrada de voltaje proveniente de
comparar 0.8 V (entrada no inversora) con 0.7 V (entrada 3. Se puede comprobar que los niveles lógicos que trabajan
inversora). Dado que 0.7 V < 0.8 V, la salida equivale al 1 con distintas medidas de voltaje permiten distinguir entre los
(uno) lógico, en este caso, 5 V. rasgos que serán utilizados en una operación de la manera
adecuada en el funcionamiento del dispositivo
Y para el led D3, se usa una compuerta lógica XOR, la cuál
únicamente emite una señal cuando ambas entradas son 0 V. REFERENCIAS
(cero) lógico. Esto hace referencia a que el circuito se
[1] El Administrador, «Comparador con amplificador operacional»
encuentra en alta impedancia. Electrónica Unicrom. Recuperado de
https://unicrom.com/comparador-con-amplificador-operacional/
[2] Floyd, T. (2006). Fundamentos de sistemas digitales. Madrid:
Prentice-Hall.
[3] https://grisalazar.wordpress.com/2014/10/28/punta-logica/
[4] Youtube, canal Armando Lima.
https://www.youtube.com/watch?v=dvoCeVCFPmE&ab_channel=Arma
ndoLima .

Ilustración 4. Leds dando a entender el funcionamiento.

Para finalizar, se puede observar el circuito completo en la

ilustración 5, que es la unión de las anteriores ilustraciones.

Ilustración 5. Circuito completo.