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Parcial - Escenario 4
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10/4/2021 Parcial - Escenario 4: PRIMER BLOQUE-TEORICO - PRACTICO/SISTEMAS DIGITALES Y ENSAMBLADORES-[GRUPO B01]
Las compuertas lógicas permiten operaciones de tipo lógico utilizando datos digitales. Las
compuertas básicas son: NOT, AND y OR. Cada una de estas compuertas se puede
representar mediante una tabla de verdad. Luego de hacer algunas mediciones en su
circuito, usted se encuentra con la siguiente tabla de verdad:
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Se trata de una compuerta OR, ya que la salida se pone en ALTO cuando alguna de las 3
entradas está en ALTO.
Se trata de una compuerta AND, puesto que la salida sólo está en ALTO para todas las entradas
en ALTO.
Esta tabla de verdad representa una compuerta AND de 3 bits, pues sólo cuando las 3
entradas están activas, la salida se pone en nivel ALTO.
No es posible utlizar una compuerta AND, pues los datos tienen más de dos entradas.
Usted está diseñando un sistema para operaciones entre números booleanos de 4 bits. Sin
embargo, no está seguro de si el resultado que entrega su circuito es correcto.
Dados los números sin signo A: 1100 y B: 1001, el sistema debería retornar los valores:
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A = 12
B = 9
. Para la suma
12 + 9 = 21
, en binario es 10101
(16 + 4 + 1)
. Para la resta,
12 − 9 = 3
, en binario 0011
(2 + 1)
. Para la multiplicación
12 ∗ 9 = 108
, en binario 1101100
(64 + 32 + 8 + 4)
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En esta se puede ver la relación entre entradas y salidas, así como la realimentación de las
salidas en las entradas, que es posible en un circuito de este tipo.
Se está diseñando un sistema digital utilizando lógica combinacional, para lo cual le hacen
entrega de un listado de requerimientos. De acuerdo con el siguiente listado, ¿cuál de los
siguientes requerimientos no es realizable mediante lógica combinacional?
La información que hay en los diferentes puertos de entrada se deberá poder dirigir hacia un bus
de datos, seleccionando la dirección respectiva del puerto y un ENABLE.
La información dispuesta en el bus de datos se podrá direccionar hacia las diferentes tarjetas
internas del sistema digital.
Las compuertas NAND son reconocidas como compuertas universales. Como se puede ver
en la imagen, ellas permiten reemplazar cualquiera de las compuertas básicas, haciendo
más económica la fabricación de circuitos integrados (al usar un único tipo
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Un decodificador de 2 líneas a 4 líneas, que activa algunas de las salidas, según el código
binario en la entrada.
Al hacer la conversión de compuertas se puede verificar que cada salida se activa para
cada uno de los cuatro códigos binarios posibles en la entrada.
Una expresión “producto de sumas” (POS, product of sums) está conformada por varios
términos suma (suma booleana) de literales que se agrupan en un producto booleano. Dado
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el siguiente circuito:
M2
M5
, es decir
¯ ¯ ¯
Y = (A + B + C )(A + B + C )
Esta expresión se puede obtener directamente del circuito. Al existir una compuerta AND
antes de la salida del circuito, se puede decir que la última operación a realizar es un
producto. Más a la izquierda, se tienen dos compuertas OR que realizan la suma de los
términos
¯
A + B + C
¯ ¯
A + B + C
M2
M5
, es decir
¯ ¯ ¯
Y = ABC + A BC
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m2 , m3 , m4
m5
Todos los circuitos combinacionales vistos hasta ahora pueden ser representados mediante
sus tablas de verdad. De acuerdo con la siguiente tabla de verdad (A y B son entradas, Y1-
Y3 salidas):
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La siguiente expresión:
¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯
¯¯¯¯¯¯¯¯¯¯ ¯¯¯
¯
WX + Y
(W X + Y )
(W XY )
¯¯¯¯¯¯¯¯¯¯ ¯¯
¯¯¯
¯¯¯¯¯¯¯¯¯¯ ¯¯¯¯
(W X Y )
(W XY )
¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯
¯¯¯¯¯ ¯¯¯¯ ¯¯¯¯
W + X + Y
Muchos de los elementos que funcionan de manera “automática” en nuestro entorno están
conformados por circuitos lógicos. Ejemplo de ellos son los semáforos, los ascensores, el
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En un ascensor por ejemplo, cuando un usuario escoje uno de los pisos a los que desea ir,
es necesario convertir el botón ingresado a un código binario que la tarjeta de control pueda
reconocer. Esta es una tarea de:
La codificación convierte la señal del pulsador a un código binario particular, para que el
sistema reconozca qué botón se pulsó.
¯ ¯ ¯
Y = AB + AD + C D .
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Aunque ambas agrupaciones son opuestas (por un lado se agrupan 0s y por el otro 1s), la
expresión resultante será equivalente. Así, el circuito de la izquierda retorna un Producto
de Sumas dado por
¯ ¯ ¯
Y = (A + D )(A + C )(B + D )
¯ ¯ ¯
Y = AB + AD + C D .
¯ ¯ ¯
Y = (A + D )(A + C )(B + D).
¯ ¯ ¯
Y = A B + A D + C D.
¯ ¯ ¯
Y = A C + BC + AC
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¯
Y = A + BC + A.
Y = BC
¯ ¯ ¯
Y = (A + B + C ). (A + B + C )
La expresión completa es
¯ ¯ ¯ ¯ ¯ ¯ ¯ ¯ ¯
Y = A BC + A BC + A BC + ABC + ABC + ABC
El uso de la lógica booleana tiene aplicaciones más allá de los circuitos digitales, por ejemplo
cuando nos encontramos con situaciones que requieren la toma de decisiones y el uso de
condicionales.
Una mamá le dice a su hijo: “Vamos a comer postre, puedes escoger entre helado o brownie,
pero no puedes comer los dos al tiempo”. Obviamente no comer postre no es una opción en
este caso.
Si usted tuviera que trasladar esta situación a un circuito digital utilizando compuertas
lógicas, usaría:
Una compuerta NAND, pues la mamá le dice que no puede comer dos cosas a la vez.
Una compuerta OR, porque si el niño come un postre o el otro estaría cumpliendo con la
condición.
Una compuerta XNOR, que permite simluar la situación en la que se debe cumplir una o la otra
únicamente.
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Una compuerta XOR, pues es la que se activa únicamente cuando las dos entradas son
diferentes.
La compuerta XOR es la adecuada, pues tiene en cuenta que se puede solo una de las
dos opciones.
Se pueden representar en binario como: 101101 010110 000010 111111 y 101101 010110
000011 000000.
Lejanas, puesto que los números menos significativos 02FF y 0300 muestran que hay muchas
posiciones de separación entre los datos. Su longitud es de 64 bits.
Después del 02 FF sigue el número 03 00. Como los primeros dos bytes son iguales, las
direcciones son contiguas. Además, la longitud total del número es de 32 bits pues cada
dígito en hexadecimal se representa por 4 bits y hay 8 dígitos en total.
Los multiplexores, además de ser usados para la selección de datos, pueden funcionar como
generadores de funciones lógicas. Partiendo de una tabla de verdad, se seleccionan los
mintérminos y se ponen a un nivel de voltaje ALTO. Las demás entradas se ponen en bajo.
De esta manera, al poner en las entradas de selección la combinación adecuada, se puede
ver el resultado en la salida.
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Para el siguiente circuito (asumiendo que las entradas y salidas están numeradas de arriba
abajo):
Y0 está en 1 y Y1 está en 1.
Y0 está en 1 y Y1 está en 0.
Y0 está en 0 y Y1 está en 1.
El multiplexor tiene la entrada de selección en 10, por lo tanto se toma la tercera entrada
de arriba hacia abajo, que está en ALTO. Aunque Y0 está en 0 al no estar seleccionada en
el demultiplexor, el valor de Y1 es 1, precisamente porque es la que está seleccionada.
Y0 está en 0 y Y1 está en 0.
Con el fin de recibir un mensaje utilizando el método de paridad impar, se debe verificar si un
circuito digital está diseñado para funcionar con el protocolo del emisor. Usted tiene
conocimiento que el circuito implementado en el receptor es el siguiente:
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Sabiendo que la salida de ERROR se debe activar cuando haya un error en la paridad, usted
deberá entonces:
Cambiar la compuerta XNOR por una XOR, de tal manera que el bit de paridad no active la
salida de error.
El circuito está bien así como está montado, pues detecta la paridad impar.
Al invertir la salida con la compuerta XNOR, el circuito sirve para detectar paridad impar. Si
se quita la negación, detecta paridad par.
Un sistema de control cuenta con un sensor de temperatura que se utilizará para medir dicha
variable en el tiempo. La señal de los sensores es un valor de voltaje y tiene la siguiente
forma:
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De acuerdo con la información recibida por los sensores, es posible afirmar que:
Como la señal tiene un voltaje mayor a 1,5 voltios y menor a 5 voltios, es compatible con la
tecnología TTL.
La señal es digital, pero requiere que se baje su nivel entre 0 y 1 voltio para usarla como binario.
Mediante inversores, se obtiene el complemento a 2 y se suma con otro número, sin acarreo.
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Utilizando las diferentes reglas del álgebra booleana, se podría decir que la siguiente
expresión:
¯
(((W + W X) + W X) + W Z )
Se puede reducir a:
¯
(W XY + W Z )
¯
(W + Z )
(W + Z )
W + WX = W
W + WY = W
¯
W + WZ
¯
W + WZ = W + Z
(X + Y + Z )
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Los teoremas de De Morgan son utilizados para la simplificación de expresiones, donde una
operación de negación se aplica simultáneamente a dos operandos (bien sea que se estén
multiplicando o sumando).
La siguiente expresión:
¯¯¯¯¯¯¯¯¯¯ ¯¯¯
¯
(W X + Y )
Se puede simplificar a
¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯¯ ¯¯¯
¯
(W + X + Y )
¯¯¯
¯
(W X + Y )
Las puertas de un vagón de tren cuentan con sensores que permiten verificar si una persona
u objeto las obstruyen. Cada uno de estos sensores funcionan de la siguiente manera:
• Hay un emisor de luz infrarroja en un extremo y un receptor en el otro.
• Si el espacio está vacío, el receptor recibe la luz infrarroja que cruza de un extremo a otro y
se genera una señal en ALTO.
• Cuando algo interrumpe el paso de la luz, el sensor no la detecta y genera una señal en
BAJO.
Se desea que cuando el conductor del tren mande la señal para cerrar puertas, el sistema
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detecte si hay obstrucciones. De ser así, se activa una señal de alarma (Que requiere un
nivel ALTO para encenderse).
Utilizar una compuerta AND, que detecte cuando todas las señales estén en ALTO.
Usar la lógica de una XOR, para detectar que las diferentes puertas estén o no obstruidas.
Hacer el montaje con una compuerta NAND, para tener una salida en bajo si no hay
obstrucciones.
La compuerat NAND es adecuada, pues no sólo verifica que todos los sensores indiquen
la ausencia de obstrucciones, sino que su salida es un nivel BAJO cuando esto sucede, lo
cual no activaría la alarma.
Una expresión “suma de productos” (SOP, sum of products) está conformada por varios
términos productos (multiplicación booleana) de literales (variable afirmada o negada) que se
agrupan en una suma booleana. Dada la siguiente tabla de verdad:
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M0
M3
M5
M7
Y = C + B + AC + ABC
Y = m(1, 2, 5, 7) = m1 + m2 + m5 + m7
¯ ¯ ¯ ¯ ¯
Y = (A + B + C )(A + B + C )(A + B + C )(A + B + C )
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