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PRÁCTICA 3
APLICACIONES PRÁCTICAS DE CONTADORES Y DIVISORES DE
FRECUENCIA
1. Objetivos
2. Conceptos Básicos
a)
b)
Figura 1. a) Contador módulo 4. b) Señales de entrada y salida del contador módulo 4: clk,
clr, q[0] y q[1]. La frecuencia de q[0] es la mitad de la correspondiente a la señal clk. Lo
mismo ocurre con q[1] y q[0].
3. Descripción de la práctica
Se diseñará un reloj digital, el cual usará contadores como divisores de frecuencia y
acumuladores de cuenta. Los divisores de frecuencia dividen la frecuencia de entrada por
un factor determinado. Los acumuladores de cuenta cuentan pulsos de entrada y almacenan
el valor de la cuenta temporalmente. Los contadores se van a generar usando la
megafunción de altera lpm_counter (ver Anexo 1).
Generar el contador de segundos (ver Anexo 1). Adicionar el contador al diseño del reloj
digital conectando las entradas y salidas de acuerdo con la Figura 2. Simular
funcionalmente el contador de segundos (ver Anexo 2). Verificar que el contador de
segundos cuente de 0 a 59.
Figura 2. Circuito digital para generar el contador de segundos del reloj digital.
Generar el contador de minutos (ver Anexo 1). Adicionar el contador al diseño del reloj
digital conectando las entradas y salidas de acuerdo con la Figura 3. Simular
funcionalmente el contador de minutos y segundos (ver Anexo 2). Verificar que el contador
de minutos cuente de 0 a 59.
contmod60min
seg[5] NOT up counter
clock modulus 60
inst9
OUTPUT min[5..0]
q[5..0]
aclr
inst8
clr
Figura 3. Circuito digital para generar el contador de minutos del reloj digital.
3.3. Horas del reloj digital
4. Informe
5. Bibliografía
Anexo 1
Megafunción lpm_counter
Indicar el número de bits del contador, en este caso el contador va a ser de 6 bits.
Indicar el módulo del contador, en este caso el módulo es 60.
Seleccionar el Clear asincrónico del contador.
Dar click en Next y luego en Finish, y ya se tiene el primer contador.
lpm_counter0
up counter
clock modulus 60
q[5..0]
aclr
inst1
Anexo 2
Simulación funcional