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74LS76 TTL Flip Flop J K

Este documento describe un circuito integrado TTL 74LS76 que contiene dos flip flops JK. Proporciona información sobre la familia lógica, tipo, tensiones de alimentación, temperatura de funcionamiento, número de pines, frecuencia máxima y encapsulado. Explica que las entradas J y K controlan el grabado y borrado de las salidas Q, mientras que las entradas PRESET y CLEAR permiten fijar directamente los estados de salida.

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74LS76 TTL Flip Flop J K

Este documento describe un circuito integrado TTL 74LS76 que contiene dos flip flops JK. Proporciona información sobre la familia lógica, tipo, tensiones de alimentación, temperatura de funcionamiento, número de pines, frecuencia máxima y encapsulado. Explica que las entradas J y K controlan el grabado y borrado de las salidas Q, mientras que las entradas PRESET y CLEAR permiten fijar directamente los estados de salida.

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74LS76 TTL Flip Flop J K

Familia: LS
Tipo: Dual J-K Flip Flop
Tensión de alimentación mínima: 4.75 V
Tensión de alimentación máxima: 5.25 V
Rango temperatura de funcionamiento: 0 °C a +70 °C
16 pines
Numero de circuitos: 2
Frecuencia de reloj máxima: 30 MHz
Encapsulado: 16DIP
J: El grabado (set), puesta a 1 ó nivel alto de la salida
K: El borrado (reset), puesta a 0 ó nivel bajo de la salida
Si no se activa ninguna de las entradas, el biestable permanece en el
estado que poseía tras la última operación de borrado o grabado.
 PIN 1PR y PIN 2PR: La entrada PRESET (poner), que sirve para
poner directamente en el Flip-Flop JK un “1” en la salida Q
 PIN 11Q y PIN 15Q: salidas Q
 PIN 3CLR y PIN 8CLR: La entrada CLEAR (borrar), que sirve para
poner directamente en el Flip-Flop JK un “0” en la salida Q
 PIN 13GND: conexión a tierra
 PIN 5VCC: conexión a corriente

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