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30 85 1 PB
30 85 1 PB
RESUMEN
Actualmente el diseño de sistemas de generación y distribución de señal/es de reloj de alto desempeño (alta
frecuencia, skew, jitter y consumo de potencia reducidos) para sistemas en un Solo Chip (SoC), constituye una
importante área de investigación en el desarrollo de sistemas electrónicos. En este artículo se presenta un análisis de
las principales filosofías de diseño de redes de generación y distribución de señal de reloj actuales y futuras. Se
deriva que las redes no-resonantes en base a osciladores controlados por voltaje/corriente representan una alternativa
altamente atractiva para la sincronización de sistemas en un solo chip debido a su fácil diseño, alta regularidad, y
escalabilidad con la tecnología de fabricación.
Palabras clave: osciladores, osciladores controlados por voltaje, SoC.
4
Del PLL
Rama
(línea de
3
interconexión)
Árbol H
2
Rejilla
flip-flop
1
Buffer 1 2 3 4
Nodo
Onda de = = = =
voltaje +
- = = =
+ -
- + = = = =
- + = = =
+ - + = = = =
- - = = =
+ = = = =
(a) (b)
45 º
225º
0º 18 0º 2 70 º 90 º
(c)
13 5º
31 5º
Figura 2. Red de generación y distribución de reloj que utiliza el acoplamiento de osciladores de ondas viajeras.
Cd
Cd
Cd Línea de
Interconexión
Línea de Corto
Interconexión Circuito Compensadores
(a) (b)
Figura 3. (a) Generación de onda estacionaria, (b) Oscilador de onda estacionaria.
Oscilador de Onda
Esta ci onari a
Línea de Interconexi ón
Difere ncial
C ompensadores
C ompensador amarrado
por i nyección
Buffe r de R eloj
14 um
4 um 3.5 um
0.6 mm
1.8 mm
Figura 4. Red de generación y distribución de reloj con base en el acoplamiento de osciladores de onda estacionaria.
lt
C arga
I nductiva
lt Línea de
Interconexión
clk
clk
clk
clk
Compens adores
(a) (b)
Figura 5. Red de generación y distribución de reloj que emplea el acoplamiento de osciladores con carga inductiva.
Vout Voutx
Vctrl
Vpol
Linea de
interconexión
Figura 6. Red de generación y distribución de reloj que utiliza el acoplamiento de VCO’s LC.
Anillo
básic o
B D
B A B
Buffer
A
A C
C Inversor
F H
F D C D
E E G
Figura 7. Red de generación y distribución de reloj con base en la interconexión y el acoplamiento de osciladores de anillo.
4 mm 8 mm
(a) (b)
(c)
8.0
1500
6.0
OOV 1000
4.0
500
2.0
0.0 0
0.09 µm 0.18 µm 0.25 µm
Shibasaki O'Mahony Wood
Redes resonantes
100 320
90 90 nm 300
Longitud de compuerta (nm)
80 280
70 frecuencia
260
60 53 nm 240
fmax (GHz)
longitud
50 220
40 200
32 nm
30 22 nm 180
16 nm
20 160
10 140
11 nm
0 120
2000 2002 2004 2006 2008 2010 2012 2014 2016 2018
Año
Figura 10. Tendencia de la longitud de compuerta y fmax en tecnología CMOS 14.
18.0
16.0
Frecuencia de operación (GHz)
14.0 Tendencia
12.0
10.0
N=5
8.0 N=3
6.0 N = número de
etapas de retardo
4.0 N=2
2.0
N=2
0.0
0.09 µm 0.12 µm 0.18 µm 0.35 µm 0.50 µm
Rui Tao Yalcin Pacheco Shing
Osciladores de anillo
Fmax /
Fmin 2 10.5 1.14 2.08 1.26
Etapas 2 2 3 2 5