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Informe4 Digitales
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1 OBJETIVO.
3 PROCEDIMIENTO EXPERIMENTAL
Teóricamente
1.44
𝑓=
(15000Ω + 6600Ω) ∗ 0.01 ∗ 10−6 𝐹
Figure 4. Simulación circuito Figure 1
= 6666.66 𝐻𝑧
El periodo en un ciclo de onda es 11.5*20µs =
230µs 15000 + 3300
𝐷𝑢𝑡𝑦 𝐶𝑦𝑐𝑙𝑒 = ∗ 100 = 84.72%
1 15000 + 6600
La frecuencia es
230∗10−6 𝑠
= 4347.82 𝐻𝑧
𝐸𝑟𝑟𝑜𝑟 𝑓𝑟𝑒𝑐𝑢𝑒𝑛𝑐𝑖𝑎
6.2∗20∗10−6 𝑠
El Duty Cycle es 100 = 53.91 % |6578.94 − 6666.66|
230∗10−6 𝑠 = ∗ 100
c) Calcular teóricamente la frecuencia y el
6666.66
Dutycycle. = 1.31 %
1.44 |84.21 − 84.72|
𝑓= 𝐸𝑟𝑟𝑜𝑟 𝐷𝑢𝑡𝑦 𝐶 = ∗ 100
(3300Ω + 30000Ω) ∗ 0.01 ∗ 10−6 𝐹 84.72
= 4324.32 𝐻𝑧 = 1.89%
3300 + 15000 f) Diseñar un circuito con el 555 timer que tenga
𝐷𝑢𝑡𝑦 𝐶𝑦𝑐𝑙𝑒 = ∗ 100 = 54.95% una frecuencia de salida de 10KHz y un duty
3300 + 30000
d) Calcular el % de error cycle de 95%.
|4347.82 − 4324.32|
𝐸𝑟𝑟𝑜𝑟 𝑓𝑟𝑒𝑐𝑢𝑒𝑛𝑐𝑖𝑎 = ∗ 100
4324.32
= 0.54 %
Figure 6. Simulación de circuito de frecuencia de salida
de 10KHz y un duty cycle de 95%.
Figure 8. Ensamble del circuito de Figure 7
El periodo del ciclo de la onda es 102.53 µs
1
La frecuencia es = 9753.29 𝐻𝑧
102.53∗10−6 𝑠
97.70∗10−6 𝑠
El Duty Cycle es 100 = 95.28 %
102.53∗10−6 𝑠
C (µF) tTeórico
t Practico
R=100k t=1.1RC
1 0.110 0.104
10 1.1 1.1
100 11 11
Teórico Practico
C.T
Frecuencia mínima
Del circuito de la Figure 7, ¿Cuál es la finalidad
𝑇1 𝑡𝑒𝑜𝑟𝑖𝑐𝑜 = ln 2 ∗ (𝑅𝐴 + 𝑃𝑂𝑇) ∗ 𝐶 de poner el capacitor C2?
= ln 2 ∗ (390 + 1𝑀)Ω ∗ 10−6 𝑢𝐹 Este capacitor es el encargado de enviar el pulso
= 0.693𝑠 en forma de onda de sierra al C.I para que este último
𝑅𝐵 = 𝑅𝐴 , 𝑒𝑛𝑡𝑜𝑛𝑐𝑒𝑠 𝑇2 𝑡𝑒𝑜𝑟𝑖𝑐𝑜 = 𝑇1 𝑡𝑒𝑜𝑟𝑖𝑐𝑜 emita una señal de salida cuadrada. Al cambiar el
6 BIBLIOGRAFIA