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Electrónica Digital Circuitos Monoestables y Astables

Prof: Víctor Escartín

CIRCUITOS MONOESTABLES Y ASTABLES

Objetivos:
ƒ Conocer las características generales de los circuitos monoestables y astables
ƒ Conocer las características de los circuitos comerciales 555, y TTL

Sumario:
ƒ Definiciones
ƒ Circuito 555
ƒ Monoestables TTL
ƒ Astables TTL.
ƒ Problemas.

Bibliografía.
• Electrónica Digital, J. W. Bignell e R. L. Donovan, McGraw Hill, volume 2, 1995
• Electrónica Digital Princípios e Aplicações, A. P. Malvino y D. P. Leach, volume 2, 1988
• Manual TTL.

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CIRCUITOS MONOESTABLES Y ASTABLES

Introducción.

¿Qué es un Monoestable?
Es un circuito muy utilizado en los sistemas digitales, cuya característica fundamental es que tiene un solo estado estable y uno
semiestable (inestable), Para pasar del estado estable al inestable se necesita de una señal externa, permaneciendo un tiempo Tm en
este estado inestable. La duración de Tm se controla mediante una red RC. Se aplica para generar pulsos de duración controlada,
también se puede utilizar para generar demoras.

¿Qué es un Astable?
Es un circuito cuya característica general es que no tiene estado estable, tiene dos estados inestables entre los cuales se mantiene
oscilando, su aplicación fundamental es como oscilador.

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TEMPORIZADOR 555.

Introducción.
Temporizador muy utilizado ya que puede trabajar como monoestable y como astable. Se fabrica en dos versiones una con tecnología
bipolar y la otra CMOS.
Analicemos a continuación su esquema general.

Diagrama funcional.
VCC Reset

U5

2 1

U3
U1 R 2 Q
Thres 3 1
+
4
Cont -

R U6
OUT
2 1
U2 U4
U7 2 /Q
+
S 2 1
Trig 1 3
-
3
R4
R
Disch
Q2

Figura 1, diagrama funcional del temporizador 555.


Threshold Trigger Reset Out Discharge
Niveles de comparación: x x L L ON
Disparo (Trig) = 1 / 3 VCC >2/3VCC >1/3VCC H L ON
Umbral (Tresh) = 2 / 3 VCC <2/3VCC >1/3VCC H Stable Stable
x <1/3VCC H H OFF

Los voltajes de referencia anteriormente referidos en los comparadores se obtienen de un divisor resistivo con 3 resistores iguales. El
circuito esta formado por los dos comparadores (U1 y U2) ya mencionados y por un latch RS (U3 y U4). Si S = R = 0 la salida
mantiene su valor, Si suponemos que el circuito biestable RS tiene su salida Q = 0, la salida del circuito será V(Out) = VL y el
transistor Q1 estará cortado.
Para que el circuito funcione el terminal de reset debe estar en 1, de lo contrario la salida seria 0 y no cambia (es dominante). La
entrada Trig es dominante con respecto a Thres.
El terminal de control (Cont) se utiliza para cambiar los niveles de comparación, si no se utiliza se puede poner un condensador de 10
nf (valor típico) para filtrar ruido de alta frecuencia en caso de ser necesario.

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Operación como MONOESTABLE.

VCC

RA
4
R

Input 2 3 Output
TR Q
7
DIS
5 6
CV THR

C1 U6 C
LM555

Figura 2, esquema típico de conexión como monoestable.

El circuito se comporta según se muestra en la figura 3. Todo comienza al llegar una transición “negativa” por la entrada (Input). Este
voltaje debe ser < 1/3VCC. Esto provoca que la salida del comparador U2, o sea la entrada S del biestable vaya a 1 haciendo que Q =
1. Por lo que Vout = VH. Además el transistor Q1 se corta, permitiendo que el condensador comience a cargarse. Al llegar este ultimo
a 2/3VCC, el comparador U1, activa su salida, la cual es la entrada R del biestable lo que provoca que Vout = 0 y que el transistor Q1
conduzca.

V(TR)

2/3 VCC
VC

Vout

Figura 3, forma de onda asociada al 555 a partir de la llegada de un pulso por el terminal de disparo.

La respuesta de un monoestable 555 conectado como se indica en la figura 2, se simulo con el programa PSPICE para RA = 3 K y C
= 1 nF. En la siguiente figura se muestra las variaciones de las señales en el nodo de entrada, en el de salida y en el condensador
cuando es estimulado por un pulso según se muestra.
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6.0V

4.0V

2.0V

0V
0s 1.0us 2.0us 3.0us 4.0us 5.0us
V(U2:TRIGGER) V(U2:OUTPUT) V(R1:1)
Time

Figura 4, forma de onda.

Donde:
V(U2:Trigger); es el pulso utilizado para disparar al monoestable.
V(U2:Output); es la forma de onda a la salida del circuito
V(R1); es el voltaje en el condensador, el cual se va cargando hasta alcanzar 2/3VCC.

Análisis del estado inestable:


Este se inicia al aplicar un pulso (negativo) por el terminar 2. Este voltaje debe bajar por debajo de < 1/3 VCC por lo que S =1 y /Q =
0, el transistor se corta y Vout = VoH.
Este estado no puede durar indefinidamente ya que C se va cargando hasta 2/3 VCC en que R = 1 y /Q = 1, V(3) = 0 el transistor
conduce y se acaba el estado inestable.
Si antes de que termine el estado inestable se vuelve a disparar esto no afecta el comportamiento del circuito o sea que NO es
redisparable.
¿Que pasa si durante el estado inestable se activa el RESET? se retorna al estado estable ya que es una entrada dominante.

Calculo del tiempo que dura el estado inestable.


Para esto tenemos que analizar la carga del condensador C1 utilizando la ecuación general que describe la carga y descarga de un
condensador.
−T
Vc = Vf – (Vf – Vi) Exp
τ
Donde:
Vf = voltaje al cual tiende a cargarse o a descargarse el condensador.
Vi = voltaje inicial en el condensador
Vc = voltaje al cual cambian las condiciones del circuito.
T = tiempo para el cual el voltaje en el condensador es Vc.
τ = constante de tiempo asociada al condensador, se calcula como el valor de condensador por la resistencia equivalente que se ve
desde los terminales del condensador.

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Utilizando la ecuación anterior a este caso;


Valor
Vi VCE(sat) ≈ 0
Vf VCC
Vc 2/3 VCC
τ RA x C

(Vf − Vi)
T = τ ln
(Vf − Vc)

Sustituyendo

(Vcc − 0) (1)
T = τ ln = τ ln = τ ln (3)
(Vcc − 2 / 3Vcc) (1 − 2 / 3)

T = 1.1 τ

Para el ejemplo de la figura 4, el calculo teórico es: T = 1.1 x 3K x 1 nF = 3.3 uS y el resultado de la simulación también es 3.3 uS.

Para un correcto funcionamiento del circuito hay que garantizar que t(trigger) < τ. En el caso de que el ancho del pulso de disparo
sea mayor que el tiempo de salida del monoestable entonces se diferencia la señal de disparo. En la siguiente figura se muestra un
ejemplo de un circuito para disparar al monoestable. Hay que garantizar que C1 x R1 < que el ancho del pulso de disparo.

VCC

1k R1
D2
D1N914

C1
Vin Vout
1nf

La simulación del circuito anterior con PSPICE para R1 = 1KΩ y C = 1 nF y sin el diodo es la mostrada en la siguiente figura.

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10V

5V

0V
0s 5us 10us 15us 20us 25us 30us
V(V1:+) V(R1:1)
Time

En la figura anterior V1 = Vin y V(R1) = Vout, se puede observar como cuando el voltaje Vin esta en 5V la salida esta estable =
VCC = 5V. Cuando el pulso de entrada cambia a 0 y después a 1, en la salida aparece unos picos de voltaje. La transición negativa se
utiliza para disparar al monoestable. La transición positiva en la salida no provoca ningún efecto en el monoestable, pero el voltaje se
eleva por encima de VCC ( ≈ 8 V) y esto puede dañar al 555. Teóricamente este voltaje puede alcanzar hasta 2 VCC.

En la siguiente figura se muestra la simulación anterior incorporandole el diodo al circuito. Se puede observar la disminución del pico
de voltaje (no llega a 6 V) en la transición positiva de la señal de entrada (= VCC + VBE).

6.0V

4.0V

2.0V

0V
0s 5us 10us 15us 20us 25us 30us
V(V1:+) V(R1:1)
Time

Si la entrada de disparo demora más que el pulso de salida en el monoestable, entonces ocurre lo que se muestra en la siguiente figura:

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6.0V

4.0V

2.0V

0V
0s 4us 8us 12us 16us 20us
V(U2:TRIGGER) V(U2:OUTPUT) V(R1:1)
Time

O sea que se activa al mismo tiempo las entradas S y R en el biestable, El resultado es el mostrado en la figura anterior, la salida Q = 1,
Vout = UNO y el transistor de discharge no se activa por lo que el monoestable no retorna a su estado estable. Observe que en esta
situación Q = /Q = 0

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Operación como ASTABLE.

VCC

RA
U6
LM555
4
R

2 3 Output
TR Q
7
DIS
5 6
CV THR
RB

C1

Figura 5, esquema típico de conexión como astable.

El comportamiento del circuito se muestra en la siguiente figura.

2/3 VCC
VC

1/3 VCC

Vout

Análisis:
Para la carga del condensador
Valor
Vi 1/3 VCC
Vf VCC
Vc 2/3 VCC
τ1 (RA + RB ) x C

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(Vf − Vi)
T1 = τ ln
(Vf − Vc)

Sustituyendo obtenemos:

T1 = τ1 ln [2] = 0.69 τ1

Para la descarga del condensador:

Valor
Vi 2/3 VCC
Vf VCE(sat) ≈ 0
Vc 1/3 VCC
τ2 (RB ) x C

(Vf − Vi )
T2 = τ ln
(Vf − Vc)

Sustituyendo obtenemos:

T2 = τ2 ln[2] = 0.69 τ2

T = T1 + T2 = 0.69 C (RA + 2 RB)

RA
+1
Pulso T1 RA + RB RB
Duty Cycle = = = =
Período T 1 + T 2 Ra + 2 RB RA
+2
RB
RA
Si la expresión anterior la analizamos para Æ 0, el Duty Cycle Æ 0.5
RB
RA
Y para Æ ∞, el Duty Cycle tiende a 1.
RB
Resumiendo 0.5 < Duty Cycle < 1

En la siguiente figura se muestra la simulación en PSPICE del astable de la figura 4 con RA = 10KΩ, RB = 100KΩ y C = 100 pF

6.0V

4.0V

2.0V

0V
20us 30us 40us 50us 60us
V(U1:THRESHOLD) V(U1:OUTPUT)
Time

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En el ejemplo anterior:
TH = 0.69 x 100 pF x ( 10K + 100K) = 7.59 uS
TL = 0.69 x 100 pF x 100K = 6.9 uS

Si se quiere producir una onda cuadrada, una variante es hacer que RA << RB otra variante es utilizar el circuito de la siguiente figura.

VCC

RA
U6
LM555
4
R

2 3 Output
TR Q
7
DIS
5 6
CV THR
RB D2

C1

D1

Figura 6, esquema típico de conexión como astable para generar una onda cuadrada.

En el circuito anterior hay que garantizar que RA = RB = R y que R >> Rd (resistencia del diodo cuando conduce).

T = 0.69 (RA + RB) C

Si RA = RB = R entonces T = 2 x 0.69 R C = 1.38 RC

Versión Bipolar Isink = Isource = 200 mA

Versión CMOS Isink = 10 mA Isorce = 100 mA.

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Otra variante para lograr un ciclo útil del 50 % es el siguiente circuito :


VCC

U6
LM555

4
R
2 3 Output
TR Q
7
DIS
5 6 R
CV THR

C1

Análisis, considerando que R >:que la resistencia de salida del 555.


Para la carga del condensador
Valor
Vi 1/3 VCC
Vf VCC-Vbe
Vc 2/3 VCC
τ1 RxC

(Vf − Vi )
T1 = τ ln
(Vf − Vc)
Sustituyendo obtenemos:

(2 − 3 * Vbe / VCCi )
T1 = R x C ln
(1 − 3 * Vbe / VCC )

Para la descarga del condensador:


Valor
Vi 2/3 VCC
Vf Vce
Vc 1/3 VCC
τ2 R xC

(2 − 3 * Vce / VCC )
T2 = R x C Ln
(1 − 3 * Vce / VCC )

Si Vbe = 0 y Vce = 0, entonces T = T1 + T2 = 1.4 R x C

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Efectos Secundarios.
Analicemos ahora como se modifican las ecuaciones vistas anteriormente para el caso de un astable si tomamos en cuenta la demora
de las entradas de threshold y trigger. Estas demoras se añaden directamente al período. El valor de la resistencia ON del transistor
también se tomará en cuenta.

Figura 7 forma de onda como oscilador.

Figura 8, expresiones del Tiempo en uno (tH) y del tiempo en cero (tL), tomando en cuenta factores de 2do orden como las demoras
internas y la resistencia ON del transistor de descarga.

Parámetros del circuito 555 de varios fabricantes.

Parámetro Característica LM555 KA555 NE555 ICM7555* TLC555* Unidades


* *
Fabricante NS Fairchild Philips Harris Texas S/C
Trigger Current Máxima 0.9 2 2 0.05 0.005 uA
Threshold Current Máxima 0.25 0.25 0.25 0.05 0.005 uA
Frecuencia Máxima 0.5 1 2 MHz
Drift temperatura 150 (tip) 150 (tip) 500 (max) 150 (tip) PPM / °C
Drift VCC 0.3 0.3 0.3 0.5 %/V
VOL* Máxima 0.35 0.35 0.35 0.4 0.45 V
IOL* Máxima 5 5 5 3.2 5 mA
VOH* Máxima 2.75 3 4 4.1 V
IOH* Máxima 100 100 0.8 1 mA
(RA + RB)* Máxima 20 6.7 3.4 MΩ

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* = VCC = 5 V
** = versión CMOS

MONOESTABLE TTL (74x-123-423-221)

Analizaremos unos circuitos integrados monoestables con tecnología TTL.


1) Circuito Monoestable 74123 y 74x423.
Circuito integrado con dos Monoestable redisparables.

Cext Rext / Cext

Cext

Rext_Cext
B In Q Q

R
/Q /Q
CLR

Figura 9, circuito lógico equivalente del 74x123

La diferencia entre el 123 y el 423 es que este ultimo no se dispara con el CLR.
A B CLEAR Q
x x L L
H x H L
x L H L
L ↑ H ∏
↓ H H ∏
L H ↑ ∏
Tabla de verdad del 74x123

A B CLEAR Q
x x L L
H x H L
x L H L
L ↑ H ∏
↓ H H ∏
Tabla de verdad del 74x423

Para Cext ≤ 1000pF se debe utilizar un gráfico que ofrece el fabricante del circuito para calcular el ancho del pulso. Para Cext ≥
100pF se calcula en base:
Tw = K Cext Rt
Donde K ≈ 0.45.

Parámetro Característica LS HC HCT Unidades


R Mínima 5 10 10 KΩ
R Máximo 260 100 100 KΩ
C Mínima
C Máxima
Input leakage Máxima 100 1 1 uA
Ancho del pulso Minimo 40 ns

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2) Monoestable 74x221
Circuito integrado con dos Monoestable NO redisparables.
Cext Rext / Cext

A 2 1

Cext

Rext_Cext
2
1 Q
3 In Q
B
R
/Q /Q
CLR

Figura 10, circuito lógico equivalente del 74x221

A B CLEAR Q
x x L L
H x H L
x L H L
L ↑ H ∏
↓ H H ∏
L H ↑ ∏

Tabla de verdad del 74x221

Resumen de algunos parámetros.

Parámetro Característica LS HC HCT Unidades


R Mínima 1.4 10 10 KΩ
R Máximo 100 1000 1000 KΩ
C Mínima
C Máxima 1000 1000 uF
Input leakage Máxima 100 uA
Ancho del pulso Mínimo 20 ns

TW = K Rext Cext
K = 0.7, valor típico.

Familias que fabrican estos monoestables

LS HC HCT
4047 monoestable, astable 221 x x x
4098 redisparable dual monoestable 123 x x x
4528 dual redisparable monoestable 423 x x x
4538 dual monoestable 4538 x x

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Modulo oscilador con cristal


∆f
Estabilidad de la frecuencia = ±25 a ±50 ppm
fo
Rango de frecuencia entre 1.8 MHZ a 66 MHz
Envejecimiento: ± 5 ppm por año (Max.)

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