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Amplificadores de potencia
1)Introduccin
Hasta el momento se analizaron amplificadores de bajo nivel y la condicin para tal estudio
fue admitir que la tensin base emisor es muy pequea (comparada con la tensin trmica).
Esta suposicin implicaba la aproximacin a un modelo lineal del transistor en alterna, el
cual permite determinar los parmetros tiles en un amplificador. Sin embargo, al trabajar
con amplificadores de potencia, no podremos, en general, admitir como vlida la hiptesis
anterior, por lo que el modelo lineal no ser, estrictamente hablando, vlido para los
amplificadores de potencia.
Desde otro punto de vista, vimos las posibles formas de operar de un amplificador segn la
polarizacin del transistor, lo que entendemos por clase del amplificador. Vimos en aquel
momento que se los clasificaba en clase A, B, AB y C.
2) Amplificador clase A
2.1) Colector comn
En este tipo de aplicacin el transistor est polarizado en el punto Q, es decir pasar por el
colector del transistor una corriente continua permanente. En general, la corriente de polari-
zacin se logra a travs de una fuente de corriente. Un esquema tpico podra ser el indicado
en la fig.1.
Interesa obtener la caracterstica de transferencia de la etapa para analizar si presenta alinea-
lidades. Dicha caracterstica define la relacin entre la tensin de salida y la de entrada (Vo
= f(Vi)). Para determinarla recorramos la malla de entrada, observndose que Vi - Vbe - Vo
= 0, por lo tanto Vo = Vi - Vbe, por lo tanto cuando Vi = 0 deber cumplirse que Vo = -
Vbe y tambin si Vo = 0, Vi = Vbe. Como la salida sigue a la entrada, se tratar de una
recta aproximadamente a 45.
El tema que queda por investigar antes de trazar la curva es qu lmites tendr esa recta.
En el semiciclo positivo, la tensin de salida slo podr alcanzar un valor tal que asegure
que el transistor est en modo activo directo (MAD), por lo tanto, el lmite ser la satura-
cin de T1.Admitiendo que la tensin colector emisor cuando el TBJ est en modo de satu-
racin (MS), es Vce(sat) = 0.2 V, podemos establecer que la mxima tensin de salida sin
recorte por saturacin es Vo(mx) = Vcc-Vce(sat). por otra parte, en el semiciclo negativo,
pueden producirse dos fenmenos a saber: por un lado, puede saturarse el T2 de la fuente de
corriente, con lo cual, mediante un anlisis similar al anterior se llega a que Vo(mn) = -
Vcc + Vce(sat). Por otra parte, puede ser que cuando se esta en la cresta del semiciclo
negativo, la corriente en la carga puede alcanzar el valor de la corriente de polarizacin
fijada por la fuente Icq. En tal circunstancia, el T1 pasar a estar en modo de corte (MC).
Para este caso Vo(mn) = - Icq RL. Deberamos entonces tener en cuenta ambas
posibilidades y adoptar como valor mximo posible de tensin de salida la menor de las dos
como hemos hecho siempre. En virtud de las consideraciones anteriores podemos dibujar la
caracterstica de transferencia que es la que podemos observar en la fig. 2
VCC
Q3 ic
R1
Vg
io
Q4
0 Q2
RL
Iq
VEE
Fig.1
2.1.1)Balance de potencias
Mediante la aplicacin del principio de conservacin de la energa podemos afirmar que la
potencia entregada por las fuentes debe ser igual a la suma de la potencia til en la carga
ms la potencia que se disipa en los dispositivos de salida. Matemticamente expresaremos
Ps = Pd + PL, donde Ps es la potencia entregada por las fuentes, Pd es la potencia disipada
en los dispositivos de salida y PL es la potencia til desarrollada en la resistencia de carga.
Analicemos ahora por separado cada trmino. El valor medio de la corriente que entrega
cada fuente es la corriente de polarizacin definida por la fuente de corriente, es decir Icq.
Por lo tanto Ps = 2 Vcc Icq
Por su parte, la potencia entregada a la carga la podemos determinar, considerando una
onda senoidal cuyo valor pico sea el valor mximo admisible sin recorte, determinado como
analizamos anteriormente multiplicando los valores eficaces de tensin y corriente, es decir
PL = Vo(rms) Io(rms) = (Vomx Iomx )/2
Finalmente, la potencia disipada por los dispositivos de salida la podemos obtener mediante
la diferencia entre la entregada por las fuentes y la til en la carga. Mediante este anlisis se
observa que si no tenemos efecto til en la carga, es decir sin seal, la potencia disipada en
los transistores ser mxima, es decir Consume ms cuando no obtenemos efecto til !
Esta caracterstica es tpica de las etapas clase A y hace que esta configuracin tenga un
comportamiento deficitario desde el punto de vista de la potencia (esperaramos que los
TBJ disiparan ms cuanto ms potencia entregaran).
Para poder medir y comparar el balance de potencias entre las distintas etapas, se define el
concepto de rendimiento del mismo modo que se lo hace para el caso de las mquinas,
como la relacin entre la potencia til en la carga y la potencia consumida (entregada por
las fuentes). En forma analtica podemos escribir = PL/Ps. Queda claro que el rendimiento
estar comprendido entre 0 y 1, aunque desde el punto de vista prctico, est claro que un
sistema con rendimiento nulo carece de sentido y, por otra parte tampoco podr alcanzarse
el valor unitario, en virtud que para lograr un efecto til habr siempre una prdida de po-
tencia. Resumiendo 0< <1.
Interesa pues determinar el rendimiento mximo que puede alcanzar una etapa de salida
clase A. Reemplazando en la definicin queda = (Vomx Iomx)/2(2Vcc Icq). Es intere-
sante conocer el valor mximo de ese rendimiento para cada clase de amplificador. Por lo
tanto deberemos conocer la condicin para obtener la mxima potencia en la carga, ya que
para igual corriente de polarizacin, garantizar mximo rendimiento. Para obtener la
condicin de mxima potencia en la carga, realizaremos el sig. anlisis grfico.
Para entender el grfico anterior hay que determinar previamente la ecuacin de la recta de
carga; para ello analizamos la malla de salida que involucra a T1.
VCC - iO RL - vCE = 0 Por otra parte, aplicando una ecuacin de nodos al nodo de RL,
queda: iC = iO + IQ, por lo tanto iO = iC - IQ. Reemplazando esta ltima ec. en la primera
resulta VCC - (iC - IQ) RL - vCE = 0
VCC - iC RL + IQ RL - vCE = 0 Finalmente, operando se llega a
iC = - vCE / RL + VCC / RL +IQ, que es la ec. de la recta de carga dinmica para esta
etapa amplificadora. Establezcamos la ordenada y la abscisa al origen.
iC (0) = 0 + VCC / RL + IQ
vCE (0) = VCC + IQ RL. Por otra parte, tambin es interesante saber cunto vale la ten-
sin de polarizacin IQ = -VCEQ / RL + VCC / RL + IQ, por lo tanto VCEQ = VCC,
hecho previsible desde lo conceptual, en virtud que si iC = IQ es porque iO = 0, en conse-
cuencia
vO = 0 y vCE = VCC.
Luego de esta disgresin entremos de lleno en el anlisis grfico. Se observan tres rectas de
carga, las cuales, es evidente, tienen pendientes distintas y, consecuentemente corresponden
a resistencias de carga distintas. Recordando que PL = (Vomx Iomx)/2 observamos que
las reas rayadas de los tringulos indicados representan las potencias en la carga para cada
recta. Vemos que para la recta "2" esta rea es mxima, lo que significa que existir una
resistencia de carga ptima, para la cual el rendimiento y la potencia de salida sern mxi-
mos. Por otra parte la recta "1" corresponde a RL < RLptima y la recta "3" a RL >
RLptima. Como aclaracin recordamos algo obvio, pero que no est de ms: el rea del
tringulo es b h /2 y de aqu surge que las reas de los tringulos formados representan las
potencias tiles en las respectivas resistencias de carga.
Debemos reconocer tambin que est claro que la resistencia ptima y la mxima potencia
til se verifican en lo que conocemos como condicin de mxima excursin simtrica
(MES), es decir cuando la mxima tensin por corte y por saturacin coinciden. Cunto
valdr entonces la resistencia de carga para tal condicin? Simplemente analicemos la pen-
diente de la recta ptima. Como sabemos, la pendiente de la recta de carga es la recproca
de la resistencia de carga, de modo que 1 / RL = IQ / VCC y finalmente RLptima = VCC
/ IQ
Analizado esto, podemos determinar el valor del rendimiento mximo de esta etapa.
PL = (Vomx Iomx) / 2 = Vomx Vomx / 2 RL, pero Vomx = VCC, despreciando la
tensin de saturacin del TBJ, queda
= (Vomx Iomx)/2(2Vcc Icq) = (VCC VCC) / 2 RL 1/ 2 VCC VCC/RL = 1/4
=25 %, es decir que el rendimiento mximo de la etapa clase A no superar el 25 %, es
decir que el 75 % de la potencia se disipar en forma de calor en los transistores, por lo cual
es, como habamos anticipado una etapa de bajo rendimiento.
2.1.2) Mxima potencia disipada
Como expliqu anteriormente, en ausencia de seal. es decir sin efecto til en la carga, la
potencia disipada ser mxima, por lo tanto Pdmx = Ps. Por supuesto que para cada TBJ
debemos considerar la mitad de este valor, el cual deber ser tenido en cuenta para el
clculo del disipador.
IQ
Q3 Q2
iO
RL
Q1
R1
iC
0
Vg VEE
exponencial
Q1
io
Vg
Q2
0
RL
-VCC 0
4) Etapa clase AB
Vimos cuando analizamos la caracterstica de transferencia de la etapa clase B que apareca
una zona en la cual los diodos no conducen, lo cual se traduca en la distorsin por cruce.
Para resolver el problema, es necesario llevar a los transistores a un valor de polarizacin
del orden de los 0.6 V para que exista una pequea corriente de manera que no entren
estrictamente en MC y conduzca corriente a la carga para bajos niveles en la tensin de
entrada. Esto puede lograrse fcilmente colocando dos diodos en serie entre las bases de
ambos TBJ como se observa en la fig.sig.
VCC
Q1
io
Vg D1
D2
0
Q2 RL
-VCC 0
Por supuesto, a los diodos hay que polarizarlos a travs de una resistencia o fuente de co-
rriente.
La caracterstica de transferencia ser la sig.
Analizando el circuito queda claro que Vi + 2 Vbe = Vo. Cuando Vo = 0, deber cumplirse
que Vi = - Vbe. Por otra parte, si Vi = 0, entonces Vo = Vbe. Por lo tanto podemos dibujar
la caracterstica:
Por supuesto, hay que tener e cuenta en cuanto al recorte de la seal si no existe una limita-
cin tambin por falta de corriente en el hemiciclo positivo. Se observa adems que ha
desaparecido la zona de distorsin por cruce. Por esta razn es que se trata de la etapa ms
usada.
Adems debemos aclarar que si bien la forma ms econmica de obtener la prepolarizacin
es mediante los diodos, tambin suelen usarse mtodos ms caros, pero tambin ms efecti-
vos como por ejemplo el llamado multiplicador de Vbe.. El circuito completo es el dibujado
a continuacin y lo podemos analizar del sig. modo. Para el TBJ central se puede plantear el
divisor de tensin de base Vbe = Vce R2 / (R1+R2) de donde podemos despejar el valor de
Vce que representa la tensin de polarizacin de los transistores. Vce = Vbe (R1 / R2 +1).
Vemos que poniendo un potencimetro como divisor de base fcilmente podemos obtener
la tensin justa para prepolarizar a los TBJ. En general se ajusta el potencimetro de base
para obtener una cierta corriente de algunos miliampere o si disponemos de algn
instrumental usando un osciloscopio para verificar cuando desaparece la distorsin por
cruce.
A
R1
Q1
R2
Vo
5) Sistemas de proteccin
Si por alguna falla, se pone en cortocircuito la salida, es posible que se supere la mxima
corriente que el TBJ es capaz de soportar. por lo tanto, los buenos amplificadores tienen
algn circuito adicional de proteccin. Uno de los ms comunes es el dibujado a continua-
cin. EL funcionamiento es sencillo. Cuando la corriente de salida es tal que hace caer 0,6
V en la resistencia Rm, entonces comenzar a conducir el T2 de manera que el colector de
este ltimo tomar corriente de la base de T1, restndole a este ltimo posibilidad de
conducir, con lo cual evitar su destruccin. Algo similar ocurre podra ocurrir con el
transistor PNP. Habr simplemente que elegir el valor de Rm de forma tal que cuando la
corriente de salida llegue al valor mximo, la cada en dicha resistencia alcance la tensin
de encendido del transistor de salida.
VCC
R3
Q1
Q2
D1 R1
R2
R4
D2
Q3
0
Q4
Vg BC546B
0 -VCC
6) Etapa cuasicomplementaria
Puede construirse una etapa de salida con transistores Darlington, lo cual aumenta la
capacidad de manejo de corriente del dispositivo como vimos en su momento. Adems es
fcilmente obtenible un Darlington de tipo PNP con un transistor NPN, lo cual mejora la
capacidad de entregar corriente, ya que la movilidad de los electrones es mayor que la de
los huecos.
VCC
D3
Q7 Q2
R3 Q3
1k D1
0
D2
Q4
Q5
Q6
Vg
-VCC
0