15/5/2016

BiestableWikipedia,laenciclopedialibre

Biestable
DeWikipedia,laenciclopedialibre
Un biestable (flipflop en ingls), es un multivibrador capaz de
permanecer en uno de dos estados posibles durante un tiempo
indefinido en ausencia de perturbaciones.1 Esta caracterstica es
ampliamente utilizada en electrnica digital para memorizar
informacin. El paso de un estado a otro se realiza variando sus
entradas.Dependiendodeltipodedichasentradaslosbiestablesse
dividenen:
Asncronos: solamente tienen entradas de control. El ms
empleadoeselbiestableRS.
Sncronos: adems de las entradas de control posee una
entradadesincronismoodereloj.
Si las entradas de control dependen de la de sincronismo se
denominansncronasyencasocontrarioasncronas.Porlogeneral,
lasentradasdecontrolasncronasprevalecensobrelassncronas.

R1,R2=1k
R3,R4=10k

Laentradadesincronismopuedeseractivadapornivel(altoobajo)oporflanco(desubidaodebajada).
DentrodelosbiestablessncronosactivadospornivelestnlostiposRSyD,ydentrodelosactivospor
flancoslostiposJK,TyD.
Los biestables sncronos activos por flanco (flipflop) se crearon para eliminar las deficiencias de los
latches(biestablesasncronososincronizadospornivel).

ndice
1 BiestableRS
1.1 BiestableRS(SetReset)asncrono
1.2 BiestableRS(SetReset)sncrono
2 BiestableD(DataoDelay)
3 BiestableT(Toggle)
4 BiestableJK
4.1 BiestableJKactivoporflanco
4.2 BiestableJKMaestroEsclavo
5 Ejemploconcomponentesdiscretos
6 Aplicacin
7 Secuenciacinymetaestabilidad
8 Vasetambin
9 Referencias

BiestableRS
https://es.wikipedia.org/wiki/Biestable

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Descripcin
Dispositivodealmacenamientotemporalde2estados(altoybajo),
cuyasentradasprincipalespermitenalseractivadas:
R: el borrado (reset en ingls), puesta a 0 nivel bajo de la
salida.
S: el grabado (set en ingls), puesta a 1 nivel alto de la
salida
Sinoseactivaningunadelasentradas,elbiestablepermaneceenel
estadoqueposeatraslaltimaoperacindeborradoograbado.En
ningncasodeberanactivarseambasentradasalavez,yaqueesto
provoca que las salidas directa (Q) y negada (Q') queden con el
mismovalor:abajo,sielflipflopestconstruidoconpuertasNOR,
CronogramadelbiestableRS.
oaalto,siestconstruidoconpuertasNAND.Elproblemadeque
ambas salidas queden al mismo estado est en que al desactivar
ambas entradas no se podr determinar el estado en el que quedara la salida. Por eso, en las tablas de
verdad,laactivacindeambasentradassecontemplacomocasonodeseado(N.D.).

BiestableRS(SetReset)asncrono
SloposeelasentradasRyS.SecomponeinternamentededospuertaslgicasNANDoNOR,segnse
muestraenlasiguientefigura:

BiestablesRSconpuertasNOR(a),NAND(c)ysussmbolosnormalizadosrespectivos(b)y(d).

TabladeverdadbiestableRS
R

Q(NOR)

Q(NAND)

N.D.

N.D.

https://es.wikipedia.org/wiki/Biestable

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N.D.

N.D.=Estadonodeseadoq=Estadodememoria

BiestableRS(SetReset)sncrono
Adems de las entradas R y S, posee
una entrada C de sincronismo cuya
misin es la de permitir o no el
cambiodeestadodelbiestable.Enla
siguiente figura se muestra un
ejemplo de un biestable sncrono a
partir de una asncrona, junto con su
esquemanormalizado:
Sutabladeverdadeslasiguiente:

CircuitoBiestableRSsncronoa)yesquemanormalizadob).

Tabladeverdad
biestableRS
C R S Q(NOR)
0 X X

N.D.

X=noimporta

BiestableD(DataoDelay)
El flipflop D resulta muy til cuando se necesita
almacenar un nico bit de datos (1 o 0). Si se aade un
inversor a un flipflop SR obtenemos un flipflop D
bsico. El funcionamiento de un dispositivo activado por
el flanco negativo es, por supuesto, idntico, excepto que
el disparo tiene lugar en el flanco de bajada del impulso
del reloj. Recuerde que Q sigue a D en cada flanco del
impulsodereloj.
Paraello,eldispositivodealmacenamientotemporalesde
dosestados(altoybajo),cuyasalidaadquiereelvalorde
laentradaDcuandoseactivalaentradadesincronismo,C.
En funcin del modo de activacin de dicha entrada de
sincronismo,existendostipos:
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Smbolosnormalizados:BiestablesDa)activo
pornivelaltoyb)activoporflancodesubida.

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Activopornivel(altoobajo),tambindenominadoregistroocerrojo(latcheningls).
Activoporflanco(desubidaodebajada).
LaecuacincaractersticadelbiestableDquedescribesucomportamientoes:

ysutabladeverdad:
D Q Qsiguiente
0

X=noimporta
Esta bscula puede verse como una primitiva lneaderetardo o una retencin de orden cero (zero order
holdeningls),yaquelosdatosqueseintroducen,seobtienenenlasalidauncicloderelojdespus.Esta
caractersticaesaprovechadaparasintetizarfuncionesdeprocesamientodigitaldeseales(DSPeningls)
mediantelatransformadaZ.
Ejemplo:74LS74

BiestableT(Toggle)
Dispositivodealmacenamientotemporalde2estados(altoybajo).Elbiestable
Tcambiadeestado("toggle"eningls)cadavezquelaentradadesincronismoo
derelojsedisparamientraslaentradaTestanivelalto.SilaentradaTesta
nivel bajo, el biestable retiene el nivel previo. Puede obtenerse al unir las
entradasdecontroldeunbiestableJK,uninquesecorrespondealaentradaT.
Noestndisponiblescomercialmente.
LaecuacincaractersticadelbiestableTquedescribesucomportamientoes:

ylatabladeverdad:

Smbolonormalizado:
BiestableTactivopor
flancodesubida.

T Q Qsiguiente
0 0

0 1

1 0

1 1

BiestableJK
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Esverstilyesunodelostiposdeflipflopmsusados.SufuncionamientoesidnticoaldelflipflopSR
enlascondicionesSET,RESETydepermanenciadeestado.LadiferenciaestenqueelflipflopJKno
tienecondicionesnovlidascomoocurreenelSR.
Estedispositivodealmacenamientoestemporalqueseencuentradosestados(altoybajo),cuyasentradas
principales,JyK,alasquedebeelnombre,permitenalseractivadas:
J:Elgrabado(seteningls),puestaa1nivelaltodelasalida.
K:Elborrado(reseteningls),puestaa0nivelbajodelasalida.
Si no se activa ninguna de las entradas, el biestable permanece en el estado que posea tras la ltima
operacindeborradoograbado.Adiferenciadel biestableRS,enelcasodeactivarseambasentradasala
vez,lasalidaadquirirelestadocontrarioalquetena.
LaecuacincaractersticadelbiestableJKquedescribesucomportamientoes:

Ysutabladeverdades:
J K Q Qsiguiente
0 0

0 0

0 1

1 0

1 1

1 1

X=noimporta
Una forma ms compacta de la tabla de verdad es (Q representa el estado siguiente de la salida en el
prximoflancoderelojyqelestadoactual):
J K Q
0 0

0 1

1 0

1 1
ElbiestablesedenominaasporJackKilby,elinventordeloscircuitosintegradosen1958,porlocualsele
concedielPremioNobelenfsicade2000.

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BiestableJKactivoporflanco
Junto con las entradas J y K existe una entrada C de
sincronismo o de reloj cuya misin es la de permitir el
cambio de estado del biestable cuando se produce un
flanco de subida o de bajada, segn sea su diseo. Su
denominacineninglsesJKFlipFlopEdgeTriggered.
Deacuerdoconlatabladeverdad,cuandolasentradasJy
Kestnanivellgico1,acadaflancoactivoenlaentrada
de reloj, la salida del biestable cambia de estado.A este
modo de funcionamiento se le denomina modo de
basculacin(toggleeningls).

Smbolosnormalizados:BiestablesJKactivoa)
porflancodesubidayb)porflancodebajada

Ejemplo:74LS73

BiestableJKMaestroEsclavo
Aunque an puede encontrarse en algunos equipos, este
tipo de biestable, denominado en ingls JK FlipFlop
MasterSlave, ha quedado obsoleto ya que ha sido
reemplazadoporeltipoanterior.
SufuncionamientoessimilaralJKactivoporflanco:enel
nivelalto(obajo)setomanlosvaloresdelasentradasJy
K y en el flanco de bajada (o de subida) se refleja en la
salida.
OtraformadeexpresarlatabladeverdaddelbiestableJK
esmedianteladenominadatabladeexcitacin:
J

K Q Qsiguiente

X 0

X 0

X 1

X 0

Smbolosnormalizados:BiestableJKMaestro
Esclavoa)activopornivelaltoyb)activopor
nivelbajo

X=noimporta
SiendoQelestadopresenteyQsiguienteelestadosiguiente.LaecuacincaractersticadelflipflopJKes:
Qsiguiente=JQ+KQlacualseobtienedelatablacaractersticadelflipflop.

Ejemploconcomponentesdiscretos

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Aunque,engeneral,losbiestablesutilizadosen
la prctica estn implementados en forma de
circuitosintegrados,enlaFigura1serepresenta
elesquemadeunsencillocircuitomultivibrador
biestable,realizadoconcomponentesdiscretos,
cuyofuncionamientoeselsiguiente:
Alaplicarlatensindealimentacin(Vcc),los
dostransistoresiniciaranlaconduccin,yaque
susbasesrecibenunpotencialpositivo,TR1a
travsdeldivisorformadoporR3,R4yR5y
TR2atravsdelformadoporR1,R2yR6,
perocomolostransistoresnosernexactamente
idnticos,porelpropioprocesodefabricaciny
el grado de impurezas del material
semiconductor, uno conducir antes o ms
rpidoqueelotro.
Supongamos que es TR1 el que conduce
Figura1.Circuitomultivibradorbiestable
primero. El voltaje en su colector disminuir,
debidoalamayorcadadetensinenR1,por
loquelatensinaplicadaalabasedeTR2atravsdeldivisorformadoporR2,R6,disminuirhaciendo
queesteconduzcamenos.EstadisminucindeconduccindeTR2hacequesubasutensindecolectory
portantoladebasedeTR1,esteprocesollevarfinalmentealbloqueodeTR2(salidaYanivelalto).
PerosiahoraaplicamosunimpulsodedisparodenivelaltoporlaentradaT,atravsdeloscondensadores
C1yC2pasaralasbasesdeambostransistores.EnelcasodeTR1notendrmsefectoqueaumentar
su tensin positiva, por lo que este seguir conduciendo. En la base de TR2 el impulso har que este
transistor conduzca, realizndose un proceso similar al descrito al principio, cuando el que conduca
primeroeraTR1,queterminarbloqueandoaesteydejandoenconduccinaTR2(salidaYanivelbajo).
LasecuenciadescritaserepetircadavezqueseapliqueunimpulsoenT.Lasalidacambiadeestadoconel
impulsodedisparoypermaneceendichoestadohastalallegadadelsiguienteimpulso,momentoenque
volveracambiar.
Lacadadetensinenlaresistenciacomndeemisores(R7)eliminalaindecisindelcircuitoyaumenta
lavelocidaddeconmutacin.

Aplicacin
Un biestable puede usarse para almacenar un bit. La informacin contenida en muchos biestables puede
representarelestadodeunsecuenciador,elvalordeuncontador,uncarcterASCIIenlamemoriadeun
ordenador,ocualquierotraclasedeinformacin.
Unusocorrienteeseldiseodemquinasdeestadofinitaselectrnicas.Losbiestablesalmacenanelestado
previodelamquinaqueseusaparacalcularelsiguiente.

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ElTestilparacontar.Unasealrepetitivaenlaentradaderelojhacequeelbiestablecambiedeestado
porcadatransicinaltobajosisuentradaTestanivel1.Lasalidadeunbiestablepuedeconectarseala
entrada de reloj de la siguiente y as sucesivamente. La salida final del conjunto considerado como una
cadenadesalidasdetodoslosbiestableseselconteoencdigobinariodelnmerodeciclosenlaprimera
entradaderelojhastaunmximode2n1,dondeneselnmerodebiestablesusados.
Uno de los problemas con esta configuracin de contador (ripple counter en ingls) es que la salida es
momentneamenteinvlidamientrasloscambiossepropaganporlacadenajustodespusdeunflancode
reloj.Haydossolucionesaesteproblema.Laprimeraesmuestrearlasalidaslocuandosesabequeestaes
vlida.Lasegunda,mscomplejayampliamenteusada,esutilizaruntipodiferentedecontadorsncrono,
que tiene una lgica ms compleja para asegurar que todas las salidas cambian en el mismo momento
predeterminado,aunqueelprecioapagareslareduccindelafrecuenciamximaalaquepuedefuncionar.
UnacadenadebiestablesTcomoladescritaanteriormentetambinsirveparaladivisindelafrecuencia
deentradaentre2n,dondeneselnmerodebiestablesentrelaentradaylaltimasalida.

Secuenciacinymetaestabilidad
Los biestables sncronos son propensos a sufrir un problema denominado metaestabilidad, que ocurre
cuandounaentradadedatosodecontrolestcambiandoenelmomentoenelquellegaunflancodereloj.
El resultado es que la salida puede comportarse de forma imprevista, tardando muchas veces ms de lo
normal en estabilizarse al estado correcto, o incluso podra oscilar repetidas veces hasta terminar en su
estadoestable.Enunordenadorestopuedesuponerlacorrupcindedatosocausarunfallodeprograma.
Enmuchoscasos,lametaestabilidadenlosbiestablessepuedeevitarasegurndosedequelosdatosylas
entradasdecontrolsemantienenconstantesduranteunperiododetiempoespecificadoantesydespusdel
flanco de reloj, denominados setup time (tsu) y hold time (th) respectivamente. Esos tiempos estn
establecidos en la hoja de datos del dispositivo en cuestin, y son tpicamente entre unos pocos
nanosegundosyunospocoscientosdepicosegundosparadispositivosmodernos.
Desafortunadamente, no siempre es posible cumplir estos requisitos, porque los biestables pueden estar
conectadosaentradasentiemporealquesonasncronas,ypuedencambiarencualquiermomentofueradel
control del diseador. En este caso, lo nico que puede hacerse es reducir la probabilidad de error a un
determinado nivel, dependiendo de la fiabilidad que se desee del circuito. Una tcnica para reducir la
incidenciaesconectardosomsbiestablesencadena,deformaquelasalidadeunaseconectaalaentrada
de la siguiente, y con todos los dispositivos compartiendo la misma seal de reloj. De esta forma la
probabilidaddeunsucesometaestablepuedereducirseconsiderablemente,peronuncapodreliminarsepor
completo.
Existen biestables robustos frente a la metaestabilidad, que funcionan reduciendo los tiempos de setupy
holdentodoloposible,peroinclusoestosnopuedeneliminarporcompletoelproblema.Estoesdebidoa
quelametaestabilidadesmuchomsqueunproblemadediseo.Cuandoelflancoderelojylaentradade
datos estn suficientemente juntos, el biestable tiene que elegir el evento que ocurri antes. Y por ms
rpido que se haga el dispositivo, siempre existe la posibilidad de que sucedan lo suficientemente juntos
comoparaquenosepuedadetectarcualeselqueocurriprimero.Aspues,eslgicamenteimposibleel
construirunbiestableapruebademetaestabilidad.

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Otro parmetro temporal importante de un biestable es el retardo relojasalida (clocktooutput tCO) o

retardodepropagacin(propagationdelaytP),queeseltiempoqueelbiestabletardaencambiarsusalida
tras un flanco de reloj. El tiempo para una transicin altoabajo (tPHL) es a veces diferente del de las
transicionesdebajoaalto(tPLH).
Cuandoseconectanbiestablesencadena,esimportanteasegurarqueeltCOdelprimeroesmayorqueel
holdtime(tH)delsiguiente,yaqueencasocontrario,elsegundobiestablenorecibirlosdatosdeforma
fiable.LarelacinentretCOytHestgarantizadanormalmentesiambosbiestablessondelmismotipo.

Vasetambin
Astable
Latch
Metaestabilidad
Microprocesador
Multivibrador
Monoestable
Sesgodereloj

Referencias
1.StevenH.Strogatz(2001).NonlinearDynamicsandChaos.WestviewPress.ISBN9780738204536.

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