PRCTICA N2

TEMA: Acondicionamiento de la seal de un sensor digital

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+OBJETIVOS:
General
Acondicionar un sensor digital para utilizarlo con la tarjeta FPGA.
Especficos
Revisar las especificaciones del sensor digital.
Identificar los puertos de entradas/salidas digitales de la FPGA.
Acondicionar el sensor digital para utilizarlo con la tarjeta FPGA.
Crear un proyecto en LabVIEW para mostrar el funcionamiento de
sensor con la tarjeta FPGA.
MATERIALES
Hardware
Sb-rio 9631.
Computador.
Sensor capacitivo de FESTO.
Software
NI LabVIEW.
NI LabVIEW FPGA.
NI LabVIEW Real-Time.
NI-RIO.
Otros
Cable Ethernet.
Fuente DC.
PROCEDIMIENTO
1. Identificar los parmetros del sensor. Como se puede observar en la tabla 1.

Tabla 2.1 Hoja de datos del sensor capacitivo FESTO.


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2. Reconocer los puertos de entradas/salidas digitales de la tarjeta FPGA. Como se
aprecia en la figura 18.


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Fig. 18 Esquema general de la tarjeta FPGA 9631.
Se observa que los conectores: P2, P3, P4 y P5 son digitales. Segn la hoja de
caractersticas de la tarjeta FPGA esta soporta hasta 5 Vc.d. debido a que el
sensor que se utiliza para esta prctica su salida es PNP normalmente abierto, es
decir, dejar pasar el voltaje de alimentacin que reciba cuando detecte un
objeto. Se tiene que acondicionar la salida del sensor para que no sobrepase el
voltaje mximo soportado de la tarjeta que es de 5Vc.d.
3. Acondicionar la salida del sensor capacitivo.
Se utiliza un divisor de voltaje como circuito de acondicionamiento como se
muestra en la figura 19.


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Fig. 19 Acondicionamiento de seal de un sensor digital.
Se comprueba el voltaje de salida mediante la ecuacin (1).

(2.1)

En condiciones normales se tiene un voltaje de salida de 2.18 c.d. pero si se
alimenta al sensor con su voltaje mximo de alimentacin que segn la hoja de
datos es de 36 Vc.d. se tiene lo siguiente:

Como se observa en el resultado al aplicar la ecuacin (1) en condiciones
mximas de alimentacin del sensor, no se sobrepasa el voltaje permitido por la
tarjeta FPGA.
4. Conectar el sensor capacitivo a la tarjeta FPGA.
Se utiliza el Conector P3 y segn se observa en la hoja de caractersticas de la
tarjeta en la figura 20, el puerto que se utiliza es el Port 8/DIO0, ya que de esta
manera el programa lo reconoce.



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Fig. 20 Pines de conexin del conector P3.
Como se muestra en la figura 20 se utiliza el pin 13 para obtener la seal de
salida del seor digital capacitivo.
5. Crear un proyecto en labview para adquisicin de la seal del sensor
Se sigue los mismos pasos de la prctica 1 realizar la conexin de la tarjeta sb-
rio con la computadora.
Una vez que se tenga listo el proyecto se procede a dar clic derecho sobre FPGA
Tarjet y se selecciona la opcin New/VI. Como se muestra en la figura 21.

Fig. 21 Creacin de un Instrumento Virtual en la tarjeta FPGA.



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Se aparece 2 ventanas, una es el panel de control y la otra es el diagrama de
bloques. En el panel de control se realiza la siguiente interfaz como se muestra
en la figura 22.

Fig. 22 Panel de control prctica2.
Los elementos que se observan en la figura 22 se colocaron de la paleta de
control la opcin modern/ decorations. Como se muestra en figura 23.

Fig. 23 Decoraciones en LabVIEW.


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De la misma manera se procede para insertar las etiquetas de practica 2 y
acondicionamiento de la seal de un sensor digital.
Para colocar el led indicador, en la paleta de control se elige la opcin modern/
Boolean/ Round led como se observa en la figura 24.

Fig. 24 Led redondo en LabVIEW.
La imagen del sensor capacitivo se inserta con Ctrl+v.
En la figura 25 se observa el diagrama de bloques y con ms detalle se describe
en la tabla 2 los pasos que se siguen para la creacin de cada elemento.

Fig. 25 diagrama de bloques de la prctica 2.

Tabla 2.2 Descripcin de los elementos utilizados en el diagrama de bloques.


Se guarda el VI y se corre el programa en la opcin run para este caso se elige la
compilacin local y se presiona ok y se espera unos minutos hasta que el
programa se compile.Al acercar un objeto el led se enciende indicando que ha
detectado un objeto el sensor capacitivo como se puede observar en la figura 27.
Objeto Detalle
While Loop Paleta de funciones/ Programing/ Structures/ While loop
Port8/DIO0 Menu del proyecto/ NI-sbRIO9631/Chasis/ FPGA tarjet/ Port8


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Fig. 27 VI de la practica 2 en ejecucin.