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1
Tanto del circuito como del cronograma podemos deducir que cada una de las salidas
de las compuertas AND corresponde a cada uno de los minterms posibles para
funciones de dos variables, en este caso representadas por las entradas S1 y S0.
Decodificador de 3x8:
Se muestra el circuito esquemtico y cronograma correspondiente a un
decodificador de decodificador de 3 a 8 lneas de salida.
A2
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0
0
1
1
1
1
A1
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1
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D2
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0
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D7
0
0
0
0
0
0
0
1
Tanto del circuito como del cronograma podemos deducir que cada una de las salidas
de las compuertas AND corresponde a cada uno de los minterms posibles para
funciones de dos variables, en este caso representadas por las entradas D7, D6, D5, D4,
D3, D2, D1 y D0.
*Si analizamos la tabla de verdad y la dividimos en dos partes iguales (Cuando S2=0 y
cuando S2=1) podemos ver que:
S2
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0
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1
1
S1
0
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1
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D7
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0
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0
1
*Cuando S2=0, las seales desde D4 hasta D7 estn desactivadas o inactivas, y las
seales desde d0 hasta d3 se comportan igual que el decodificador de 2 a 4.
S2
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0
0
0
S1
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0
D6
0
0
0
0
D7
0
0
0
0
*Cuando S2=1, las seales desde D0 hasta D3 estn desactivadas o inactivas, y las
seales desde D4 hasta D7 se comportan igual que el decodificador de 2 a 4.
S2
1
1
1
1
S1
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1
1
S0
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Seales de
Entrada
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A2
A1
A0
S0
S1
S2
S3
S4
S5
S6
S7
S8
S9
S10
S11
S12
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S14
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Seales de
Entrada
Seales de Salida
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A2
A1
A0
S0
S1
S2
S3
S4
S5
S6
S7
S8
S9
S10
S11
S12
S13
S14
S15
Activadores:
A3
A2
A1
A0
S0
S1
S2
S3
S4
S5
S6
S7
S8
S9
S10
S11
S12
S13
S14
S15
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A1
A0
S0
S1
S2
S3
S4
S5
S6
S7
S8
S9
S10
S11
S12
S13
S14
S15
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S0
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S13
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A0
S0
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E1
E2
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E4
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