Laboratorio: Las Compuertas NOT, AND, OR,

NAND, NOR Y XOR

Revisión: febrero 1, 2021

Objetivos
Comprobar el comportamiento de las funciones lógicas NOT, AND, OR, NAND, NOR y
XOR. Mediante el simulador gConstructorVirtualDeCircuitos.

Fundamentos Teóricos Básicos

La breve descripción que se detalla a continuación define de forma simplificada el

funcionamiento de cada una de esas puertas así como la ecuación lógica a la que
responden:

• NOT: El nivel lógico que presenta a su salida es el opuesto al de su entrada;

Y=A
• AND: La salida es <<1>> cuando todas las entradas valen también <<1>>;
Y = A⋅B
• OR: La salida es <<1>> cuando cualquier entrada vale <<1>>; Y = A+ B
• NAND: La salida es <<1>> cuando cualquier entrada vale nivel lógico <<0>>;
Y = A⋅B
• NOR: La salida es <<1>> cuando todas las entradas valen <<0>>; Y = A+ B
• XOR: La salida es <<1>> cuando el número de entradas que estén a <<1>> sea
impar; Y = A⊕B

La Figura 1-1 muestra los símbolos, cápsulas y distribución de patillas de los chips
SN7404, SN7408, SN7432, SN7400, SN7402 y SN7486.

Figura 1-1. Cápsulas y símbolos de las seis funciones lógicas básicas

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Esquemas de Montaje

Véase la Figura 1-2.

Figura 1-2. Esquema electrónico para comprobar

el funcionamiento de una puerta NOT

Materiales Necesarios

• Plantilla
• Circuitos integrados: SN7404, SN7400, SN7402, SN7408, SN7432, SN7486
• Fuente de alimentación
• (3) Resistencias de 330 Ω ( No es necesario si se realiza en
“gConstructorVirtualDeCircuitos”)
• (3) Leds
• Cables de Conexión

Montaje Práctico ______________________________ ________________

1. Conectar la alimentación +5 Vcc a la patilla 14

2. Conectar la tierra GND a la patilla 7 sel SN7404
3. Unir el interruptor E0 con la patilla 1
4. La patilla 1 con el led S0
5. La patilla 2 con el les S1

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Desarrollo de la Práctica

Mediante el interruptor E0 se introducen los niveles lógicos de acuerdo a la siguiente

tabla de la verdad. El led S0 visualiza el nivel lógico de entrada y el led S1 el de salida.

E0 S0 S1
0 0 1
1 1 0

El diagrama de tiempo de la Figura 1-3 es equivalente a la tabla de la verdad anterior y

también permite determinar el funcionamiento de cualquier circuito lógico.

Figura 1-3. Diagrama de tiempos de la función NOT

Trabajo Personal

Considerando el ejemplo anterior, se propone montar el esquema de la Figura 1-4. De

igual forma, completar la tabla de la verdad y el correspondiente diagrama de tiempos.

E0 S0 S1 S2
0
1

Figura 1-4. Esquema propuesto. Completar la tabla de la verdad

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De la misma manera que se ha analizado el comportamiento de la función NOT, se

sugiere hacer un análisis similar con el resto de las puertas. Para ello hay que montar el
correspondiente circuito integrado sobre la plantilla, según los siguientes esquemas de
las Figuras 1-5, 1-6, 1-7,1-8 y 1-9. Proceder a verificar su funcionamiento completando
las respectivas tablas de la verdad.

E0=S0 E1=S1 S2
0 0
0 1
1 0
1 1

Figura 1-5. La puerta AND

E0=S0 E1=S1 S2
0 0
0 1
1 0
1 1

Figura 1-6. La puerta OR

E0=S0 E1=S1 S2
0 0
0 1
1 0
1 1

Figura 1-7. La puerta NAND

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E0=S0 E1=S1 S2
0 0
0 1
1 0
1 1

Figura 1-8. La puerta NOR

E0=S0 E1=S1 S2
0 0
0 1
1 0
1 1

Figura 1-9. La puerta XOR

De igual forma se puede resolver el diagrama de tiempos, representando la salida de

cada una de las puertas analizadas en función de las dos señales de entrada E0 y E1
(Fig. 1-10).

Figura 1-10. Diagramas de tiempos de las diferentes puertas lógicas

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ANOTACIONES PERSONALES
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