Diseño de amplificador de bajo ruido con SiGe BiCMOS de 0,35 µm
Tecnología para aplicaciones WLAN / WiMax
Mehmet Kaynak, Ibrahim Tekin, Ayhan Bozkurt y Yasar Gurbuz
Universidad Sabanci, Facultad de Ingeniería y Ciencias Naturales, Orhanli, Tuzla, 34956, Estambul,
Turquía Tel: ++ 90 (216) 483 9533, correo electrónico: mehmetk@su.sabanciuniv.edu
Resumen - Este artículo presenta una metodología de diseño de un LNA totalmente
integrado de bajo ruido y baja potencia, dirigido a las tres bandas de aplicaciones
WLAN IEEE 802.11a en la banda de 5-6 GHz y utilizando tecnología SiGe BiCMOS
HBT de 0,35 µm. En este artículo enfatizamos la importancia de la extracción de
componentes parásitos mediante el uso de simulaciones electromagnéticas, que
generalmente se ignora en la literatura de trabajos / investigaciones similares al
reportar la figura de ruido. Finalmente, hemos obtenido un LNA emparejado en chip
SiGe HBT, que exhibe NF de 2.75 dB, ganancia de> 15dB, pérdida de retorno de
entrada de <-15dB, pérdida de retorno de salida de <-10dB. El circuito consume solo
10,6 mW con una tensión de alimentación de 3,3 V. El área de la matriz del circuito es
de 595 × 925 µm2, incluidas las almohadillas.
Palabras clave - Amplificador de bajo ruido, LNA, SiGe, BiCMOS, HBT, inductor de
alto Q, emparejamiento simultáneo
Yo NTRODUCCIÓN
La tendencia de demanda hacia los servicios multimedia interactivos ha
obligado al desarrollo de nuevos sistemas inalámbricos que cuentan con
mayores anchos de banda. La WLAN de próxima generación funciona en el
rango de frecuencia de 5-6 GHz. Un receptor frontal capaz de operar dentro de
este rango de frecuencia es esencial para cumplir con los productos actuales y
futuros. Uno de los componentes críticos, que permite el uso común de la
tecnología, se puede atribuir a los Amplificadores de Bajo Ruido (LNA) de alto
rendimiento en la cadena del receptor del
Transceptores 802.11a. En IEEE 802.11a, hay tres bandas de frecuencia;
5.15GHz - 5.25GHz, 5.25GHz - 5.35GHz y 5.725GHz - 5.825GHz. Un LNA bien
diseñado no solo debe proporcionar suficiente ganancia para suprimir la figura de
ruido general, sino que también debe tener un ancho de banda adecuado para
cubrir las tres bandas de frecuencia. Recientemente, se han implementado
muchos LNA utilizando diversas tecnologías de semiconductores con excelentes
cifras de ruido bajo (NF) [1-5]. Estas cifras de bajo ruido se logran a expensas de
un consumo de energía de CC muy alto u otras compensaciones como una alta
pérdida de retorno de entrada / salida, baja linealidad o rangos dinámicos
insatisfactorios. La compensación de las compensaciones depende de las
aplicaciones, ya que el ruido ultrabajo puede no ser una prioridad debido a la
necesidad de una baja disipación de energía y una mayor duración de la batería
de los sistemas de comunicación portátiles. Para tales sistemas portátiles, el
consumo total de energía podría ser tan bajo como 15 mW, lo que se considera
aceptable como bajo consumo de energía [6]. También es posible lograr un bajo
nivel de ruido junto con un bajo consumo de energía utilizando GaAs
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tecnologías o mediante el uso de componentes coincidentes fuera del chip. Sin
embargo, estas soluciones también tienen un alto costo tecnológico. Ha habido un
esfuerzo creciente hacia la realización de inductores de alta Q en chip de bajo costo
para mantener el costo más bajo.
En este artículo, presentamos el diseño y desarrollo de LNA integrado
de baja potencia y bajo ruido para aplicaciones WLAN en la banda de 5
GHz utilizando tecnología SiGe BiCMOS HBT de 0,35 µm. Se utilizó un
amplificador cascodo de una etapa con degeneración inductiva del emisor.
Para obtener una figura de ruido baja, se analizaron diferentes transistores,
disponibles en la tecnología, y se eligió el óptimo (npn232). Se derivó una
fórmula del NF de nuestro circuito y se utilizó para optimizar los transistores
y los puntos de polarización. Las simulaciones electromagnéticas (EM) de
los componentes pasivos
son realizado por utilizando Agilent
IMPULSO ® herramienta y se extraen todos los componentes parásitos, un
paso crucial para optimizar los parámetros de rendimiento del LNA.
Finalmente, hemos obtenido un LNA emparejado en chip SiGe HBT para
receptores 802.11a, que exhibe NF de 2.75 dB, pérdida de retorno de entrada
de <-15dB, pérdida de retorno de salida de <-10dB y consumo de energía de
10,6 mW.
II. L N / A re ESIGN
En los circuitos LNA, la ganancia se puede lograr mediante un solo transistor de
tres terminales, lo que significa tres modos diferentes de operación. El modo de
funcionamiento de emisor común (CE) se utiliza con mayor frecuencia como
controlador para un LNA. La etapa de colector común (CC) tiene alta impedancia de
entrada y baja impedancia de salida, un buen candidato para etapas de búfer. La
base común (CB) se usa generalmente como un cascodo en combinación con la
etapa de controlador de emisor común, la topología más utilizada en aplicaciones
LNA para lograr una alta ganancia en frecuencias de RF. Las cargas de las topologías
se pueden realizar utilizando resistor para aplicaciones de banda ancha o utilizando
resonadores sintonizados para aplicaciones de banda estrecha. El procedimiento de
decisión para elegir la red de adaptación de entradas es similar al procedimiento de
elección de carga. Un LNA con adaptación de entrada resistiva tiene altas cifras de
ruido debido a las resistencias en la entrada del circuito, generalmente no se prefiere
para aplicaciones de bajo ruido. Este problema se puede resolver utilizando
inductores para la entrada simultánea y la adaptación de ruido. En este trabajo,
nuestra topología de elección es “cascodo degenerado por emisor” como se detalla
en las siguientes subsecciones.
 A. Topología del circuito y descripción detallada

La Figura 1 ilustra el esquema de un LNA de emisor común conectado a

cascodo con degeneración de emisor inductivo.

Figura 2: NF min contra yo C curva para transistor npn232

Como se ve en la Fig.2, 80-125 µA de rango de corriente de colector

proporciona la figura de ruido más baja y es adecuado para el transistor npn232 con
área de dispositivo de unidad para 5.2 GHz
banda de frecuencia. Otras corrientes de colector aumentan el NF min

Figura 1: Circuito Cascode LNA de un solo transistor, aumentando directamente el NF general del
LNA.
El amplificador cascodo tiene la ventaja de tener alta ganancia, bajo
ruido y estabilidad, gracias a un gran aislamiento.
El transistor Q 1 proporciona la ganancia del amplificador y debe seleccionarse C. Entrada simultánea y correspondencia de ruido

cuidadosamente de la biblioteca de tecnología. los

La aplicación típica para lograr transistores de área grande es En los LNA, la compensación entre ganancia y figura de ruido es un problema
conectándolos en paralelo. El transistor Q 2 es un amplificador de base común bien conocido [7]. Los círculos de ganancia y figura de ruido son una manera fácil de
y proporciona el aislamiento inverso mediante encontrar las impedancias óptimas que dan la ganancia máxima y la NF máxima
reduciendo la capacitancia de Miller entre su entrada y respectivamente. Hay varias metodologías presentes que se pueden aplicar para
salida. El inductor L re se utiliza con fines de polarización, carga y obtener una figura de ruido muy baja al mismo tiempo que una buena correspondencia
coincidencia de salida. L re debe ser elegido tan grande de entrada. En este trabajo usaremos el gráfico de Smith para lidiar con esta
suficiente para bloquear el flujo de la señal de CA a V dd y también para compensación porque las impedancias deseadas se pueden obtener simultáneamente
aumentar la carga del circuito teniendo en cuenta que en el mismo gráfico de Smith. Por lo tanto, un diseñador puede elegir fácilmente dónde
L re también es parte del circuito de adaptación de salida. C o1 se utiliza tanto para cargar debe operar el circuito.
como para igualar la salida del circuito. También eso
se utiliza para el bloqueo de CC de la salida del circuito. La C cp
condensador en la entrada se utiliza para los propósitos de dc-
bloqueo y coincidencia de entrada. L gramo y degeneración
inductancia L mi se utilizan para proporcionar coincidencia de potencia y ruido. En
el rango de frecuencia de 5 GHz, valores típicos
para L mi tiene aproximadamente 200-500 pH. Estos son los valores que las bibliotecas de
tecnología no tienen, por lo que estos inductores deben ser
diseñado por el diseñador.

B. Diseño de transistor de bajo ruido

Uno de los principales esfuerzos durante el diseño del LNA se centra en

optimizar las corrientes de polarización y las geometrías de los transistores para
obtener una figura de ruido baja. Para una tecnología determinada, el factor de ruido
alcanzable depende básicamente de la densidad de corriente de funcionamiento. En
general, los detalles tecnológicos específicos del diseño de los datos de proceso son

no disponible. Por encontrar el J copto del dispositivo de la unidad, se podrían utilizar

los datos simulados o medidos. La figura de ruido
En la Fig. 2 se muestran las curvas de corriente del colector del transistor npn232 a 5,2 Figura 3: Círculos de ruido de LNA
GHz para el área del dispositivo de la unidad.

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 Realizamos entrada simultánea y emparejamiento de ruido mediante el diseño de la
red de emparejamiento de entrada de modo que el centro de los círculos de ruido (NC) del
LNA se mueva hacia el centro del gráfico de Smith de admitancia de la fuente, presentado
en la Fig.3.
el rango de frecuencia de nuestro interés. Como se ve en la Fig. 5, el LNA de
retroalimentación en cascodo logra una ganancia de potencia de más de 15 dB en el rango
de frecuencia 5-6. La planitud de la ganancia dentro
0,2 dB en este rango de frecuencia cubre las tres bandas de
Estándar 802.11a; 5. 15 GHz-5,25 GHz, 5,25 GHz-5,35 GHz y 5,725
GHz -5,825 GHz.

Figura 4: Transistor controlador LNA con dos inductores

Dado que el LNA es el primer componente en la cadena del receptor, la

entrada debe coincidir con 50-Ω que es la impedancia de salida de la etapa
anterior. El método más conveniente para el emparejamiento de entrada requiere
dos inductores para proporcionar el emparejamiento de potencia y ruido que se Figura 5: Curva de ganancia del LNA (S21)
muestra en la Fig.
4. En la Fig. 4, los inductores L segundo y yo mi están diseñados para estar en chip, como NF min y las curvas NF de nuestro circuito LNA se muestran en la Fig. 6. Una
todos los demás pasivos de este circuito. En esto coincidencia de ruido en el rango de frecuencia deseado (5-
topología, la impedancia de entrada se puede escribir como 6 GHz) y el cambio de NF de 2.8 dB en la banda de 5-6 GHz se puede observar
en la Fig. 6. En la literatura, las simulaciones de ruido generalmente no incluyen
gramo metro L e + jwL los inductores y las resistencias en serie de los cables. En este trabajo se tienen
Z en= - j + jwL e + segundo
(1) en cuenta todos los efectos parásitos de los inductores y se puede decir que
baño π C π
estos parásitos afectan el rendimiento de ruido del circuito hasta% 20,

Para la coincidencia de entrada, la parte real de la impedancia de entrada en la ecuación Por ejemplo, la suma de la resistencia en serie de L segundo,
(1) debe ser igual a la resistencia de la fuente (50-Ω). Es decir aumenta la figura de ruido de 2,1 dB a 2,8 dB. Esta
La diferencia se atribuye a la resistencia en serie del
inductor, contribuyendo al factor Q del inductor. L segundo
R s= g metro L mi (2)
La contribución al factor Q también se ve en la Fig.6, cambiando
Cπ
de 10 a 20. Un factor de calidad inferior para los inductores L gramo
Además, la parte imaginaria de la impedancia de entrada debe ser igual a cero para y yo s significa un aumento en la resistencia en serie de la entrada, lo que
obtener el valor de L segundo como provoca un aumento en la figura de ruido de la
circuito.
Rs Cπ
Lb=1 - 2
(3)
Cπw gramo metro

Antes del emparejamiento, la entrada del circuito es capacitiva.

debido a la C π capacitancia del transistor de entrada. L mi en

La figura 1 ajusta la parte real de la impedancia de entrada y L segundo en la Fig. 1 sintoniza la

parte imaginaria de la impedancia de entrada. Como un
Como resultado, la impedancia de entrada final está cerca del centro del gráfico de Smith,
lo que proporciona una impedancia de entrada real pura de 50 Ω.

III. S RESULTADOS DE IMULACIÓN

En esta sección, se presentan los resultados de la simulación de LNA Figura 6: Análisis de NFmin y NF del LNA
cascodo de una etapa de banda ancha de 5-6 GHz. Todas las simulaciones se
realizan utilizando Agilent Design System (ADS) y Cadence ® herramientas de diseño Como se ve en la Fig.6, NF del circuito es casi igual al
con AMS 0.35µm SiGe NF min del circuito que es muy deseado. También se observa en la Fig.6 es la
Tecnología HBT. Esta tecnología tiene un pico F T valor de 50 GHz. La Figura 5 coincidencia de entrada que da el mejor valor en

presenta el resultado de la simulación de ganancia de el mismo rango de frecuencia con NF.

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 La coincidencia de entrada de nuestro circuito también es adecuada para
aplicaciones WLAN. La figura 7 ilustra una buena entrada
coincidencia de impedancia de 50 Ω. S 11 del circuito está por debajo de -15 dB a la
frecuencia de interés. Esto también nos muestra que
Se obtiene coincidencia simultánea de entrada y ruido.
Figura 7: Coincidencia de entrada del LNA (S11)
La adaptación de impedancia en la entrada siempre es necesaria,
mientras que en la salida solo es necesaria con el LNA accionando un filtro de
rechazo de imagen externo, colocado entre el LNA y el mezclador. Por otro lado,
la conexión directa en chip entre el LNA y el mezclador proporciona una mejor
linealidad y ahorra el consumo de energía. Pero se requieren especificaciones de
rendimiento más estrictas del filtro de rechazo de imagen para evitar la
degradación de la figura de ruido. En este trabajo, la salida también se adapta a
la impedancia de la fuente de 50 Ω.
La S 22 resultado del circuito se presenta en la Fig. 8. En el
frecuencia de interés, S 22 es menor que -10dB que es suficiente para
arquitecturas de transceptores heterodinos [8].
Figura 8: Coincidencia de salida del LNA (S 22)
IV. PROBLEMAS DE DISEÑO
El diseño completo del LNA, incluidos los circuitos de polarización, se presenta en
la Fig. 9. Todos los componentes están integrados en el chip, incluidos los
condensadores de derivación y bloqueo de CC. El LNA en estudio fue diseñado y
simulado con un estándar de 0.35 µm
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Tecnología SiGe BiCMOS sobre un sustrato tipo p. Hay cuatro capas de
metal en esta tecnología y la capa superior de metal tiene un grosor de 3
µm, ideal para realizar inductores.
A 5 GHz de frecuencia de operación, todos los caminos tendrán
capacitancias, resistencias y también inductancias parásitas. Los simuladores
típicos pueden extraer componentes parásitos de RC, pero la extracción por
inductancia es un tema muy interesante para las comunidades de
investigación / empresa de RF y microondas de hoy en día. En este trabajo se
extraen todas las inductancias parásitas utilizando Agilent MOMENTUM ® herramienta.
Por último, todos los caminos en la parte de entrada del LNA se realizan
utilizando la capa superior de metal debido a la reducción de la resistencia en
serie. Estas resistencias en serie agregan ruido directamente y aumentan el
rendimiento de ruido general del sistema.
Nuestro circuito ocupa un área de 595 × 925 µm 2. Funciona con una
tensión de alimentación de 3,3 V para aumentar la oscilación de salida del
LNA. Solo consume 10,6 mW de potencia, muy bajo en comparación con LNA
bipolares similares [1-5].
Figura 9 Disposición del LNA (595 × 925 µm 2)
V. C ONCLUSIÓN
Este artículo presenta el diseño, simulación e implementación de un
amplificador de bajo ruido para WLAN IEEE
Aplicaciones 802.11a en el rango de frecuencia de funcionamiento de 5-6 GHz.
Hemos demostrado un procedimiento de diseño cuidadoso para el circuito, incluidos
los inductores utilizados en nuestro diseño, enfatizando
los importancia de electromagnético
simulaciones / consideraciones, cuando el interés de la frecuencia es superior a 5
GHz. Esto se debe a que a medida que aumentan las relaciones de aspecto espesor /
ancho, las corrientes horizontales también aumentan, por lo que deben tenerse en
cuenta para la precisión de nuestros resultados. Se especificó la importancia de los
componentes pasivos, especialmente el inductor, y se proporcionan las soluciones
para los resultados de simulación precisos. El NF del circuito incluye todos los
componentes parásitos de los pasivos y muy cerca de
NF min eso es 2.8 dB. En la literatura de investigación similar, no es una
práctica común incluir la extracción parasitaria de
componentes pasivos al informar la figura de ruido. En este trabajo, probamos que los
componentes parásitos pueden degradar el NF del circuito en aproximadamente un
20%, teniendo un gran potencial para
 afectar el rango dinámico del transceptor general. La ganancia del amplificador VII. UNA UTHOR ' S segundo IOGRAFÍA
es suficiente para la aplicación especificada, IEEE 802.11a, que está por encima
de 15 dB en la frecuencia de interés. También hemos presentado una
Mehmet Kaynak ( BS'04) Recibió su
uniformidad de ganancia dentro de 0,2 dB para la misma frecuencia. La entrada y
BS la licenciatura desde Electrónica y
la salida del circuito tienen una pérdida de retorno en banda mejor que -15 dB y Departamento de Ingeniería de Comunicaciones
-10 dB respectivamente. LNA es incondicionalmente estable en toda la banda. de la Universidad Técnica de Estambul (UIT) en
2004. Actualmente continúa su maestría en el
Programa de Microelectrónica de la Facultad de
El circuito consume solo 10,6 mW con una tensión de alimentación de 3,3 V. Ingeniería y Ciencias Naturales de la Universidad

El área de la matriz del circuito es 595 × 925 µm 2, incluyendo almohadillas. El Sabanci, Estambul, Turquía. Sus intereses de
investigación son analógicos
resultado también demuestra de manera inequívoca que se puede lograr un bajo
y diseño de IC de modo mixto, diseño de RF y microondas y RF MEMS.
NF y un bajo consumo de energía simultáneamente con redes de adaptación de
entrada y salida en el chip. Tanto desde la perspectiva del rendimiento como del
costo, estos resultados muestran que la tecnología SiGe es muy competitiva con Ibrahim Tekin ( MSc'92 – PhD'97) Obtuvo su
sus tecnologías homólogas, las tecnologías CMOS, BJT y GaAs. licenciatura y maestría en el Departamento de
Ingeniería Eléctrica y Electrónica de la
Universidad Técnica de Oriente Medio (METU) en
1990 y 1992, respectivamente. De 1993 a 1997
estuvo con
los Eléctrico Ingenieria
VI. R EFERENCIAS
Departamento de la Universidad Estatal de Ohio
[1] P. Ma, M. Racanelli, J. Zheng, M. Knight. “Un nuevo amplificador (OSU) donde recibió su doctorado en 1997.
bipolar-MOSFET de bajo ruido (BiFET LNA), configuración de circuito, Durante 1990-1993 fue asistente de investigación
Diseño Metodología, y Chip en METU, y de
Implementación". Transacciones IEEE sobre teoría y técnicas de microondas, vol. 51, De 1993 a 1997 trabajó como investigador asociado graduado en el Laboratorio de
no 11, págs. 2175-2180, noviembre de 2003. Electrociencia, OSU. De 1997 a 2000, trabajó como investigador en el Laboratorio de
[2] CP Moreira, E. Kerherve, P. Jarry, D. Belot. “Un LNA de bajo consumo que Tecnología Inalámbrica de Bell Laboratories, Lucent Technologies. Ahora trabaja en el
utiliza una tecnología fT SiGe: C BiCMOS7RF de 0,25 µm 60 GHz para programa de telecomunicaciones de la Universidad Sabancı de Estambul. Sus intereses
aplicaciones inalámbricas”. IEEE Mediterráneo de investigación son el diseño de RF y microondas, antenas y circuitos UWB, métodos
Microondas Simposio (MMS'2004), numéricos en electromagnetismo. Es miembro de las sociedades IEEE Antennas and
Marsella - Francia, junio de 2004. Propagation y IEEE Communications.
[3] DJ Cassan y JR Long, "Un amplificador de bajo ruido con retroalimentación de
transformador de 1 V para LAN inalámbrica de 5 GHz en CMOS de 0,18 µm", IEEE J.
Circuitos de estado sólido, vol. 38, no. 3, págs. 427– Yasar Gurbuz (MS'93 – PhD'97)
435, marzo de 2003. recibió la licenciatura en ingeniería eléctrica con
[4] C.-Y. Cha y S.-G. Lee, “Un LNA de 5.2 GHz en CMOS de 0.35 µm que utiliza altos honores de la Universidad de Erciyes, en
resonancia en serie entre etapas y optimiza la resistencia del sustrato”, IEEE J. 1990. Recibió la maestría en 1993 y el
Circuitos de estado sólido, vol. doctorado en 1997 en ingeniería eléctrica de la
38, no. 4, págs. 669–672, abril de 2003. Universidad de Vanderbilt en los Estados
[5] TP Liu y E.Westerwick, "chipset frontal de transceptor de radio CMOS de Unidos. Trabajó como investigador asociado
5 GHz", IEEE J. Circuitos de estado sólido, senior en Vanderbilt entre 1997 y 1999.
vol. 35, no. 12, págs. De diciembre de 2000.
[6] HW Chiu, Shey-Shi Lu y Yo-Sheng Lin, "Un LNA CMOS monolítico NF de Sus responsabilidades incluían dirigir y realizar proyectos de investigación, impartir
banda de 5 GHz de 2,17 dB con consumo de energía de CC de 10 mW", Transacción
cursos y asesorar a estudiantes de posgrado en las áreas de dispositivos y sensores de
IEEE sobre teoría y técnicas de microondas, vol. 53, no. 3, marzo de 2005 estado sólido. De 1999 a 2000 trabajó en Aselsan Inc. En 2000, se unió a la Facultad
de Ingeniería y Ciencias Naturales de la Universidad de Sabanci, como profesor
[7] Sorin P. Voinigescu, Michael C. Maliepaard, Jonathan L. Showell, Greg E. asistente y fue ascendido a profesor asociado en 2002. Sus áreas de investigación
Babcock, David Marchesan, Michael Schroter, Peter Schvan y David L. incluyen circuitos integrados analógicos y de señal mixta, dispositivos y sensores de
Harame, “Un modelo escalable de ruido de alta frecuencia para transistores estado sólido, sistemas microelectromecánicos (MEMS) y tecnologías de
bipolares con aplicación Dimensionamiento del transistor para un diseño de semiconductores de banda ancha. Tiene más de 20 artículos de revistas revisados por
amplificador de bajo ruido ” IEEE Journal of Solid-State Circuits, vol. pares y más de cuarenta artículos de conferencias en su área de investigación. Es
miembro de IEEE
32, no. 9, págs. 1430-1439, septiembre de 1997

[8] Behzad Razavi, RF Microelectronics, Prentice Hall y SPIE.

PTR, 1998.

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