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FACULTAD DE INGENIERÍA
DIVISIÓN DE CIENCIAS BÁSICAS
Diseño Digital
2
Práctica #_____
Martínez
Elaborada por: ______________ Rojas
_____________ José Eduardo
___________
Apellido paterno Apellido materno Nombre(s)
Grupo: 1
Semestre: 2020-1
Conclusiones ................................................................................................................................... 19
Referencias ..................................................................................................................................... 19
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Objetivo
El alumno analizara de que partes esenciales conta un código hecho atravez del
lenguaje de descripción de hardware VHDL, así también que implica la implementación
de funciones mediante el estilo flujo de datos.
Material y equipo
Computadora, software de descripción de hardware, tarjeta de desarrollo.
Software Quartus II. En espcífico Quartus II 13.0(64 bit) Web edition
Probamos con una MAX II .
Dispositivo con matrcula:EPM240T100C5 un CPLD
Procedimientos
Practica 2 A
Implantar las siguiente funciones
• 𝐹1(𝑎𝑏𝑐) = 𝑎𝑏)𝑐 + 𝑎)
y=x+y=>𝑏)𝑐 + 𝑎)
𝐹1(𝑎𝑏𝑐) = 𝑏)𝑐 + 𝑎)
𝐹1(𝑎𝑏𝑐) = +(5,0,1,2,3)
a b c F1
0 0 0 1
0 0 1 1
0 1 0 1
0 1 1 1
1 0 0 0
1 0 1 1
1 1 0 0
1 1 1 0
• 𝐹2(𝑎𝑏𝑐) = 𝑎𝑏 + 𝑏)𝑎𝑐̅ + 𝑎 ⊙ 𝑐
𝐹2(𝑎𝑏𝑐) = 𝑎𝑏 + 𝑏)𝑐̅ + 𝑎 ⊙ 𝑐
𝑎𝑐 + )))
𝐹2(𝑎𝑏𝑐) = ))) 𝑏𝑐 + 𝑎𝑏 + 𝑎𝑐
𝐹2(𝑎𝑏𝑐) = +(0,1,4,6,7,5)
a b c F2
0 0 0 1
0 0 1 0
0 1 0 1
0 1 1 0
1 0 0 1
1 0 1 1
1 1 0 1
1 1 1 1
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• 𝐹3(𝑎𝑏𝑐) = 6𝑎 + 𝑏) + 𝑐̅7(𝑏 + 𝑐)
𝐹3(𝑎𝑏𝑐) = 8(3,0,4)
a b c F3
0 0 0 0
0 0 1 1
0 1 0 1
0 1 1 0
1 0 0 0
1 0 1 1
1 1 0 1
1 1 1 1
Tabla de resultados
a b c F1 F2 F3 DEC
0 0 0 1 1 0 3
0 0 1 1 0 1 5
0 1 0 1 1 1 7
0 1 1 1 0 0 1
1 0 0 0 1 0 2
1 0 1 1 1 1 7
1 1 0 0 1 1 6
1 1 1 0 1 1 6
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1.a- Contrucción de nuestras funciones
• 𝐹1(𝑎𝑏𝑐) = 𝑎𝑏)𝑐 + 𝑎)
• 𝐹2(𝑎𝑏𝑐) = 𝑎𝑏 + 𝑏)𝑎𝑐̅ + 𝑎 ⊙ 𝑐
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• 𝐹3(𝑎𝑏𝑐) = 6𝑎 + 𝑏) + 𝑐̅7(𝑏 + 𝑐)
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4.a.- Compilamos
Compilamos cada una de nuestras funciones para ver que estén bien armadas
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6.a.- Crear un nuevo File University Program VWF
Ahí Insertamos nuestros nodos, en node finder, le damos list y seleccionamos “>>” para
seleccionar los nodos encontrados
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8.a.-Implementación de las 3 funciones
Aquí utilizamos nuestros archivos symbol files y unimos nuestras funciones
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9.a.-Simulación
Aquí podemos ver la simulación de nuestras funciones con la respectiva salida en un formato decimal
que podemos comparar con nuestros cálculos
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10.a.- Comparación de los resultados con los obtenidos en clase
a b c F1 F2 F3 DEC
0 0 0 1 1 0 3
0 0 1 1 0 1 5
0 1 0 1 1 1 7
0 1 1 1 0 0 1
1 0 0 0 1 0 2
1 0 1 1 1 1 7
1 1 0 0 1 1 6
1 1 1 0 1 1 6
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Practica 2 B
A partir de las siguientes funciones lógicas implántelas dentro del ambiente gráfico de la plataforma
Quartus II de Altera
• 𝐹1(𝑥𝑦𝑧) = 𝑥(𝑥̅ + 𝑦𝑧̅ + 𝑧) POS
0+ 𝑥𝑦𝑧̅ + 𝑥𝑧= 𝑥𝑦𝑧̅ + 𝑥𝑧
𝐹1(𝑥𝑦𝑧) = (𝑥̅ + 𝑦) + 𝑧)(𝑥̅ + 𝑧̅)
𝐹3(𝑎𝑏𝑐) = 8(7,8,6)
x y z F1
0 0 0 1
0 0 1 1
0 1 0 1
0 1 1 1
1 0 0 1
1 0 1 0
1 1 0 0
1 1 1 0
• 𝐹3(𝑥𝑦𝑧) = )))
𝑥𝑦 + 𝑥⨁𝑦) POS
• 𝑥𝑦 + (𝑥𝑦) + (𝑥̅ 𝑦)
𝐹3(𝑥𝑦𝑧) = )))
• 𝑥𝑦 + (𝑥𝑦)
𝐹3(𝑥𝑦𝑧) = )))
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x y z F3
0 0 0 1
0 0 1 1
0 1 0 0
0 1 1 0
1 0 0 0
1 0 1 0
1 1 0 0
1 1 1 1
x y z F1 F2 F3 F4 DECIMAL
0 0 0 1 0 1 0 10
0 0 1 1 0 1 1 11
0 1 0 1 1 0 0 12
0 1 1 1 1 0 1 13
1 0 0 1 0 0 0 08
1 0 1 0 0 0 1 1
1 1 0 0 1 1 0 2
1 1 1 0 0 1 1 3
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1.b.-Crear nuestra área de trabajo
Igual que en el anterior creamos nuestro proyecto o utilizamos el actual
3.b.-Compilación
Vemos que el circuito este bien armado
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4.b.- Creamos un nuevo File University Program VWF
Ahí Insertamos nuestros nodos, en node finder, le damos list y seleccionamos “>>” para seleccionar los
nodos encontrados
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5.b.- Condensar nuestras variables
Agrupamos nuestras entradas y salidas y les damos el valor de unsigned decimal para salida y binario
para entrada dependiendo de lo que quiera mostrar, en entradas le damos en la opción de count value
para crear nuestros valores que le daremos a las variables le damos 0 y 1 y en count every deacuerdo a
cuanto tiempo
6.a.-Simulación
Por útlimo damos en run Funcional simulation para ver resultados sean congruentes ya que no
consideramos la tiempos de respuesta, ya que si fuera en ese caso escogeriamos rum timing simulation
para una simulación temporal, guardaremos el archivo con la extensión vwf, e iniciará la compilación y
nos dará una ventana con los resultados finales de la simulación
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7.b.- Comparar nuestros resultados con los obtenidos
x y z F1 F2 F3 F4 DECIMAL
0 0 0 1 0 1 0 10
0 0 1 1 0 1 1 11
0 1 0 1 1 0 0 12
0 1 1 1 1 0 1 13
1 0 0 1 0 0 0 08
1 0 1 0 0 0 1 1
1 1 0 0 0 1 0 2
1 1 1 0 0 1 1 3
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Previo2:
Se puede decir que productos es la multiplicación booleana de variables o sus complementos. Cuando
dos o más productos se suman mediante la suma booleana, la expresión se llama suma de productos.
Producto de sumas
Cuando dos o más términos de suma se multiplican, la expresión resultante recibe el nombre de
producto de sumas.
De las siguientes expresiones, deduce las formas sop y pos canónicas para cada una de ellas.
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F(abcd)=(a + b) (c+ d)(a +c + d) Forma POS
)))) + (cd
F(abcd)=(ab )))) + (a c d
)))))))) Forma SOP
Conclusiones
En resumidas cuentas utilizando el simulador Quartus II se pudo entender y hacer más simple cada
función, en comparación del segundo ejercio pudimos comparar los procedimientos y herramientas que
se utilizaron en Quartus II ya que armamos en un 1 solo diagrama todas la funciones, pude entender que
es un poco más dificil pero menos tardado. Me di cuenta de como podemos utilizar la forma POS ó la
forma SOP en cada uno de los casos aunque en mi opinión se me facilitó más la forma SOP, pudimos
comparar todos nuestros resultados en simulaciones y con nuestros cálculos y resultaron ser los mismos
por lo que se planteraron bien la solcuiones. Finalmente se puede concluir que está práctica fue de mucha
ayuda para entender un poco más de la materia y del simulador, ya que son elementos principales que
seguiremos ocupando durante el curso y que necesitamos comprender para poder aplicarlos en un futuro.
Referencias
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