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UNIDAD V
FLIP-FLOPS
1. LATCHES
Para estos Latchs las entradas son los terminales “ S “ Set y “ R “ Reset y las
salidas “ Q “ y “ Q’ “ . Podemos describir su funcionamiento de acuerdo a la
siguiente tabla que nos muestra su funcionamiento para el caso (b):
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Electrónica Digital TECSUP – PFR
Los símbolos lógicos para los casos (a) y (b) se muestran en las figuras
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TECSUP – PFR Electrónica Digital
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Los Flip-Flops son dispositivos biestables síncronos. Esto significa que los
cambios en la salida se producen sincronizadamente con los pulsos de control en
la entrada de reloj.
Un Flip-Flop disparado por flanco cambia de estado con el flanco positivo ( flanco
de subida ) o con el flanco negativo ( flanco de bajada ) del impulso de reloj y es
sensible a sus entradas sólo en esta transición del reloj.
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TECSUP – PFR Electrónica Digital
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Tenemos también al CI 7476 , presenta dos flip-flops pero disparados por flanco
negativo, con entradas de Preset y Clear activadas con nivel bajo.
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4. CARACTERÍSTICAS DE OPERACIÓN
(a)
(b)
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5. APLICACIONES
Usaremos un flip-flop del tipo JK con disparo en el flanco Negativo y con entrada
asíncrona de SET (para usar esta entrada, la conectaremos a fuente para
desactivarla ), el esquema de sus terminales físicos se muestra a continuación y
corresponde al CI 74113
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Nótese que las salidas de los dos flip-flops QA y QB cambian en los flancos de
bajada de la señal de reloj, como el mostrado al inicio con una flecha. Y que
efectivamente para QA la duración de la señal es el doble del de la señal de
reloj y para QB la duración es el doble del tiempo de QA y el cuádruple del de la
señal de reloj:
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Para esta implementación estamos usando tres flip-flops por tanto la cuenta
llegará hasta 2 n donde “n” toma el valor de 3.
El diagrama de tiempos es :
Nótese que la cuenta empieza con el primer flanco de bajada de la señal de reloj.
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