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Tema8 PDF
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Una colección de dos o más biestables D con una entrada común se conoce
como un registro. Los registros se usan para almacenar una serie de bits
relacionados, como un byte (8 bits) de una computadora.
La figura muestra un registro de 3 bits. La palabra A[0-2] solo aparece en
la salida Q[0-2], si se produce el disparo del biestable, mediante el flanco
de subida del reloj CLK:
A0 A1 A2
CLK
D Q D Q D Q
Q0 Q1 Q2
Registros de Desplazamiento
D Q D Q D Q D Q
CLK Q CLK Q CLK Q CLK Q
CLR CLR CLR CLR
CLR Salida de
Datos Serie
CLK
Registros y Contadores 2
Salidas
ABCD
CLR = 0 0000
CLR = 1 / 1er Pulso de CLK 1000
CLR = 1 / 2º Pulso de CLK 0100
CLR = 1 / 3er Pulso de CLK 1010
CLR = 1 / 4º Pulso de CLK 0101
Salidas Serie
D
CLR = 1 / 4º Pulso de CLK 1
CLR = 1 / 5º Pulso de CLK 0
CLR = 1 / 6º Pulso de CLK 1
CLR = 1 / 7º Pulso de CLK 0
Un registro de este tipo carga todos los bits al mismo tiempo, con lo que no
es necesario esperar muchos pulsos de reloj para obtener la información.
El siguiente circuito es un registro de desplazamiento de 4 bits de carga
paralelo y desplazamiento a la derecha:
Salida de Datos Paralelo
A B C D
Carga de
Datos Paralelo
D
C
B
A
PR PR PR PR
J J J J
Q Q Q Q
CLK CLK CLK CLK
Q Q Q Q
K CLR K CLR K CLR K CLR
CLR
CLK
Los datos se cargan por el PRESET de cada biestable (se trata de una
entrada asíncrona). Veamos un ejemplo de cómo se realiza el registro y el
desplazamiento de un dato.
Vamos a cargar la palabra 0110:
Esta es la secuencia de funcionamiento
Salidas
ABCD
CLR = 0 0000
CLR = 1 0110
er
CLR = 1 / 1 Pulso de CLK 0011
CLR = 1 / 2º Pulso de CLK 1001
er
CLR = 1 / 3 Pulso de CLK 1100
CLR = 1 / 4º Pulso de CLK 0110
Se puede observar, que el dato se carga de forma asíncrona, y que antes del
primer pulso del reloj, el dato ya está registrado; lo que se hace de forma
síncrona es el desplazamiento a la derecha. Como se ve, se produce una
circulación de la palabra digital, de ahí que se conozcan estos registros
como recirculantes.
Registros y Contadores 4
A SRG4
QA
Carga B QB Salida
Paralelo C QC Paralelo
D QD
Reloj CLK
Borrado CLR
S0 S1
Control de
modo
Modo de operación S0 S1
Mantenimiento 0 0
Despl. Izquierda 0 1
Despl. Derecha 1 0
Carga paralelo 1 1
CONTADORES
1 1 1 Q
EN Q EN Q EN
CLK T Q T Q T Q
CBA 000
000
1er Pulso de CLK 001
2º Pulso de CLK 010 001
3er Pulso de CLK 011
4º Pulso de CLK 100
5º Pulso de CLK 101
6º Pulso de CLK 110
110
7º Pulso de CLK 111
8º Pulso de CLK 000
111
4/16 0
1 J
2 Q QA
QA 3 CLK
0 VCC Q QA’
QB 4 K
QC 5
A/D 3 6
7 J
8
Q QB
CLK
9 Q QB’
K
10
11
12 J
13 Q QC
CLK
14 Q QC’
GND EN 15 K
CLK
Registros y Contadores 7
Estados Q1 Q0
1/1 D A 0 0
0/0 B 0 1
0/1 A C 1 0
C 1/1 D 1 1
1/0 1/0
B 0/1
Z = AX’ + DX + CX + BX’
D0 = AX + CX’ + DX’
D1 = BX’ + C + DX’
Registros y Contadores 8
CLK
A
X’
D
X
ECUACIONES: B SRG
Q3n+1 = AX’ + DX + BX X
Q2n+1 = AX A 1D Q3 = A
Q1n+1 = BX’ + CX X
Q2 = B
Q0n+1 = CX’ + DX’ B
X’ Q1 = C
C Q0 = D
X
C
X’
D
X’
Registros y Contadores 9
BA/Z
a XX/0
R CTR
XX/X h M1
b X1/1 XX/1
XX/1 X0/0
g
c n n
1X/1 D Q
0X/0
e
d
XX/0 XX/1
Estado Q2 Q1 Q0 Estado Q2 Q1 Q0
A 0 0 0 E 1 0 0
B 0 0 1 F 1 0 1
C 0 1 0 G 1 1 0
D 0 1 1 H 1 1 1
Registros y Contadores 10
Ya solo queda deducir D2, D1, D0, M1 y Z por el método que se quiera:
D2 = q2’
D1 = q1’q2’
D0 = q0q1
M1 (B,A,q2,q1,q0) = Σm(3,5,9,11,13,18,19,21,25,26,27,29)
Z (B,A,q2,q1,q0) = Σm(4,5,6,9,12,13,14,18,20,21,22,25,26,28,29,30)
Reset R CTR
M1
CLK
D0 Q0 Q0
1D
D1 Q1 Q1 M1
Q2
D2 Q2 Z
A
B
CIRCUITO
A PARA
B DISEÑAR