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Cdigo
EA-FR-7
Versin
Fecha
05-08-2014
Pgina 1 de 7
1. rea Disciplinar:
1.1.
Espacio Acadmico:
1.2. Ciclo
Fundamentacin
Procesadores
Profesionalizacin
1.3.
X
Ciclo y Ao
1.4.
1 semestre 2015
Cdigo
1.5. Grupo
1.7.
Nmero de Crditos
nfasis
1.6.
Tipo de Curso:
Terico
Prctico
Terico-Prctico
1.8.
Horas Trabajo
Independiente
Docente Responsable:
1.10. Nmero de
Estudiantes
1. Pregunta tica
2. Objetivo General
Conocer la arquitectura de los procesadores para posteriormente programarlos
para resolver diferentes problemticas a travs del uso de las interrupciones,
puertos de entrada y salida anlogos y digitales, entre otros.
3
5
4
EA-FR-7
Versin
Fecha
2.1.
Cdigo
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Objetivos Especficos
3.2. Nivel de
Desempe
o
Competencia
Indagacin y modelacin
Alto
3.3. Indicadores de
Competencia
Capacidad
para
resolver
problemas
usando
micro
procesadores.
Capacidad para disear un
Diseo de sistemas
Alto
Medio
pertinentes
de
comunicarse
dispositivos
digitales.
Contenidos
Temticos
Lenguaje de descripcin de
hardware para circuitos
integrados de muy alta
velocidad (VHDL)
Lgica de
transferencia entra
registros.
4.2.
Estrategias
pedaggica
s
Trabajo independiente
4.3. De
preparacin
Lecturas,
exposiciones,
talleres guiados y
laboratorios
guiados.
Lecturas,
exposiciones,
talleres guiados y
laboratorios
guiados.
4.4. De
resultado
s
Comprensin y
aprehensin de los
temas abordados
Comprensin y
aprehensin de los
temas abordados
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Contenidos
Temticos
4.2.
Lenguajes de
mquina de
procesadores.
Arquitectura
procesador.
de
un
Interfaces
Interrupciones
Estrategias
pedaggica
s
5. Unidad
5.1.
Comprensin y
aprehensin de los
temas abordados
Comprensin y
aprehensin de los
temas abordados
Comprensin y
aprehensin de los
temas abordados
Comprensin y
aprehensin de los
temas abordados
5.2.
del
Tema
docente
los
velocidad (VHDL).
Lgica de transferencia
de
Lenguaje de descripcin de
integrados de muy alta
velocidad (VHDL).
hardware para circuitos
4.4. De
resultado
s
Lenguaje de descripcin de
integrados de muy alta
Lecturas,
exposiciones,
talleres guiados
laboratorios
guiados.
Lecturas,
exposiciones,
talleres guiados
laboratorios
guiados.
Lecturas,
exposiciones,
talleres guiados
laboratorios
guiados.
Lecturas,
exposiciones,
talleres guiados
laboratorios
guiados.
Presentacin
anteriores.
hardware para circuitos
4.3. De
preparacin
Sema
na
Trabajo independiente
5. Unidad
5.1.
Sema
na
5.2.
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Tema
entra registros.
Primer Corte
Lgica de transferencia
entra registros.
Lenguajes de mquina
de procesadores.
Lenguajes de mquina
de procesadores.
Arquitectura de un
procesador.
Segundo Corte
10
Arquitectura de un
procesador.
11
5. Unidad
5.1.
Sema
na
Interfaces
12
Interfaces
13
Interrupciones
14
Interrupciones
15
Tercer corte
16
5.2.
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Fecha
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Tema
flotante.
Interfaces de entrada
Interfaces de salida
Interfaces bidireccionales
Interfaces programables
Jerarquizacin de interrupciones.
Interrupciones no enmascarables y
enmascarables. Generacin de
interrupciones desde interfaces.
Activaciones por interrupciones externas.
Activaciones por interrupciones internas:
desbordamiento de los temporizadores,
finalizacin de la escritura de memoria
interna, reset, etc
Evaluacin de los temas abordados
6. Evaluacin
6.1.
Corte
6.2.
Evaluaci
n
Primer corte
Actividades
de
evaluacin
Pruebas escritas
Prcticas de laboratorio
05-08-2014
6.3.
Parmetros de
evaluacin
Se aplicarn talleres
formular
problemas
y
de
comunicaciones digitales,
con base en los conceptos
adquiridos.
Se realizar evaluacin
continua
determinar
fin
si
de
el
estudiante
ha
desarrollado
las
6.4. Valor
porcentual
30%
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Fecha
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6. Evaluacin
6.1.
Corte
6.2.
Evaluaci
n
Segundo corte
Actividades
de
evaluacin
6.3.
Parmetros de
evaluacin
Pruebas escritas
Heteroevaluacin
Se aplicarn talleres
Prcticas de laboratorio
6.4. Valor
porcentual
30%
formular
problemas
y
de
comunicaciones digitales,
con base en los conceptos
adquiridos.
Se realizar evaluacin
continua
determinar
fin
si
de
el
estudiante
ha
desarrollado
las
Pruebas escritas
Heteroevaluacin
Se aplicarn talleres
Prcticas de laboratorio
Proyecto
formular
problemas
y
de
comunicaciones digitales,
con base en los conceptos
adquiridos.
Se realizar evaluacin
continua
determinar
fin
si
de
el
estudiante
ha
desarrollado
las
05-08-2014
40%
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Fecha
Pgina 7 de 7
6. Evaluacin
6.1.
Corte
6.2.
Evaluaci
n
Actividades
de
evaluacin
6.3.
Parmetros de
evaluacin
6.4. Valor
porcentual
Metodologa:
Autoevaluacin,
Coevaluacin,
Heteroevaluacin
Direcciones de Internet
8. E-mail
guillermo.valenciap@uniagustiniana.e
du.co
8.1.
3203368110
8.2.
8.3.
Estudios de postgrado:
Maestra en Telecomunicaciones
Telfono
05-08-2014